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公开(公告)号：KR100198419B1
公开(公告)日：1999-06-15
申请号：KR1019960064185
申请日：1996-12-11
IPC: H04L7/033
Abstract: 본 발명은 직각 상관기를 이용한 주파수/위상 잠김방식의 측모드 잠김방지 및 정위상 오차발생 감소를 실현한 클럭 추출 회로에 관한 것이다. 그 목적은 직각 상관기를 이용한 주파수/위상 잠김방식의 클럭 추출 회로에서 위상 잠김 루프의 신호와 주파수 잠김 루프의 신호가 서로 상쇄되어 발생하는 측모드 잠김현상을 방지하고, 주파수 잠김 루프 신호에 의한 과도한 오프셋 전압을 제거하여 온도, 신호패턴에 따른 추출 클럭위상 변화를 최소화하는 데에 있다. 그 특징은 직각 상관기를 이용한 주파수/위상 잠김방식의 클럭 추출 회로에 있어서, 상기 직각 상관기의 주파수/위상 이중 잠김 루프의 90°신호의 위상 검출기의 출력신호의 직류값을 검출하여 제어신호로 사용하고, 전압제어 발진기와 입력클럭 사이의 주파수 차에 비례하는 차 주파수 직류 신호를 입력받아, 상기 제어신호에 따라 상기 차 주파수 직류신호를 절체하되, 위상 잠김이 발생하지 않은 경우에는 상기 주파수 잠김 루프의 동작이 이루어지도록 닫히고, 위상 잠김 루프가 동작하는 경우에는 상기 주파수 잠김 루프가 상기 위상 잠김 루프에서 분리되는 동작을 하도록 열리는 스위치를 더 구비하는 데에 있다.
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公开(公告)号：KR100150360B1
公开(公告)日：1998-11-02
申请号：KR1019950055878
申请日：1995-12-23
Abstract: 본 발명은 마이크로파 신호의 위상을 전압 조정에 의해 연속적으로 360도 이상 변화시킬 수 있는 아날로그 위상 조정기에 관한 것이다.
본 발명에서 안출된 위상조정기는 반사형 위상조정기로서, 조정전압 범위 중간에서 직렬 공진하도록 구성된 바랙터 회로 두개(33, 34, 35, 36)가 동작 주파수의 0.25 파장 길이에 해당하는 전송로(37)를 사이에 두고 병렬로 연결되는 방식으로 반사를 위한 부하 회로가 구성된다. 본 발명에서는 전송로 저항 Z3(37)와 부하회로의 입력 정합 저항 Z3를 요구되는 위항 변화폭, 혹은 삽입 손실 값으로부터 결정할 수 있는 설계식을 제시하고, 구체적으로 구현 회로로서 90도 하이브리드 결합기를 이용한 두가지 방식의 위상조정기 회로를 고안하였다. 본 발명의 특징은 1단이 90도 하이브리드 결합기로 360도 이상의 위상변화폭을 갖도록 함으로써, 종래의 2단 이상 조정기에 비교하여 삽입손실이 월등히 적고, 회로 크기도 상대적으로 작은 장점이 있다.
본 발명의 위상 조정기는 기가비트급이 데이터신호를 수신할 때 클럭 추출 및 데이터 재생회로에서 클럭의 위상을 조정하는데 사용될 수 있고, 그외에도 위상 배열 안테나, MMIC 위상조정기 등에도 응용될 수 있다.-
公开(公告)号：KR1019980045933A
公开(公告)日：1998-09-15
申请号：KR1019960064185
申请日：1996-12-11
IPC: H04L7/033
Abstract: 본 발명은 직각 상관기를 이용한 주파수/위상 잠김방식의 측모드 잠김방지 및 정위상 오차발생 감소를 실현한 클럭 회로에 관한 것이다. 그 목적은 직각 상관기를 이용한 주파수/위상 잠김방식의 클럭 추출 회로에서 위상잠김 루프의 신호와 주파수 잠김 루프의 신호가 서로 상쇄되어 발생하는 측모드 잠김현상을 방지하고, 주파수 잠김루프 신호에 의한 과도한 오프셋 전압을 제거하기 위하여 온도, 신호패턴에 따른 추출 클럭 위항 변화를 최소화하는데 있다. 그 특징은 직각 상관기를 주파수/위상 잠김방식의 클럭 추출 회로에 있어서, 상기 직각 상관기의 주파수/위상 이중 잠김 루프의 90°신호의 위상 검출기의 출력신호의 직류값을 검출하여 제어신호로 사용하고, 전압제어 발진기와 입력클럭 사이의 주파수 차에 비례하는 차 주파수 직류신호를 입력받아, 상기 제어신호에 따라 상기 차 주파수 직류신호를 절체하되, 위상 잠김이 발생하지 않은 경우에는 상기 주파수 잠김 루프의 동작이 이루어지도록 닫히고, 위상 잠김 루프가 동작하는 경우에는 상기 주파수 잠김 루프가 상기 위상 잠김 루프에서 분리되는 동작을 하도록 열리는 스위치를 더 구비하는데에 있다.
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公开(公告)号：KR1019970004782B1
公开(公告)日：1997-04-03
申请号：KR1019940026532
申请日：1994-10-17
Abstract: The converter for converting MRZ-to-PRZ signal samples the gigabit class clock signal and is operated stably and made cheaply. The signal converter consists of a Lange mixer(61) which outputs the differentiate signal of NRZ signal and phase-reversed differentiate signal, a phase regulator(62) which adjusts the differentiate signal from the Lange mixer, a matching resistor(63) connected to Lange mixer, a bridge diode rectifier(60) connected to the matching resistor and which outputs the PRZ signal, and bias circuit(68) which provides dc voltage proper for rectification with negative dc bias voltage applied to the bridge diode rectifier.
Abstract translation: 用于转换MRZ到PRZ信号的转换器采样千兆级时钟信号，并且稳定运行并且成本低廉。 信号转换器由输出NRZ信号和相位差分信号的差分信号的Lange混频器（61），调整来自Lange混频器的差分信号的相位调节器（62），连接到 朗格混频器，连接到匹配电阻器并输出PRZ信号的桥式二极管整流器（60）以及提供用于整流的直流电压的偏置电路（68），其施加到桥式二极管整流器的负直流偏置电压。
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