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公开(公告)号：KR100183139B1
公开(公告)日：1999-05-01
申请号：KR1019950054001
申请日：1995-12-22
IPC: H04N21/236
CPC classification number: H04N21/23608 , H04N7/52 , H04N7/56 , H04N21/242 , H04N21/4344
Abstract: 본 발명은 동영상(MPEG Ⅱ) 비디오 스트림 6채널을 수용하여 가입자에게 서비스하기 위한 동영상 비디오 스트림 전송 시스템에 관한 것으로서, 가입자와 가까운 거리에 원격장치를 설치하여 MPEG Ⅱ 비디오 스트림 6채널을 DS3 신호로 다중 전송하기 위하여 1차로 MPEG Ⅱ 비디오 스트림을 6,464Mb/s(이하 6,5M로 표기) 프레임 신호를 생성하고, 그런 다음 3개의 6,5M 신호와 12비트의 프레임 정렬워드(Frame Alignment Word)와 유지보수 관련 MA 채널 및 기타 오버헤드를 20.1312Mb/s신호로 다중화 한후, 이 20.1312Mb/s 프레임 2개를 이용하면 DS3프레임을 구성함으로써 DS3프레임에 MPEG Ⅱ비디오 스트림 6개를 수용하여 가입자에게 전송할 수 있다.
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公开(公告)号：KR100164101B1
公开(公告)日：1998-12-15
申请号：KR1019940033805
申请日：1994-12-12
Abstract: 본 발명은 프레임 제어수단(1)과, 프레임 구성수단(2)과, 프레임 동기 검출수단(3)과, 제1 직/병렬 변환수단(4)을 구비하는 것을 특징으로 하여, 범용 로직 게이트를 이용하여 64Kb/s 신호 프레임을 구성함으로서 직렬 64Kb/s 채널을 이용하여 8비트 데이터를 송수신할 수 있고, 이에 따라 전체 회로의 단순화를 기할 수 있어 시스템의 유지, 보수, 관리를 용이하게 할 수 있는 특유의 효과가 있는 64Kb/s 신호 프레임 통신장치에 관한 것이다.
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公开(公告)号：KR100140174B1
公开(公告)日：1998-06-15
申请号：KR1019940027029
申请日：1994-10-21
Applicant: 한국전자통신연구원
IPC: H04N7/10
Abstract: 본 발명은 프레인 맵핑/디맵핑 장치에 관한 것으로, 광 케이블 티.브이.(CATV)망에서 가입자 접속/단말장치간 가입자망이 시분할 다중화기/폴링(TDM Polling)망인 경우 분배 센터에서 가입자에게 아날로그 전화 서비스(POTS)를 제공하기 위하여, 프레임을 정합하는 프레임 정합 수단(21); 타임 슬롯을 재배치하는 시그널링 변환 수단(22);타임 슬롯 제어 신호에 따라 타임 슬롯을 재배치하여 외부의 가입자들에게 전송하는 프레임 맵핑 수단(23);타임 슬롯 제어 신호에 따라 타임 슬롯을 재배치하여 디맵핑 프레임을 출력하는 프레임 디맵핑 수단(24);및 타입 슬롯 제어 신호를 출력하는 타임 슬롯 제어 수단(25)을 구비하여 가입자 용량이 증가하고, 적은 비용으로 가입자에게 아날로그 전화 서비스(POT)를 제공할 수 있는 효과가 있다.
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公开(公告)号：KR1019970057884A
公开(公告)日：1997-07-31
申请号：KR1019950054001
申请日：1995-12-22
IPC: H04N21/236
Abstract: 본 발명은 가입자와 가까운 거리에 원격장치를 설치하여 MPEG Ⅱ 비디오 스티림 6채널 DS3로 다중 전송을 하기위한 DS3 다중장치를 제공하는데 그 목적이 있다.
본 발명은 상기 목적을 달성하기 위해서 1단계로 MPEG Ⅱ 비디오 스트림을 6.46Mb/s(이하 6.5M로 표기)프레임 신호를 생성한다. 이 신호가 DS3 프레임에 수용될 수 있는 신호로 이루어지기 위해서 3개의 6.5를 20.1312Mb신호로 1차 다중화 한다. 이 20.1312Mb신호 프레임에는 3개의 6.5M 신호를 수용하며 12비트의 FAW(Frame Alignment Word)와 유지보수 관련 M＆A채널 및 기타 오버헤드로 구성된 프레임 구조를 갖는다. 이 20.1312Mb/s 프레임 2개를 이용하여 DS3 프레임을 구성함으로써 DS3 프레임에 MPEG Ⅱ 비디오 스트림 6개를 수용한다.-
公开(公告)号：KR1019960024998A
公开(公告)日：1996-07-20
申请号：KR1019940033805
申请日：1994-12-12
Abstract: 본 발명은 프레임 제어수단(1)과, 프레임 구성수단(2)과, 프레임 동기 검출수단(3)과, 제1직/병렬 변환수단(4)을 구비하는 것을 특징으로 하여, 범용 로직 게이트를 이용하여 64Kb/s 신호 프레임을 구성함으로서 직렬 64Kb/s 채널을 이용하여 8비트 데이타를 송수신할 수 있고, 이에 따라 전체 회로의 단순화를 기할 수 있어 시스템의 유지, 보수, 관리를 용이하게 할 수 있는 특유의 효과가 있는 64Kb/s신호 프레임 통신장치에 관한 것이다.
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Patent Agency Ranking
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公开(公告)号：KR1019950023029A
公开(公告)日：1995-07-28
申请号：KR1019930027296
申请日：1993-12-10
Abstract: 본 발명은 디지틀 광 CATV 시스템의 가입자 단말장치에서 기패된 리모콘으로 TV채널 선택, 스테레오 오디오 채널 선택, TV 오디오 모드 선택 및 PPV(Pay Per View)채널에 대한 패스워드 처리등을 제어하는 방법 및 데이타 포맷 구조에 관한 것으로, 상기와 같은 본 발명은 광CATV시스템에서 가입자 댁내에 있는 가입자 단말장치에서 리모콘 및 키패드를 이용하여 다음과 같은 기능 항목을 수행한다.
-TV32 채널중 2채널 선택 및 PPV 채널 패스워드 처리를 할 수 있다.
-스테레오 오디오 14채널중 1채널 선택 및 TV오디오 모드를 선택 처리할 수 있다.
-TV 채널 선택 정보와 관련한 데이타 포맷으로 TV1, TV2 채널선택 정보를 처리 수행한다.
-스테레오 오디오 채널 및 TV오디오 모드와 관련한 데이타 포맷으로 해당 데이타를 처리 수행한다.-
公开(公告)号：KR1019950001565B1
公开(公告)日：1995-02-25
申请号：KR1019910026042
申请日：1991-12-30
IPC: H04N7/10
Abstract: The circuit for providing the high transmission quality to the optical CATV subscriber includes a channel clock generator 4 of 44.736 MHz dependant clocks by delaying the dependant clock with constant time, a first signal processor determining the proper clock after diagnosing the transition time of one channel data and providing the processed DS3 channel data to the subscriber junction box as the channel 1 data, a second signal processor providing the channel 2 data to the subscriber junction box, and a third signal processor providing the stereo audio data channel signal as the channel 3 data to the subscriber junction box.
Abstract translation: 用于向光学CATV用户提供高传输质量的电路包括通过以固定时间延迟从属时钟的44.736MHz相关时钟的信道时钟发生器4，第一信号处理器在诊断一个信道数据的转换时间之后确定适当的时钟 以及将经处理的DS3信道数据作为信道1数据提供给用户接线盒，向用户接线盒提供信道2数据的第二信号处理器，以及提供立体声音频数据信道信号作为信道3数据的第三信号处理器 到订户接线盒。
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公开(公告)号：KR1019940017232A
公开(公告)日：1994-07-26
申请号：KR1019920026075
申请日：1992-12-29
IPC: H03L7/199
Abstract: 본 발명은 광 CATV의 동기 장치에 있어서, 아날로그 위상고정루프(PLL)를 이용한 고안정도 동기회로에 관한 것이다.
본 발명은, 동기 장치의 기준신호로 사용되는 표준신호로서 주신호와 예비신호를 입력받아 클럭을 추출하는 이중화된 표준신호 수신수단(1,11)과, 선로상에 장애에도 안정적으로 동작하기 위한 상기 이중화된 표준신호 수신수단(1,11)이 1 : 1 절체기능을 가지도록 주신호와 예비신호의 손실상태를 검출하는 이중화된 표준신호 손실 검출 수단(2,12)과, 상기 이중화된 표준신호 수신수단(1,11)에 연결되어 기준클럭의 손실을 검출하는 기준클럭 손실 검출수단(10)과, 상기 기준 클럭 손실 검출수단(10)에서 제공하는 제어신호에 따른 기준클럭을 선택하여 출력하는 이중화된 기준크럭 발생수단(C,D)과, 상기 이중호된 기준클럭 발생수단(C,D)의 출력을 입력받아 시스템 클럭을 발생시키는 이중화된 시스템 클럭 발생수단(A,B)과, 상기 이중화된 시스템 클럭 발생수단 (A,B)의 각각에 입력이 연결되어 상기 시스템 클럭 발생수단(A,B)의 위상동기 상태를 검출하여 동작모드를 결졍하는 동작모드 검출수단(17)과, 상기 동작모드 검출수단(17)의 출력을 제어신호로서 입력받아 상기 이중화된 시스템클럭 발생수단(A,B)의 두 출력중 안정된 클럭을 절체하여 최종적인 시스템 클럭을 출력하는 시스템 클럭 선택수단(20)을 구비한다.
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