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公开(公告)号：CN106571811A
公开(公告)日：2017-04-19
申请号：CN201510644885.3
申请日：2015-10-09
Applicant: 张伟林
Inventor： 张伟林
CPC classification number: H03L7/08 , G11B5/02 , G11B20/1024 , G11B2220/2508
Abstract: 本发明提供了一种适应于各种不同类型及用途高阻型数字鉴相器下规范性地设计同步补偿型三相马达同步控制电路的设计方案，内中同步补偿信号形成电路如图1所示，其工作原理如下说明：当a=1，即鉴相器检出到输入信号间存在着相差时标识2的与门形成上升边沿触发信号触发单稳态触发振荡器输出一个脉冲信号，而最终形成的同步补偿脉冲信号的时宽受到三个因素所决定的。一是单稳态脉冲信号的时宽，二是起始时刻被吞没了一个由标识4的延迟时间所决定的时宽，三是实际同步补偿脉冲信号的也受到INH信号维持时间所限定。
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公开(公告)号：CN106571804A
公开(公告)日：2017-04-19
申请号：CN201510644884.9
申请日：2015-10-09
Applicant: 张伟林
Inventor： 张伟林
IPC: H03K19/0175 , H03L7/085
CPC classification number: H03K19/018507 , H03L7/085
Abstract: 本发明是作为在申请中《标准化设计高阻型数字鉴相器的结构原理方案》这一发明专利对象鉴相器的标准型接口电路，其方框图为图1。电路的工作原理以INH为有效屏蔽方式为例说明如下：各个门电路是作为数字开关形式存在的，当INH即数字开关的控端信号为有效时各个开关处于断开状态，数字开关的输出为常态值。这个常态值作为配对n或p型场效应管开关的控端信号确保场效应管开关处于断开状态，即鉴相器输出为高阻态值。当INH为无效时各个开关处于导通状态，数字开关的输出根据其自身定义为输入信号的正相态值或反相态值。通过常态值与n或p型场效应管开关的配对特征确保二个场效应管开关中一个处于导通状态，另一个处于断开状态，实现鉴相器输出为相对应的“H”或“L”态值。
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公开(公告)号：CN106571804B
公开(公告)日：2023-08-11
申请号：CN201510644884.9
申请日：2015-10-09
Applicant: 张伟林
Inventor： 张伟林
IPC: H03K19/0175 , H03L7/085
Abstract: 本发明是作为在申请中《标准化设计高阻型数字鉴相器的结构原理方案》这一发明专利对象鉴相器的标准型接口电路。电路的工作原理以INH为有效屏蔽方式为例说明如下：各个门电路是作为数字开关形式存在的，当INH即数字开关的控端信号为有效时各个开关处于断开状态，数字开关的输出为常态值。这个常态值作为配对n或p型场效应管开关的控端信号确保场效应管开关处于断开状态，即鉴相器输出为高阻态值。当INH为无效时各个开关处于导通状态，数字开关的输出根据其自身定义为输入信号的正相态值或反相态值。通过常态值与n或p型场效应管开关的配对特征确保二个场效应管开关中一个处于导通状态，另一个处于断开状态，实现鉴相器输出为相对应的“H”或“L”态值。
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公开(公告)号：CN106571811B
公开(公告)日：2023-06-02
申请号：CN201510644885.3
申请日：2015-10-09
Applicant: 张伟林
Inventor： 张伟林
Abstract: 本发明提供了一种适应于各种不同类型及用途高阻型数字鉴相器下规范性地设计同步补偿型三相马达同步控制电路的设计方案，内中同步补偿信号形成电路，其工作原理如下说明：当a=1，即鉴相器检出到输入信号间存在着相差时标识2的与门形成上升边沿触发信号触发单稳态触发振荡器输出一个脉冲信号，而最终形成的同步补偿脉冲信号的时宽受到三个因素所决定的。一是单稳态脉冲信号的时宽，二是起始时刻被吞没了一个由标识4的延迟时间所决定的时宽，三是实际同步补偿脉冲信号的也受到INH信号维持时间所限定。
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Patent Agency Ranking
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公开(公告)号：CN112350719A
公开(公告)日：2021-02-09
申请号：CN201910727510.1
申请日：2019-08-07
Applicant: 张伟林
Inventor： 张伟林
Abstract: 本发明案的锁相环中来自VCO的锁相环输入输出信号及VCO输出信号属于三个不同器件的输出信号，处在锁相环锁定状态下的锁相环外部输入信号与锁相环输出信号呈正交关系，尽管鉴相器即锁相环的二个输入信号依旧保持着鉴相器原有的同步同相关系。有关锁定状态下锁相环的二个输入信号Wr,Wc，输出信号Wout与VCO输出信号Wvco的时序工作关系如图所示，其中锁相环外部输入信号与锁相环输出信号呈正交关系，内中外部输入信号并无等占空比的限制条件，方便说明起见采用了等占空比信号的样例。
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公开(公告)号：CN111865301A
公开(公告)日：2020-10-30
申请号：CN201910346867.5
申请日：2019-04-27
Applicant: 张伟林
Inventor： 张伟林
Abstract: 本技术提供了一种适应于各种不同类型及用途的高阻型数字鉴相器针对时滞型VCO组环锁相环作同步补偿同步控制电路一个标准化设计方案，有着以下特征：1.控端信号直接取自于鉴相器输出信号；2.最大补偿时宽受制于一个人为设定时宽；3.实际补偿时宽在最大补偿时宽约束下受制于鉴相器输出的相位误差信号；4.正相补偿与反相回调补偿的时宽有着不等性；5.设置补偿不作用窗口，反相回调补偿窗口大于正相补偿窗口作为锁相环自主锁定窗口期。
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公开(公告)号：CN106656169A
公开(公告)日：2017-05-10
申请号：CN201510645127.3
申请日：2015-11-03
Applicant: 张伟林
Inventor： 张伟林
IPC: H03L7/085
Abstract: 图1所示本发明《全自动锁定工作状态的高阻型数字鉴相器》的高阻型数字鉴相器内部电路方框图，其工作原理说明如下：初态后另一输入信号加入，如果高阻态输出电平不在电平窗口比较器内时由于标识5的输出为“1”，则cp有计数脉冲输入，调整DAC的输出电平值直至标识5的输出为“0”；此时由于cp无计数脉冲输入则DAC的输出电平值保持在一个固定的值上，最终通过LF的调整，将高阻态输出电平锁定在[V2,V1]内的同步工作状态。反之，高阻态输出电平在电平窗口比较器内时由于标识5的输出为“0”直接cp无计数脉冲输入，经过LF调整将高阻态输出电平锁定在[V2,V1]内的同步工作状态。
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