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公开(公告)号：CN109658959A
公开(公告)日：2019-04-19
申请号：CN201810755948.6
申请日：2018-07-11
Applicant: 格芯公司
Inventor： A·桑卡尔 , 凡卡崔汉文·宾维杰亚拉梵
IPC: G11C11/34
Abstract: 本发明涉及混合堆叠写驱动器，其中，一种电路包括具有存储器单元及位线的存储器阵列。写驱动器通过列选择晶体管与该位线连接。写辅助电路与该写驱动器连接。该写辅助电路包括共同升压节点、负升压晶体管、以及保持晶体管。该负升压晶体管自该数字线连接至该共同升压节点。在针对该存储器阵列的选定单元的写操作期间，该负升压晶体管将该存储器阵列的该选定单元的该位线选择性拉至地。该写辅助电路可包括自第一数字线连接至该共同升压节点的第一负升压晶体管，自第二数字线连接至该共同升压节点的第二负升压晶体管，以及自该共同升压节点连接至地的保持晶体管。
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