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公开(公告)号：CN118609617A
公开(公告)日：2024-09-06
申请号：CN202311353829.5
申请日：2023-10-18
Applicant: 三星电子株式会社
Abstract: 公开了一种操作与外部电子设备通信的电子设备的方法。该方法包括：加载包括至少一个第一条件比特、第一有效比特和第二有效比特的第一用户数据；参考电子设备的转换表中与至少一个第一条件比特相对应的目标转换规则，基于第一用户数据来生成第一中间数据和第二中间数据，与第一中间数据相对应的第一功率值和与第二中间数据相对应的第二功率值之和小于或等于功率阈值；通过对第一中间数据执行第一编码来生成第一符号数据；通过对第二中间数据执行第二编码来生成第二符号数据；以及提供包括第一符号数据和第二符号数据的第一编码数据。
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公开(公告)号：CN118367931A
公开(公告)日：2024-07-19
申请号：CN202311373412.5
申请日：2023-10-23
Applicant: 三星电子株式会社
Abstract: 提供模数转换电路及对其操作电压进行校正的方法。所述模数转换电路包括：模数转换器(ADC)，被配置为从外部源接收输入信号和第一时钟信号，并且输出第二时钟信号和数字输出信号；决策计数器，被配置为每当从模数转换器接收的第二时钟信号被施加到决策计数器时使决策计数值递增；电压控制逻辑，被配置为基于将决策计数值与参考计数值进行比较的结果来输出控制信号；以及调节器，被配置为输出操作电压，其中，ADC被配置为调整第二时钟信号的周期，并且电压控制逻辑被配置为经由控制信号来控制调节器输出校正后的操作电压。
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公开(公告)号：CN117012247A
公开(公告)日：2023-11-07
申请号：CN202310489341.9
申请日：2023-05-04
Applicant: 三星电子株式会社
IPC: G11C11/4076 , G11C11/4078 , G11C29/02
Abstract: 提供一种半导体存储器件。所述半导体存储器件包括：数据时钟缓冲器，其从存储器控制器接收数据时钟信号并且输出一对差分输入信号；边沿延迟控制器，其基于控制代码来调节所述一对差分输入信号的占空比，并且输出一对经校正时钟信号；第一单位延迟路径电路，其基于所述一对经校正时钟信号来生成具有不同相位的四个输出时钟信号；上升沿多路选择器，其串行地输出与所述四个输出时钟信号中的每一个输出时钟信号的上升沿对应的数据；第二单位延迟路径电路，其基于所述一对经校正时钟信号来生成具有不同相位的四个副本时钟信号；以及正交误差校正电路检测器，其基于所述副本时钟信号来检测占空误差，并且输出控制代码。
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公开(公告)号：CN115881182A
公开(公告)日：2023-03-31
申请号：CN202211184051.5
申请日：2022-09-27
Applicant: 三星电子株式会社
IPC: G11C7/22 , G11C11/4076
Abstract: 一种相位校正电路包括接收输入时钟信号并将输入时钟信号延迟第一延迟时间那么长以将输出时钟信号输出到第0节点的延迟电路、第一微调电路和第二微调电路。第一微调电路包括与第0节点连接的第一端子、接收第一控制信号的第二端子、以及第三端子，并且第二微调电路包括与第三端子连接的第四端子、接收第二控制信号的第五端子以及与负载电容器连接的第六端子。响应于第一控制信号，输出时钟信号可以被进一步延迟第二延迟时间那么长，第二延迟时间比第一延迟时间短。响应于第二控制信号，输出时钟信号可以被提前第三延迟时间那么长，第三延迟时间比第一延迟时间短。
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公开(公告)号：CN115412065A
公开(公告)日：2022-11-29
申请号：CN202210588615.5
申请日：2022-05-26
Applicant: 三星电子株式会社
Abstract: 提供了一种发射器电路、选择电路和操作选择电路的方法。发射器电路包括：时钟生成器，其被配置为生成具有不同相位的多个时钟信号；以及多个选择电路，其被配置为接收多个并行数据信号，以及基于多个时钟信号和接收的多个并行数据信号在输出节点输出串行数据信号。多个选择电路中的每一个包括：数据多路复用器，其被配置为基于多个并行数据信号中的接收到的一个和多个时钟信号生成多个数据选择信号；控制信号生成器，其被配置为基于多个数据选择信号生成第一控制信号和第二控制信号；以及输出驱动器，其连接至输出节点，并且被配置为：基于第一控制信号为输出节点预充电，或者基于第二控制信号将输出节点放电。
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Patent Agency Ranking
公开(公告)号：CN115408325A
公开(公告)日：2022-11-29
申请号：CN202210550849.0
申请日：2022-05-18
Applicant: 三星电子株式会社
Abstract: 提供了一种接收并行信号并且响应于并行信号而输出串行信号的发送器电路及其操作方法。所述发送器电路可以包括：时钟生成器，其生成具有各自不同的相位的第一时钟信号；复用器，其包括选择电路，所述选择电路分别被配置为响应于第一时钟信号中的至少两个而将并行信号中的至少两个选择性地提供到输出节点；以及输出驱动器，其通过放大输出节点处的信号来生成串行信号。
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公开(公告)号：CN114464226A
公开(公告)日：2022-05-10
申请号：CN202111259448.1
申请日：2021-10-27
Applicant: 三星电子株式会社
IPC: G11C11/406 , G11C11/15
Abstract: 提供了一种改进了时钟信号的可靠性的存储器件。该存储器件包括数据模块，该数据模块包括：时钟信号发生器，被配置为从缓冲器接收内部时钟信号，并基于内部时钟信号生成具有不同相位的第一内部时钟信号、第二内部时钟信号、第三内部时钟信号和第四内部时钟信号；以及第一数据信号发生器，被配置为基于第一数据和第一内部时钟信号生成第一数据信号，基于第二数据和第二内部时钟信号生成第二数据信号，基于第三数据和第三内部时钟信号生成第三数据信号，以及基于第四数据和第四内部时钟信号生成第四数据信号。
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公开(公告)号：CN114203216A
公开(公告)日：2022-03-18
申请号：CN202110664944.9
申请日：2021-06-16
Applicant: 三星电子株式会社
Abstract: 公开了多电平信号接收器和包括多电平信号接收器的存储器系统。所述多电平信号接收器包括其中具有M‑1个感测放大器的数据采样器，所述M‑1个感测放大器被配置为将具有M个电压电平中的一个的多电平信号与M‑1个参考电压进行比较，从而生成M‑1个比较信号。数据采样器还被配置为生成包括N个位的目标数据信号，M是大于二的整数，并且N是大于一的整数。提供了均衡控制器，被配置为通过以下操作训练所述M‑1个感测放大器：基于所述M‑1个比较信号的均衡值，(i)在第一训练模式期间调整M‑1个电压区间中的至少一个，和(ii)在第二训练模式期间调整所述M‑1个参考电压的电平，所述M‑1个电压区间中的每个表示所述M个电压电平之中的两个相邻的电压电平之间的差。
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公开(公告)号：CN114155894A
公开(公告)日：2022-03-08
申请号：CN202111048370.9
申请日：2021-09-08
Applicant: 三星电子株式会社
IPC: G11C11/4076 , G11C7/22
Abstract: 提供的存储设备可以将脉冲幅度调制方法应用于数据(DQ)信号发送/接收，并且可以根据操作频率条件缩放DQ信号，从而提高数据传输性能并有效地改进功耗。存储设备包括存储单元阵列和数据输入/输出电路，数据输入/输出电路被配置为缩放包括从存储单元阵列读取的数据的DQ信号，并输出缩放DQ信号。数据输入/输出电路被配置为利用对应于操作频率条件的DQ参数基于n电平脉冲幅度调制(PAMn)(其中n是4或更大的整数)来缩放DQ信号并输出DQ信号。其他方面包括与存储设备通信的存储控制器，以及包括存储设备和存储控制器的存储系统。
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