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公开(公告)号:FR3064136A1
公开(公告)日:2018-09-21
申请号:FR1752066
申请日:2017-03-14
Applicant: ST MICROELECTRONICS ROUSSET
Inventor: MARTINEZ ALBERT
IPC: H03K19/173 , H03K5/06
Abstract: L'invention concerne un élément retardateur (8), comportant : une première porte logique de type OU Exclusif (82), dont une première entrée (C) définit une borne d'entrée (83) de l'élément ; et une deuxième porte logique de type OU Exclusif (84) dont une première entrée (C) est connectée en sortie de la première porte et dont une sortie définit une borne de sortie (85) de l'élément, des deuxièmes entrées (D) des deux portes étant interconnectées à une deuxième borne d'entrée (87) de l'élément.
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公开(公告)号:FR2987171A1
公开(公告)日:2013-08-23
申请号:FR1251597
申请日:2012-02-22
Applicant: ST MICROELECTRONICS ROUSSET
Inventor: MARTINEZ ALBERT , FORNARA PASCAL
Abstract: Un ensemble thermiquement déformable (ENS1) est réalisé au sein d'un niveau de métallisation de circuit intégré, et on utilise le comportement physique du métal formant cet ensemble thermiquement déformable (ENS1) soumis à une variation de température provoqué par le passage d'un courant, de façon à venir placer cet ensemble en contact avec un corps formant butée (CPS1) sans qu'il y ait de retour naturel possible à la configuration initiale (dans laquelle l'ensemble est à distance du corps) et de pouvoir déterminer très simplement l'état ou la configuration dans laquelle se trouve l'ensemble par une lecture capacitive (DCP, CLC).
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公开(公告)号:FR2935056A1
公开(公告)日:2010-02-19
申请号:FR0804593
申请日:2008-08-14
Applicant: ST MICROELECTRONICS ROUSSET
Inventor: MARTINEZ ALBERT
Abstract: L'invention concerne un procédé d'acheminement de données entre une unité émettrice (TU1, TU2) et une unité destinataire (RU1, RU2) reliées par un réseau (ADB) dans un système de traitement (PS1) comportant plusieurs unités, le procédé comprenant des étapes d'acheminement des données dans le réseau entre l'unité émettrice et l'unité destination, et d'application d'un traitement aux données acheminées, le traitement comprenant plusieurs étapes qui sont appliquées aux données par différentes unités (DPU1-DPU5) du réseau recevant les données, pour exploiter des temps de latence d'acheminement des données.
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