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公开(公告)号：KR1019950012320B1
公开(公告)日：1995-10-16
申请号：KR1019920004383
申请日：1992-03-17
IPC: H04L12/28
Abstract: The device comprises a video connecting unit for connecting an image signal; a first pre-input/pre-output unit for storing the image information in connection with the video connecting unit; a second pre-input unit for storing ATM adaptation layer-service data unit transmitted from the first pre-input/pre-output unit and a dividing and recoupling header, transmitting ATM layer adaptation layer-protocol data unit to the ATM layer, or dividing the ATM layer adaptation layer-protocol data unit into the header and the ATM adaptation layer-service data unit; a buffer controlling unit for monitoring the storage state in connection with the first and second pre-input unit and controlling the pre-output unit; a first counting unit for counting a count driving signal outputted from the buffer controlling unit; a division and recouple header generating unit for receiving the count signal and transmitting the dividing and recoupling header to the second pre-input unit; a division and recouple header detecting unit for receiving the output of the first counting unit and detecting the dividing and recoupling header among data transmitted from the division and recouple header generating unit and the second pre-input unit; and an image data compensating unit for compensating a damage data by checking an output order number of the division and recouple header detecting unit and transmitting the compensated data to the second pre-input unit.
Abstract translation: 该装置包括用于连接图像信号的视频连接单元; 第一预输入/预输出单元，用于存储与视频连接单元相关联的图像信息; 用于存储从第一预输入/预输出单元发送的ATM适配层服务数据单元的第二预输入单元和分配和重新耦合报头，将ATM层适配层协议数据单元发送到ATM层，或划分 ATM层适配层协议数据单元转换成报头和ATM适配层业务数据单元; 缓冲器控制单元，用于监视与第一和第二预输入单元相关的存储状态并控制预输出单元; 第一计数单元，用于对从缓冲器控制单元输出的计数驱动信号进行计数; 分割和补充标题生成单元，用于接收所述计数信号，并将所述分割和重新耦合报头发送到所述第二预输入单元; 分割和补充标题检测单元，用于接收第一计数单元的输出，并检测从分割和再匹配标题生成单元和第二预输入单元发送的数据中的分割和重新耦合报头; 以及图像数据补偿单元，用于通过检查分割的输出顺序号和重新匹配标题检测单元来补偿损伤数据，并将补偿的数据发送到第二预输入单元。
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公开(公告)号：KR100249502B1
公开(公告)日：2000-03-15
申请号：KR1019970073018
申请日：1997-12-24
Applicant: 한국전자통신연구원
IPC: H04L12/28
Abstract: 1. 청구범위에 기재된 발명이 속하는 기술분야
본 발명은 LAN 카드의 TCP/IP 가속 장치 및 방법에 관한 것임.
2. 발명이 해결하고자하는 기술적 요지
본 발명은 이더넷 LAN 환경에서 사용되는 LAN의 내부에 이더 타입에 따른 상위 계층 패킷의 분류기능과 TCP/IP의 일부기능을 내장하여, 고속 환경하에서 통신에 응용될 수 있는 TCP/IP 가속 장치 및 방법을 제공하는데 그 목적이 있다.
3. 발명의 해결 방법의 요지
본 발명은 입력된 데이터의 이더 프레임 형태를 구분하여 제어신호 및 인터넷 프로토콜 처리를 위한 정보를 출력하는 전방 처리수단; 전송 제어 프로토콜 처리를 위한 정보 및 동작 완료를 위한 신호를 출력하는 인터넷 프로토콜 처리수단; 및 동작 완료를 위한 신호 및 상태 레지스터 비트값을 출력하는 전송 제어 프로토콜 처리수단을 포함한다.
4. 발명의 중요한 용도
본 발명은 고속의 LAN 환경에서 주요 병목이 되고 있는 TCP/IP 동작을 고속화하는데 이용됨.-
公开(公告)号：KR100233244B1
公开(公告)日：1999-12-01
申请号：KR1019970032145
申请日：1997-07-10
Applicant: 한국전자통신연구원
CPC classification number: H04L12/2801 , H04L2012/5664 , H04L2012/5671 , H04L2012/5672
Abstract: 1. 청구범위에 기재된 발명이 속한 기술분야
본 발명은 다수의 스트림을 수용하는 운송스트림 다중화 장치에 관한 것임.
2. 발명이 해결하려고 하는 기술적 과제
본 발명은, PCI 버스를 이용해 인코더들과 다중 운송스트림 장치간의 인터페이스를 간단히 하여 각 인코더들로부터 전송되는 다수의 PES 스트림들을 하나의 운송스트림 장치에서 다중화하는 운송스트림 다중화 장치를 제공하고자 함.
3. 발명의 해결방법의 요지
본 발명은, PCI 버스를 통하여 전송되는 복수의 스트림들을 각각 구분하여 전송하는 PCI 인터페이스 처리부; 선택 및 입력신호와 전송제어신호를 출력하는 제어신호 처리부; 페이로드를 출력하는 미디어 버퍼부; 패킷 출력에 필요한 타이밍 신호를 출력하는 타이머 처리부; 운송스트림 헤더 출력신호를 출력하는 다중화 제어부; 운송스트림 헤더 출력신호에 따라 헤더 데이터를 출력하는 운송스트림 헤더 처리부; 및 운송스트림 패킷과 운송스트림 페이로드를 입력받아 다중화하여 운송스트림 패킷을 출력하는 다중화부를 포함한다.
4. 발명의 중요한 용도
본 발명은 ATM망의 멀티미디어 통신에 이용됨.-
公开(公告)号：KR1019990009675A
公开(公告)日：1999-02-05
申请号：KR1019970032145
申请日：1997-07-10
Applicant: 한국전자통신연구원
Abstract: 1. 청구범위에 기재된 발명이 속한 기술분야
본 발명은 다수의 스트림을 수용하는 운송스트림 다중화 장치에 관한 것임.
2. 발명이 해결하려고 하는 기술적 과제
본 발명은, PCI 버스를 이용해 인코더들과 다중 운송스트림 장치간의 인터페이스를 간단히 하여 각 인코더들로부터 전송되는 다수의 PES 스트림들을 하나의 운송스트림 장치에서 다중화하는 운송스트림 다중화 장치를 제공하고자 함.
3. 발명의 해결방법의 요지
본 발명은, PCI 버스를 통하여 전송되는 복수의 스트림들을 각각 구분하여 전송하는 PCI 인터페이스 처리부; 선택 및 입력신호와 전송제어신호를 출력하는 제어신호 처리부; 페이로드를 출력하는 미디어 버퍼부; 패킷 출력에 필요한 타이밍 신호를 출력하는 타이머 처리부; 운송스트림 헤더 출력신호를 출력하는 다중화 제어부; 운송스트림 헤더 출력신호에 따라 헤더 데이터를 출력하는 운송스트림 헤더 처리부; 및 운송스트림 패킷과 운송스트림 페이로드를 입력받아 다중화하여 운송스트림 패킷을 출력하는 다중화부를 포함한다.
4. 발명의 중요한 용도
본 발명은 ATM망의 멀티미디어 통신에 이용됨.-
公开(公告)号：KR100153919B1
公开(公告)日：1998-11-16
申请号：KR1019950055906
申请日：1995-12-23
IPC: H04L12/28
Abstract: 본 발명은 ATM망을 통하여 전송되어 오는 ATM 셀들로 부터 MPEG 운송 스트림을 복원하기 위한 장치에 관한 것으로, ATM 버퍼링부(12); 망 정합 복원 제어부(11); ATM 셀 분리부(13); ATM 헤더 점검부(14); AAL5_PDU 분리부(15); 트레일러 점검부(16); 및 운송 스트림 버퍼링부(17)를 구비하고, MPEG-2 시스템으로 부터 제공되는 운송 스트림이 실시간으로 ATM 망을 통하여 수신될 때, ATM 망과 운송 스트림 역다중화기와의 정합을 시킬 수 있는 기능을 제공하므로 다양한 비트율을 갖는 MPEG 비디오, 오디오 서비스를 수용할 수 있는 효과가 있다.
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Patent Agency Ranking
公开(公告)号：KR1019980039219A
公开(公告)日：1998-08-17
申请号：KR1019960058214
申请日：1996-11-27
IPC: H04L12/18
Abstract: 본 발명은 MPEG-2 비디오 및 MPEG-1 오디오 인코더로 부터 제공되는 가변길이의 단위 PES에 대하여 시작 코드를 검출하여 이를 TS 헤더에 표시하므로 수신부에서 단위 PES를 복원하는 기능과 단위 PES의 길이를 184 바이트 단위로 고정화하여 처리하는 가변 길이를 같은 PES에 대한 TS 계층의 동기 장치에 관한 것으로,상위의 MPEG 비디오/오디오 인코더로 부터 제공되는 가변 PES를 버퍼로 부터 출력하도록 제어하는 PES 입력 신호 제어 수단과, 입력되는 가변 PES로 부터 PES 데이타를 184바이트의 TS 페이로드 단위로 정렬하여 출력하는 가변 PES 데이타 처리수단과, 입력되는 PES 데이타에 대하여 PES 시작 코드의 검출하여 이를 입출력 제어를 위하여 통보하는 PES 시작 코드 검출 수단과, 검출된 PES 시작 코드 신호로 부터 출력을 184 바이트의 TS페이로드 형태로 정렬시키기 위한 PES 동기 제어 처리수단과, 정렬된 PES_PDU를 저장하는 버퍼 수단으로 구성된다.
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公开(公告)号：KR1019980027419A
公开(公告)日：1998-07-15
申请号：KR1019960046202
申请日：1996-10-16
IPC: H04L12/56
Abstract: 본 발명은 ATM 망 정합을 위한 엠펙(Moving Picture Expert Group : 이하, MPEG 이라고 한다)-2 TS 다중화 장치에 관한 것으로, 특히 MPEG-2 비디오, MPEG-1 오디오 신호를 실시간으로 전송하기 위하여 다중화한 후 이를 ATM 망에 정합시키는 ATM 망 정합을 위한 MPEG-2 TS 다중화 장치에 관한 것이다.
본 발명은 비디오/오디오 인코더로 부터 제공되는 미디어, PCR 패킷, PMT 패킷 및 PAT 패킷을 저장한 후 TS 헤더를 부가하여 타이머에 따라 출력하는 미디어 및 타이머 처리수단; 수신되는 각각의 TS 패킷의 다중화 및 출력을 제어하는 TS 패킷 다중화 제어수단; TS 다중화기로부터 출력되는 TS 패킷을 ATM 망 정합을 위하여 저장하는 버퍼 수단; 및 ATM 망으로의 전송을 위하여 AAL5 프로토콜 처리를 하여 ATM 셀화하는 ATM 정합장치 수단을 구비하는 것을 그 특징으로 한다.-
公开(公告)号：KR1019970019235A
公开(公告)日：1997-04-30
申请号：KR1019950031983
申请日：1995-09-26
IPC: H04L12/43
Abstract: 본 발명은 망장치에서 발생할 수 있는 프레임 동기문제를 해결하거나 예방하기 위한 프레임 수신장치에 관한 것으로, 광수신기(1)와, 상기 광수신기(1)에 연결된 프레임 수신기(2)와, 상기 프레임 수신기(2)에 연결된 프레임 처리기(3)를 구비하는 프레임 수신장치에 있어서, 상기 광수신기(1)Dp서 오는 LOS(Loss Of Signal)신호와 프레임 처리기(3)에서 오는 OOF(Out Of Frame) 신호를 사용하여 프레임 수신기(2)로 가는 LOS 신호를 만들어 주는 LOS 신호 발생수단(4): 상기 프레임 처리기(3)에서 오는 OOF 신호와 리셋(Reset)신호를 이용하여 프레임 수신기(2)로 가는 OOF 신호를 발생시키는 OOF 발생수단(5): 망의 클럭을 분주하여 상기 LOS 신호 발생수단(4)과 OOF 발생수단(5)에서 사용할 느린 클럭을 만들어 내는 클럭발생수단(6)을 더 구비하는 것을 특징으로 하여 OOF 상태에서 빠른 간안에 인-프레임 상태로 돌아올 수 있도록 하는 효과가 있다.
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公开(公告)号：KR1019970000669B1
公开(公告)日：1997-01-16
申请号：KR1019940004616
申请日：1994-03-09
IPC: H04L12/26 , H04L12/939 , H04L12/823
Abstract: The apparatus for detecting error ATM cell and data is composed of a cell length counter(14) counting a starting signal of an input cell; a comparator(15) applying a signal(COMP) to a cell reception controlling part(12), of which signal compares a size of the starting signal with 53 octet size; the cell length counter(14) outputting an up-count-value(UPVAL) signal to the counter comparator(15) in case of SOCout signal provided from a SOC processing part(13) being '1' while outputting a down-count-value(DNVAL) signal to the counter comparator(15) in case of '0'; accordingly, the cell reception controlling part(12) applying RDCLK to a cell reception buffer(16) to store SOC signal from a cell matching buffer(11) and a cell(cell[7;0 ) in the cell reception buffer(16) in case that the COMP signal is '0' while outputting a buffer clear signal(BCLR) to the cell reception buffer(16) to discard the cell stored in the cell reception buffer in case that the COMP signal is not '0'.
Abstract translation: 用于检测错误ATM信元和数据的装置由对输入信元的起始信号进行计数的信元长度计数器（14）组成; 将信号（COMP）施加到小区接收控制部分（12）的比较器（15），其中信号将起始信号的大小与53字节大小进行比较; 在从SOC处理部分（13）提供的SOCout信号为“1”的情况下，单元长度计数器（14）输出向上计数值（UPVAL）信号到计数器比较器（15） 值（DNVAL）信号到“0”的情况下的计数器比较器（15）; 因此，将小区接收缓冲器（16）中的信元（cell）[7; 0]应用于小区接收缓冲器（16）并存储SOC信号的小区接收控制部分（12） 在COMP信号不为“0”的情况下，当向信元接收缓冲器（16）输出缓冲区清除信号（BCLR）时，COMP信号为“0”，以丢弃存储在信元接收缓冲器中的信元。
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公开(公告)号：KR1019960020166A
公开(公告)日：1996-06-17
申请号：KR1019940031097
申请日：1994-11-24
Abstract: 본 발명은 인터럽트 처리수단(11)과, LCD 처리수단(13)과, LCD타이머수단(12)과, 장애 처리수단(15)과, 장애 타이머수단(14)과, 계층관리 상태레지스터수단(16)을 구비하는 것을 특징으로 하여, 물리계층의 오동작이나, 망의 링크상태가 불량하여 비정상적인 셀의 유입이나, 또는 상대방과의 호 연결 설정에서 일정시간 또는 상당한 시간 셀을 송수신 못할 경우 발생되는 시스템의 오류를 계층단위로 점검할 수 있게 하므로 각 시스템 및 링크에서의 이상상태에 대한 물리계층의 계층관리기능을 통하여 시스템의 관리를 효율적으로 할 수 있는 효과가 있는 물리계층 계층관리부 제어장치에 관한 것이다.
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