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公开(公告)号：CN106487354A
公开(公告)日：2017-03-08
申请号：CN201610739148.6
申请日：2016-08-26
Applicant: 安桥株式会社
CPC classification number: H03G3/341 , H03F1/26 , H03F3/183 , H03F3/187 , H03F3/45475 , H03F3/72 , H03F2200/03 , H03G3/348 , H03M1/66 , H04R5/04
Abstract: 音乐再生装置。本发明的目的是利用简单的结构实现将放大电路的反相输出设置成接地的主动控地。DAP(1)包括：正极侧DAC(7)，其将数字音频数据D/A转换成模拟音频数据；正极侧放大电路(9)，其对DAC(7)D/A转换成的模拟音频数据进行放大；负极侧DAC(8)，其将数字音频数据D/A转换成模拟音频数据；以及负极侧放大电路行放大；以及CPU(2)。在将放大电路(10)的输出设置成接地的ACG模式的情况下，CPU(2)使DAC(8)静音。(10)，其对DAC(8)D/A转换成的模拟音频数据进
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公开(公告)号：CN102386860B
公开(公告)日：2015-12-09
申请号：CN201110240679.8
申请日：2011-08-19
Applicant: 安桥株式会社
CPC classification number: H03F3/3066 , H03F1/34 , H03F1/52 , H03F3/3076 , H03F3/3435 , H03F2203/30031 , H03F2203/30084 , H03F2203/30117
Abstract: 本发明涉及一种放大电路和电流-电压转换电路，该放大电路包括：设置在输入级的第一晶体管、第二晶体管、第三晶体管和第四晶体管；以及第一偏置电路。输入信号被输入到第一晶体管的控制端子和第二晶体管的控制端子，第一晶体管的第一端子连接到第三晶体管的第一端子，第二晶体管的第一端子连接到第四晶体管的第一端子，第一晶体管的第二端子连接到第一电位，第二晶体管的第二端子连接到等于或不等于第一电位的第二电位，第三晶体管的第二端子连接到第三电位，第四晶体管的第二端子连接到第四电位，第一偏置电路连接在第三晶体管的控制端子与第四晶体管的控制端子之间。
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公开(公告)号：CN106488360A
公开(公告)日：2017-03-08
申请号：CN201610726917.9
申请日：2016-08-25
Applicant: 安桥株式会社
Abstract: 音乐再生装置。本发明的目的是减少至D/A转换器(DAC)的信号输出和接线。DAP(1)包括：DAC(7)，该DAC(7)将LR两声道数字音频数据D/A转换成LR两声道模拟音频数据；放大电路(9)，该放大电路(9)对DAC(7)D/A转换的LR两声道模拟音频数据进行放大；DAC(8)，该DAC(8)将LR两声道数字音频数据D/A转换成LR两声道模拟音频数据；以及放大电路(10)，该放大电路(10)对DAC的反相LR两声道模拟音频数据进行放大。(8)D/A转换成的LR两声道模拟音频数据被反相
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公开(公告)号：CN102386860A
公开(公告)日：2012-03-21
申请号：CN201110240679.8
申请日：2011-08-19
Applicant: 安桥株式会社
CPC classification number: H03F3/3066 , H03F1/34 , H03F1/52 , H03F3/3076 , H03F3/3435 , H03F2203/30031 , H03F2203/30084 , H03F2203/30117
Abstract: 本发明涉及一种放大电路和电流-电压转换电路，该放大电路包括：设置在输入级的第一晶体管、第二晶体管、第三晶体管和第四晶体管；以及第一偏置电路。输入信号被输入到第一晶体管的控制端子和第二晶体管的控制端子，第一晶体管的第一端子连接到第三晶体管的第一端子，第二晶体管的第一端子连接到第四晶体管的第一端子，第一晶体管的第二端子连接到第一电位，第二晶体管的第二端子连接到等于或不等于第一电位的第二电位，第三晶体管的第二端子连接到第三电位，第四晶体管的第二端子连接到第四电位，第一偏置电路连接在第三晶体管的控制端子与第四晶体管的控制端子之间。
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Patent Agency Ranking
公开(公告)号：CN104796153B
公开(公告)日：2020-01-10
申请号：CN201510032815.2
申请日：2015-01-22
Applicant: 安桥株式会社
IPC: H03M3/04
Abstract: 信号调制电路。提供了一种能够实时校正输出状态并且减小由延迟装置产生的失真/噪声分量的影响的电路。该信号调制电路包括：减法器；积分器；相位反转电路；DFF，该DFF用于在按照与所述时钟信号同步的定时插入零电平的同时，将该信号延迟并且量化；三值信号产生电路，该三值信号产生电路用于产生三值信号，该三值信号用于将连接到单个电源的负载选择性地驱动成包括正电流开状态、负电流开状态和关状态的三值通电状态；驱动器电路，该驱动器电路用于产生用于驱动负载的驱动信号；以及反馈电路，该反馈电路用于将来自所述驱动器电路的驱动信号反馈到所述输入信号。
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公开(公告)号：CN104242878B
公开(公告)日：2018-08-07
申请号：CN201410258023.2
申请日：2014-06-11
Applicant: 安桥株式会社
IPC: H03K5/131
CPC classification number: H03K19/0002 , H03K19/09443 , H03K19/21 , H03M3/30 , H04L25/4923 , H04L25/4925
Abstract: 本发明提供了种脉冲合成电路。该电路具有通用性,并且对比特数字信号合成以生成三值信号。脉冲合成电路合成来自两个DFF的比特数字信号以生成三值信号。脉冲合成电路具有第NOR门、第二NOR门、第三NOR门和三个开关。第开关连接到第电势,第二开关连接到第二电势,并且第三开关连接到第三电势。根据来自两个DFF的信号的逻辑值来接通/关断第至第三开关,并且第电势、第二电势和第三电势中的任个被设置为输出电势从而生成三值信号。
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公开(公告)号：CN104242878A
公开(公告)日：2014-12-24
申请号：CN201410258023.2
申请日：2014-06-11
Applicant: 安桥株式会社
IPC: H03K5/13
CPC classification number: H03K19/0002 , H03K19/09443 , H03K19/21 , H03M3/30 , H04L25/4923 , H04L25/4925
Abstract: 本发明提供了一种脉冲合成电路。该电路具有通用性，并且对一比特数字信号合成以生成三值信号。脉冲合成电路合成来自两个DFF的一比特数字信号以生成三值信号。脉冲合成电路具有第一NOR门、第二NOR门、第三NOR门和三个开关。第一开关连接到第一电势，第二开关连接到第二电势，并且第三开关连接到第三电势。根据来自两个DFF的信号的逻辑值来接通/关断第一至第三开关，并且第一电势、第二电势和第三电势中的任一个被设置为输出电势从而生成三值信号。
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公开(公告)号：CN102386858A
公开(公告)日：2012-03-21
申请号：CN201110231249.X
申请日：2011-08-12
Applicant: 安桥株式会社
CPC classification number: H03F3/4517
Abstract: 本发明涉及一种放大电路。在所述放大电路中，第一发射极跟随电路和第二发射极跟随电路可以增大位于反相输入端子侧的输入阻抗。因此，当在该放大电路的反相输入端子与输出端子之间连接有反馈电路时，可以对该放大电路增益的根据反馈电路配置的波动进行抑制。
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公开(公告)号：CN102386858B
公开(公告)日：2016-01-20
申请号：CN201110231249.X
申请日：2011-08-12
Applicant: 安桥株式会社
CPC classification number: H03F3/4517
Abstract: 本发明涉及一种放大电路。在所述放大电路中，第一发射极跟随电路和第二发射极跟随电路可以增大位于反相输入端子侧的输入阻抗。因此，当在该放大电路的反相输入端子与输出端子之间连接有反馈电路时，可以对该放大电路增益的根据反馈电路配置的波动进行抑制。
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