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公开(公告)号：CN109416664B
公开(公告)日：2023-09-01
申请号：CN201780041385.8
申请日：2017-06-02
Applicant: 英特尔公司
Abstract: 一个实施例提供了一种设备。所述设备包含线性地址空间、元数据逻辑和增强的地址空间布局随机化（ASLR）逻辑。所述线性地址空间包含元数据数据结构。所述元数据逻辑要生成元数据值。所述增强的ASLR逻辑要将所述元数据值与线性地址组合到地址指针中并且要在由所述线性地址的至少部分所指向的位置将所述元数据值存储到所述元数据数据结构。所述地址指针对应于增强的地址空间中的表观地址。所述增强的地址空间的大小比所述线性地址空间的大小更大。
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公开(公告)号：CN109416672B
公开(公告)日：2024-03-19
申请号：CN201780041367.X
申请日：2017-06-06
Applicant: 英特尔公司
Abstract: 处理器一方面包括解码从存储器读取指令的解码单元。从存储器读取指令要指示源存储器操作数和目的地存储位置。处理器还包括与解码单元耦合的执行单元。响应于从存储器读取指令，执行单元要从源存储器操作数读取数据，在数据有缺陷时将有缺陷数据的指示存储在架构上可见的存储位置中，以及当数据有缺陷时完成执行从存储器读取指令的操作而不引起异常条件。公开了其它处理器、方法、系统和指令。
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公开(公告)号：CN109416664A
公开(公告)日：2019-03-01
申请号：CN201780041385.8
申请日：2017-06-02
Applicant: 英特尔公司
CPC classification number: G06F11/073 , G06F11/0727 , G06F12/0623 , G06F12/14 , G06F2212/1052 , G06F2212/657
Abstract: 一个实施例提供了一种设备。所述设备包含线性地址空间、元数据逻辑和增强的地址空间布局随机化（ASLR）逻辑。所述线性地址空间包含元数据数据结构。所述元数据逻辑要生成元数据值。所述增强的ASLR逻辑要将所述元数据值与线性地址组合到地址指针中并且要在由所述线性地址的至少部分所指向的位置将所述元数据值存储到所述元数据数据结构。所述地址指针对应于增强的地址空间中的表观地址。所述增强的地址空间的大小比所述线性地址空间的大小更大。
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公开(公告)号：CN109416672A
公开(公告)日：2019-03-01
申请号：CN201780041367.X
申请日：2017-06-06
Applicant: 英特尔公司
CPC classification number: G06F11/1048 , G06F11/0721
Abstract: 处理器一方面包括解码从存储器读取指令的解码单元。从存储器读取指令要指示源存储器操作数和目的地存储位置。处理器还包括与解码单元耦合的执行单元。响应于从存储器读取指令，执行单元要从源存储器操作数读取数据，在数据有缺陷时将有缺陷数据的指示存储在架构上可见的存储位置中，以及当数据有缺陷时完成执行从存储器读取指令的操作而不引起异常条件。公开了其它处理器、方法、系统和指令。
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