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公开(公告)号：KR100197861B1
公开(公告)日：1999-06-15
申请号：KR1019950051032
申请日：1995-12-16
Applicant: 고등기술연구원연구조합
IPC: H04N7/15
Abstract: 본 발명은 화상 회의 시스템에서 하나의 화상 헤더와 3 개의 블럭 그룹 데이타들로 이루어 지며, 상기 블럭 그룹 데이타들은 블럭 그룹 시작 코드와, 블럭 넘버와, 매크로 블럭 데이타들로로 구성된 각각의 제 1,2,3,4 화상 데이타(QCIF)를 하나의 화상 헤더와 12 개의 블럭 그룹 데이타로 구성되는 제 5 화상 데이타(CIF)로 통합하기 위한 블럭 그룹 데이타내의 블럭 넘버 변경 장치에 관한 것으로서, 순차적으로 입력되는 상기 제 1,2,3,4 화상 데이타들중 상기 제 1 화상 데이타의 화상 헤더가 검출되면 화상 헤더 감출 신호와 검출된 화상 헤더를 출력하고 나머지 화상 데이타에서 검출된 화상 헤더는 제거하여 상기 제 1,2,3,4 화상 데이타의 블럭 그룹 데이타들을 출력하는 화상 입력 제어부(10)와; 상기 화상 입력 제어부(10)로부터의 화상 헤더 검출 신호에 의해서 리셋되고 블럭 그룹 시작 검출 신호에 의해서 카운트 업되는 카운터(20)와; 상기 카운터(20)로부터의 카운트 값을 직렬 데이타로 변환하여 출력하는 변환부(30)와; 상기 화상 입력 제어부로부터 인가되는 제 1,2,3,4 화상 데이타들의 블럭 그룹 데이타가 각각 저장되고 제 2 선택 신호에 의거하여 출력 인에이블되어 저장된 블럭 그룹 데이타를 선택적으로 출력하는 제 1,2,3,4 선입 선출 메모리(41,42,43,44)와; 상기 변환부(30)로부터의 카운트 값에 의거하여 상기 제 1,2,3,4 선입 선출 메모리의 선택을 위한 제 1 선택 신호를 출력하는 제 1 선택부(50)와; 상기 제 1 선택 신호에 의거하여 상기 제 1,2,3,4 선입 선출 메모리(41,42,43,44)의 선택을 위한 상기 제 2 선택 신호를 출력하는 제 2 선택부(60)와; 상기 제 1 선택 신호에 의거하여 상기 제 1,2,3,4 선입 선출 메모리(41,42,43,44)로부터의 블럭 그룹 데이타를 선택적으로 출력하는 제 1 멀티 플렉서부(70)와; 상기 제 1,2,3,4 선입 선출 메모리(41,42,43,44)로부터 출력되는 블럭 그룹 데이타에서 블럭 그룹 시작 코드를 검출하여 상기 블럭 그룹 시작 검출 신호를 출력하는 블럭 그룹 시작 검출부(80)와; 상기 블럭 그룹 시작 검출 신호에 의거하여 제 3 선택 신호를 출력하는 제 3 선택부(90)와; 상기 제 3 선택 신호에 의거하여 상기 제 1 멀티 플렉서부(70)의 출력 신호와 상기 변환부(30)로부터의 출력 신호를 선택적으로 출력하여, 상기 제 1 멀티 플렉서부(70)로부터 인가되는 상기 블럭 그룹 데이타들내의 블럭 넘버를 상기 변환부(30)의 출력으로 대치하므로서, 상기 제 1,2,3,4 화상 데이타(QCIF)를 하나의 화상 헤더와 12 개의 블럭 그룹 데이타로 구성한 상기 제 5화상 데이타(CIF)로 통합하여 출력하는 제 2 멀티 플렉서부(100)를 포함한다.
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公开(公告)号：KR1019970057789A
公开(公告)日：1997-07-31
申请号：KR1019950051032
申请日：1995-12-16
Applicant: 고등기술연구원연구조합
IPC: H04N7/15
Abstract: 본 발명은 화상 회의 시스템에서 하나의 화상 헤더와 3 개의 블럭 그룹 데이타들로 이루어 지며, 상기 블럭 그룹 데이타들은 블럭 그룹 시작 코드와, 블럭 넘버와, 매크로 블럭 데이타들로로 구성된 각각의 제 1,2,3,4 화상 데이타(QCIF)를 하나의 화상 헤더와 12 개의 블럭 그룹 데이타로 구성되는 제 5 화상 데이타(CIF)로 통합하기 위한 블럭 그룹 데이타내의 블럭 넘버 변경 장치에 관한 것으로서, 순차적으로 입력되는 상기 제 1,2,3,4 화상 데이타들중 상기 제 1 화상 데이타의 화상 헤더가 검출되면 화상 헤더 감출 신호와 검출된 화상 헤더를 출력하고 나머지 화상 데이타에서 검출된 화상 헤더는 제거하여 상기 제 1,2,3,4 화상 데이타의 블럭 그룹 데이타들을 출력하는 화상 입력 제어부(10)와; 상기 화상 입력 제어부(10)로부터의 화상 헤더 검출 신호에 의해서 리셋되고 블럭 그룹 시작 검출 신호에 의해서 카운트 업되는 카운터(20)와; 상기 카운터(20)로부터의 카운트 값을 직렬 데이타로 변환하여 출력하는 변환부(30)와; 상기 화상 입력 제어부로부터 인가되는 제 1,2,3,4 화상 데이타들의 블럭 그룹 데이타가 각각 저장되고 제 2 선택 신호에 의거하여 출력 인에이블되어 저장된 블럭 그룹 데이타를 선택적으로 출력하는 제 1,2,3,4 선입 선출 메모리(41,42,43,44)와; 상기 변환부(30)로부터의 카운트 값에 의거하여 상기 제 1,2,3,4 선입 선출 메모리의 선택을 위한 제 1 선택 신호를 출력하는 제 1 선택부(50)와; 상기 제 1 선택 신호에 의거하여 상기 제 1,2,3,4 선입 선출 메모리(41,42,43,44)의 선택을 위한 상기 제 2 선택 신호를 출력하는 제 2 선택부(60)와; 상기 제 1 선택 신호에 의거하여 상기 제 1,2,3,4 선입 선출 메모리(41,42,43,44)로부터의 블럭 그룹 데이타를 선택적으로 출력하는 제 1 멀티 플렉서부(70)와; 상기 제 1,2,3,4 선입 선출 메모리(41,42,43,44)로부터 출력되는 블럭 그룹 데이타에서 블럭 그룹 시작 코드를 검출하여 상기 블럭 그룹 시작 검출 신호를 출력하는 블럭 그룹 시작 검출부(80)와; 상기 블럭 그룹 시작 검출 신호에 의거하여 제 3 선택 신호를 출력하는 제 3 선택부(90)와; 상기 제 3 선택 신호에 의거하여 상기 제 1 멀티 플렉서부(70)의 출력 신호와 상기 변환부(30)로부터의 출력 신호를 선택적으로 출력하여, 상기 제 1 멀티 플렉서부(70)로부터 인가되는 상기 블럭 그룹 데이타들내의 블럭 넘버를 상기 변환부(30)의 출력으로 대치하므로서, 상기 제 1,2,3,4 화상 데이타(QCIF)를 하나의 화상 헤더와 12 개의 블럭 그룹 데이타로 구성한 상기 제 5화상 데이타(CIF)로 통합하여 출력하는 제 2 멀티 플렉서부(100)를 포함한다.
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公开(公告)号：KR100202391B1
公开(公告)日：1999-06-15
申请号：KR1019950067074
申请日：1995-12-29
Applicant: 고등기술연구원연구조합
IPC: G11B20/10
Abstract: 본 발명은 영상 신호 처리를 위한 양자화기에 관한 것으로서, 더욱 상세하게는 영상 부호와 장치에서 양자화 스텝 사이즈(Quantization Step Size)를 결정하기 위한 비트(bit)수 측정시 하드웨어의 복잡성을 줄이기 위한 양자화 스텝 사이즈 결정 장치에 관한 것이다.
이를 위하여 본 발명은, 양자화하고자 하는 이산 코사인 변환(DCT)된 DCT 블록 데이터에 대한 양자화 스텝 사이즈를 결정하는 양자화 스텝 사이즈 결정 장치에 있어서, 이산 코사인 변환 (DCT)되어 입력되는 DCT 블록 데이터들의 클래스를 결정하는 클래스 결정부(200)와; 클래스 결정부(200)에서 출력되는 클래스 정보들중 전송 데이터량을 압축하기 위하여 의미있는 정보들만 전송하는 이니셜 스캐일링부(300)와;이니셜 스캐일링된 정보들에 대응하여 서로 다른 양자화 스텝으로 DCT 계수를 양자화하는 다수개의 양자화기로 구성되어 있는 양자화 스텝 사이즈 결정부(400)와; 클래스 결정부(200) 및 양자화 스텝 사이즈 결정부(300)의 출력 정보를 산술 평균에 이하여 양자화 스텝 사이즈의 조합을 결정하는 조합 결정부(500)와; 많은 이미지 데이터를 이용한 실험으로 계산된 심벌 - 비트 테이블을 이용하고 조합 결정부(500)의 출력신호에 대응하여 블록당 발생 예상되는 비트수의 조합을 결정하는 비트 결정부(600)와; 비트 결정부(600)에서 결정되어진 비트수의 조합과 우 하는 데이터량에 대응하는 비트수의 조합을 비교하여 가장 근접한 조합을 구하여 출력하는 비교부(700)를 포함하도록 구성되어, 블록당 발생되는 비트수를 예측하기 위한 하드웨어의 구성이 간단해지는 효과가 있다.-
公开(公告)号：KR1019970050841A
公开(公告)日：1997-07-29
申请号：KR1019950067074
申请日：1995-12-29
Applicant: 고등기술연구원연구조합
IPC: G11B20/10
Abstract: 본 발명은 영상 신호 처리를 위한 양자화기에 관한 것으로서, 더욱 상세하게는 영상 부호와 장치에서 양자화 스텝 사이즈(Quantization Step Size)를 결정하기 위한 비트(bit)수 측정시 하드웨어의 복잡성을 줄이기 위한 양자화 스텝 사이즈 결정 장치에 관한 것이다.
이를 위하여 본 발명은, 양자화하고자 하는 이산 코사인 변환(DCT)된 DCT 블록 데이터에 대한 양자화 스텝 사이즈를 결정하는 양자화 스텝 사이즈 결정 장치에 있어서, 이산 코사인 변환 (DCT)되어 입력되는 DCT 블록 데이터들의 클래스를 결정하는 클래스 결정부(200)와; 클래스 결정부(200)에서 출력되는 클래스 정보들중 전송 데이터량을 압축하기 위하여 의미있는 정보들만 전송하는 이니셜 스캐일링부(300)와;이니셜 스캐일링된 정보들에 대응하여 서로 다른 양자화 스텝으로 DCT 계수를 양자화하는 다수개의 양자화기로 구성되어 있는 양자화 스텝 사이즈 결정부(400)와; 클래스 결정부(200) 및 양자화 스텝 사이즈 결정부(300)의 출력 정보를 산술 평균에 이하여 양자화 스텝 사이즈의 조합을 결정하는 조합 결정부(500)와; 많은 이미지 데이터를 이용한 실험으로 계산된 심벌 - 비트 테이블을 이용하고 조합 결정부(500)의 출력신호에 대응하여 블록당 발생 예상되는 비트수의 조합을 결정하는 비트 결정부(600)와; 비트 결정부(600)에서 결정되어진 비트수의 조합과 우 하는 데이터량에 대응하는 비트수의 조합을 비교하여 가장 근접한 조합을 구하여 출력하는 비교부(700)를 포함하도록 구성되어, 블록당 발생되는 비트수를 예측하기 위한 하드웨어의 구성이 간단해지는 효과가 있다.
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