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公开(公告)号：KR101183738B1
公开(公告)日：2012-09-17
申请号：KR1020107027916
申请日：2008-05-14
Applicant: 재단법인서울대학교산학협력재단
CPC classification number: H03L7/0995 , H03K3/0322 , H03K3/35613 , H03K2005/0013 , H03L1/00 , H03L7/0998 , H03L7/18 , H03L2207/50
Abstract: 본 발명은 유사 차동 증폭 회로(pseudo-differential pair)를 구성하고 PMOS와 NMOS에 래치(latch)를 구성함으로써, 공급 전원의 변동을 상승 및 하강 에지 양쪽에서 대칭적으로 보상함으로써 전파 지연 지터를 최소화한다. 본 발명은 거친 튜닝(coarse tuning)을 위한 지연 선(delay line)에서 양 쪽으로 두 개의 노드를 취하고 정밀 튜닝을 위한 블록을 구성하고, 공급 전원의 변동에 대응해서 지연 셀의 궤환 래치의 강도를 보상하는 방법을 제공한다. 본 발명은 공급 전원 V
DD 가 증가하면 PMOS의 구동력을 증대시키는데, 그만큼 출력 전압이 증가 되어, 증가한 출력 전압이 NMOS 래치를 강하게 닫히도록 해서 이전 상태를 반전하는데 그만큼 시간 지연이 생기게 되므로 전체적 전파 지연을 일정하게 할 수 있다. 그 결과, 전원 전압이 약간 변동을 하더라도 지터 잡음없이 일정 주파수의 클럭을 발진할 수 있다.-
公开(公告)号：KR1020110014643A
公开(公告)日：2011-02-11
申请号：KR1020107027916
申请日：2008-05-14
Applicant: 재단법인서울대학교산학협력재단
CPC classification number: H03L7/0995 , H03K3/0322 , H03K3/35613 , H03K2005/0013 , H03L1/00 , H03L7/0998 , H03L7/18 , H03L2207/50
Abstract: PURPOSE: A method for eliminating jitter and a digital control oscillating circuit using the same are provided to oscillate a clock in a pre-set frequency without jitter noises by constantly maintaining wave delaying time. CONSTITUTION: The output of N-type metal oxide semiconductor(MOS) drivers(160, 170) of a differential amplifier is in connection with the gate terminal of an NMOS transistor. The output of PMOS load transistors(180, 190) is in connection with the gate of a PMOS transistor. A pseudo-differential amplifying circuit is composed of the NMOS transistor and the PMOS transistor. The output of the pseudo-differential amplifying circuit is in connection with the output of an inverter terminal composed of transistors(120, 130).
Abstract translation: 目的：提供消除抖动的方法和使用该方法的数字控制振荡电路，以通过不断维持波延迟时间来振荡具有预设频率的时钟，而不产生抖动噪声。 构成：差分放大器的N型金属氧化物半导体（MOS）驱动器（160,170）的输出与NMOS晶体管的栅极端子连接。 PMOS负载晶体管（180,190）的输出与PMOS晶体管的栅极连接。 伪差分放大电路由NMOS晶体管和PMOS晶体管构成。 伪差分放大电路的输出与由晶体管（120,130）构成的反相器端子的输出相连。
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