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公开(公告)号：CN101901170B
公开(公告)日：2015-04-22
申请号：CN201010189715.8
申请日：2010-05-26
Applicant: 罗伯特.博世有限公司
Inventor： M·斯普劳尔
CPC classification number: G06F11/1028
Abstract: 本发明公开了数据处理装置和用于误差检测与误差校正的方法。数据处理装置包括误差检测装置和误差校正装置。误差检测装置能够检测在被存储在存储器的存储器单元中的数据中的可校正误差和不可校正误差。误差检测装置然后确定邻近存储器单元或存储器单元，所述邻近存储器单元或存储器单元与其中检测到可校正误差的存储器单元物理相邻，并且根据在物理相邻的邻近存储器单元中检测的可校正误差来生成指示错误的信号。如果未生成指示错误的信号，则误差校正装置用来校正由误差检测装置所检测的可校正误差。
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公开(公告)号：CN102549554A
公开(公告)日：2012-07-04
申请号：CN201080043681.X
申请日：2010-09-20
Applicant: 美光科技公司
Inventor： 约瑟夫·M·杰德罗
CPC classification number: G06F11/08 , G06F3/0616 , G06F3/064 , G06F3/0688 , G06F11/1028 , G06F11/108
Abstract: 本发明包含用于基于条带的存储器操作的方法及装置。一个方法实施例包含将数据写入跨越多个存储器装置的存储卷的第一条带中。通过将经更新数据写入跨越所述多个存储器装置的所述存储卷的第二条带的一部分中来更新所述第一条带的一部分。使所述第一条带的所述部分无效。维持所述第一条带的所述无效部分及所述第一条带的剩余部分直到所述第一条带被回收为止。本发明还揭示其它方法及装置。
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公开(公告)号：CN101740135A
公开(公告)日：2010-06-16
申请号：CN200910212292.4
申请日：2009-11-16
Applicant: 富士通株式会社
Inventor： 鹈饲昌树
CPC classification number: H03M13/1575 , G06F11/1028 , H03M13/1515
Abstract: 一种错误判断电路，包括：第一EOR电路树，用于在使用里德-索罗蒙代码的SmEC-DmED中通过在伽罗瓦扩展域GF(2m)中相加，相对于m位块单元数据，通过与受保护以避免错误的原代码的多项式表达相关的多项式余项计算来生成校正码的校验位；第二EOR电路树，用于当要被检测错误并且可能混有错误的代码的多项式表达为Y(x)时，相对于代码C(x)，根据Sn＝Y(αn)生成检验子，其中把校验位添加到原代码；和错误检测电路部件，用于根据是否满足检验子方程式S12＝S0S2来检测存在一个块错误、两个块错误还是没有错误。
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公开(公告)号：CN104769558A
公开(公告)日：2015-07-08
申请号：CN201280076878.2
申请日：2012-11-05
Applicant: 三菱电机株式会社
Inventor： 迹部浩士
CPC classification number: G06F11/1028 , G06F11/1016 , G06F11/1048 , G06F12/0802 , Y02D10/13
Abstract: 内部缓冲器(A109)缓存来自存储器(105)的数据。存储器地址变换部(106)从请求要求源(101)输入读取请求。命中判定部(113)判定存储有读取请求所要求的有效载荷数据、和对应的ECC的大于或等于2个地址即读出候补地址中的某地址处的数据是否已经缓存或者预定要缓存至内部缓冲器(A109)。命令发出间隔控制部(114)在某地址处的数据已经缓存或者预定要缓存至内部缓冲器(A109)的情况下，在经过规定的延迟时间之后，将部分读取命令输出至存储器(105)，该部分读取命令指示从读出候补地址中除了数据已经缓存或者预定要缓存至内部缓冲器(A109)的地址以外的地址读取数据。
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公开(公告)号：CN102630318B
公开(公告)日：2015-06-03
申请号：CN201080053195.6
申请日：2010-11-26
Applicant: 国际商业机器公司
Inventor： T.A.安托纳科波罗斯 , R.D.西德西扬 , E.S.艾勒夫瑟里奥 , R.哈斯 , 胡晓宇 , I.伊利亚迪斯
CPC classification number: G06F11/1028 , G11C29/765
Abstract: 提供了通过使用容错架构以及一个用于随机/突发错误校正的纠错码（ECC）机制和L层交织机制，处理固态驱动器（SSD）中的故障的存储集成电路（IC）的问题的系统和方法。此处描述的系统和方法在一个或多个集成电路故障时保持SSD运行，并且允许从故障的集成电路中恢复先前存储的数据，并允许在其它运行的集成电路中校正随机/突发的错误。这些系统和方法将故障的集成电路以此处作为备用集成电路的功能/运行完全的集成电路代替。此外，这些系统和方法改善了最大可实现读取/写入数据率方面的I/O性能。
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Patent Agency Ranking
公开(公告)号：CN102549554B
公开(公告)日：2015-04-08
申请号：CN201080043681.X
申请日：2010-09-20
Applicant: 美光科技公司
Inventor： 约瑟夫·M·杰德罗
CPC classification number: G06F11/08 , G06F3/0616 , G06F3/064 , G06F3/0688 , G06F11/1028 , G06F11/108
Abstract: 本发明包含用于基于条带的存储器操作的方法及装置。一个方法实施例包含将数据写入跨越多个存储器装置的存储卷的第一条带中。通过将经更新数据写入跨越所述多个存储器装置的所述存储卷的第二条带的一部分中来更新所述第一条带的一部分。使所述第一条带的所述部分无效。维持所述第一条带的所述无效部分及所述第一条带的剩余部分直到所述第一条带被回收为止。本发明还揭示其它方法及装置。
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公开(公告)号：CN103971751B
公开(公告)日：2018-03-13
申请号：CN201410042712.X
申请日：2014-01-29
Applicant: 希捷科技有限公司
Inventor： A·H·S·阿赫西恩 , 李宗旺 , E·F·哈拉特什 , L·丹简
IPC: G11C29/42
CPC classification number: G06F11/1028 , H03M13/1171 , H03M13/3723 , H03M13/611 , H03M13/612 , H03M13/63
Abstract: 本发明提供用于以选择性的二进制及非二进制解码在闪存中进行检测和解码的方法和装置。来自闪存器件的数据这样来处理：从闪存器件的一个或多个页中获得多个位的一个或多个读出值；基于给定的数据模式在特定的模式被从该多个位中读出时被写入该多个位的概率而将该多个位的一个或多个读出值转换成非二进制对数似然比；并且使用非二进制对数似然比来联合解码该多个位，其中页被独立地编码。
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公开(公告)号：CN104769558B
公开(公告)日：2017-07-21
申请号：CN201280076878.2
申请日：2012-11-05
Applicant: 三菱电机株式会社
Inventor： 迹部浩士
CPC classification number: G06F11/1028 , G06F11/1016 , G06F11/1048 , G06F12/0802 , Y02D10/13
Abstract: 内部缓冲器(A109)缓存来自存储器(105)的数据。存储器地址变换部(106)从请求要求源(101)输入读取请求。命中判定部(113)判定存储有读取请求所要求的有效载荷数据、和对应的ECC的大于或等于2个地址即读出候补地址中的某地址处的数据是否已经缓存或者预定要缓存至内部缓冲器(A109)。命令发出间隔控制部(114)在某地址处的数据已经缓存或者预定要缓存至内部缓冲器(A109)的情况下，在经过规定的延迟时间之后，将部分读取命令输出至存储器(105)，该部分读取命令指示从读出候补地址中除了数据已经缓存或者预定要缓存至内部缓冲器(A109)的地址以外的地址读取数据。
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公开(公告)号：CN102939590B
公开(公告)日：2016-09-14
申请号：CN201080067368.X
申请日：2010-06-11
Applicant: 飞思卡尔半导体公司
Inventor： 亨利·克洛滕斯
CPC classification number: G06F11/1028 , G06F21/64 , G06F21/79
Abstract: 一种用于为在随机存取存储器（RAM）元件内存储的数据提供数据保护的方法。所述方法包括接收要写入存储器的数据（420），划分所接收的数据为多个数据段（430），对所述数据段应用纠错编码以形成码字段（440），交织所述码字段以形成交织数据码字（450），以及在单一时钟周期内将所述交织数据码字写入存储器（460）。
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公开(公告)号：CN102023815B
公开(公告)日：2016-01-20
申请号：CN201010285233.2
申请日：2010-09-15
Applicant: 马维尔国际贸易有限公司
Inventor： 格雷戈里·伯德
IPC: G06F3/06
CPC classification number: G06F11/108 , G06F11/1008 , G06F11/1028 , G06F11/1048 , G06F12/0246 , G06F2212/1032 , G06F2212/7208 , G11C29/52
Abstract: 本公开包括涉及在固态存储器中实现容错数据存储的系统和技术。在一些实现中，方法包括：接收待存储的数据；将数据分成逻辑数据块；将块分配到逻辑块分组，逻辑块分组包括来自多个固态物理存储器设备中的两个或多个的至少一个物理数据存储块；将所述块存储在物理数据存储块中；确定相应于持久数据的代码；以及存储相应于存储在逻辑块分组中的数据的代码。通过识别相应于损坏的物理数据存储块的逻辑数据块和逻辑块分组，读取存储在所识别的分组中的数据和代码，并将该代码与不同于存储在损坏的块中的数据的所读取的数据进行比较，可恢复损坏的所存储的数据的块。
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