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公开(公告)号：CN100388253C
公开(公告)日：2008-05-14
申请号：CN200410085143.3
申请日：2004-08-02
Applicant: 松下电器产业株式会社
IPC: G06F13/28
CPC classification number: G06F13/28
Abstract: 本发明提供了一种DMA传输控制器，该DMA传输控制器包括：传输参数存储单元，用于存储对于由主处理器执行的多个逻辑处理器的总线占用时间值和一组或多组直接存储器存取传输的传输参数；数据传输执行单元，用于根据DMA传输参数来执行DMA传输；控制单元，用于控制DMA传输参数的接收和传输，以及DMA传输的开始和中断；以及时间测量单元，用于当每一个逻辑处理器的第一个DMA传输开始时，开始测量总线占用逝去时间。当总线占用逝去时间达到总线占用时间值时，控制单元中断所执行的DMA传输以根据与规定顺序的逻辑处理器相关的传输参数来开始执行DMA传输。
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Patent Agency Ranking
公开(公告)号：CN1151454C
公开(公告)日：2004-05-26
申请号：CN98100157.2
申请日：1998-01-22
Applicant: 松下电器产业株式会社
IPC: G06F17/14
CPC classification number: G06F17/141
Abstract: 一种高速傅里叶变换装置及方法是对存储于RAM中第偶数次符号及存储于RAM101中第奇数次符号，通过RAM地址生成部分生成的RAM地址，由蝶形运算部分进行高速傅里叶变换。RAM地址变换部分是将输入输出临时地址仅进行输入输出用位反向符号的指示次数的位反向处理，在变换输入输出用实际地址的同时，将蝶形运算用临时地址仅进行蝶形运算用位反向信号的指示次数的位反向处理，变换蝶形运算用实际地址。该装置及方法可实现符号输入和符号输出的重叠。
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公开(公告)号：CN1120414C
公开(公告)日：2003-09-03
申请号：CN99109761.0
申请日：1999-07-12
Applicant: 松下电器产业株式会社
CPC classification number: H03M13/271 , H03M13/2767 , H03M13/41
Abstract: 本发明的去交错装置对一输入传输帧进行去交错并输出该被去交错的帧，该传输帧通过对一初始帧执行帧间交错以形成一中间帧并对该中间帧中包括的至少一数据执行段内交错而获得的。该去交错装置包括：一存储器；用于接收该传输帧并将该传输帧写入该存储器中的一数据写部分；和用于当从该存储器读取数据时同时解除该帧间交错和段内交错且输出数据的一数据读部分。
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公开(公告)号：CN1188939A
公开(公告)日：1998-07-29
申请号：CN98100157.2
申请日：1998-01-22
Applicant: 松下电器产业株式会社
IPC: G06F17/14
CPC classification number: G06F17/141
Abstract: 一种高速傅里叶变换装置及方法是对存储于RAM中第偶数次符号及存储于RAM101中等奇数次符号,通过RAM地址生成部分生成的RAM地址,由蝶形运算部分进行高速傅里叶变换。RAM地址变换部分是将输入输出临时地址仅进行输入输出用位反向符号的指示次数的位反向处理,在变换输入输出用实际地址的同时,将蝶形运算用临时地址仅进行蝶形运算用位反向信号的指示次数的位反向处理,变换蝶形运算用实际地址。该装置及方法可实现符号输入和符号输出的重叠。
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公开(公告)号：CN1246682A
公开(公告)日：2000-03-08
申请号：CN99109761.0
申请日：1999-07-12
Applicant: 松下电器产业株式会社
CPC classification number: H03M13/271 , H03M13/2767 , H03M13/41
Abstract: 本发明的去交错装置对一输入传输帧进行去交错并输出该被去交错的帧,该传输帧通过对一初始帧执行帧间交错以形成一中间帧并对该中间帧中包括的至少一数据执行段内交错而获得的。该去交错装置包括:一存储器;用于接收该传输帧并将该传输帧写入该存储器中的一数据写部分;和用于当从该存储器读取数据时同时解除该帧间交错和段内交错且输出数据的一数据读部分。
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公开(公告)号：CN1591374A
公开(公告)日：2005-03-09
申请号：CN200410085143.3
申请日：2004-08-02
Applicant: 松下电器产业株式会社
IPC: G06F13/28
CPC classification number: G06F13/28
Abstract: 本发明提供了一种DMA传输控制器，该DMA传输控制器包括：传输参数存储单元，用于存储总线占用时间值以及用于多个逻辑处理器中的每个的一组或多组DMA传输的传输参数；数据传输执行单元，用于根据DMA传输参数来执行DMA传输；控制单元，用于控制DMA传输参数的接收和传输，以及DMA传输的开始和中断；以及时间测量单元，用于当每一个逻辑处理器的第一个DMA传输开始时，开始测量总线占用逝去时间。当总线占用逝去时间达到总线占用时间值时，控制单元中断所执行的DMA传输以根据与规定顺序的逻辑处理器相关的传输参数来开始执行DMA传输。
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