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公开(公告)号：CN105224468B
公开(公告)日：2019-02-05
申请号：CN201410252855.3
申请日：2014-06-09
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/02
Abstract: 本发明公开了一种内存共享方法，应用于异构硬件，异构硬件连接主机，本发明方法包括：异构硬件获取主机发送的主机的部分内存的内存地址；当异构硬件的内存的空闲容量低于预定容量时，异构硬件根据内存地址，将异构硬件的内存中使用频率低于预定使用频率的数据存储到部分内存。采用本发明提供的内存共享方法，能够将异构硬件的内存中使用频率低于预定使用频率的数据存储到主机的部分内存，减少使用频率低于预定使用频率的数据在异构硬件的内存中所占用的存储空间，从而增大异构硬件的空闲存储空间，为运行在异构硬件上的应用提供更多的内存空间。
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公开(公告)号：CN105701020B
公开(公告)日：2018-11-30
申请号：CN201410709140.6
申请日：2014-11-28
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/02
CPC classification number: G06F12/02
Abstract: 本发明实施例提供了一种内存访问的方法、相关装置和系统，解决了现有技术内存访问效率较低的问题。该方法包括：接收进程的内存访问请求消息，其中，所述内存访问请求消息包括所述进程请求访问的内存对应的虚拟地址的信息；根据所述进程从预设的映射关系集合中获取所述进程所对应的映射关系，所述映射关系为所述虚拟地址与所述进程请求访问的内存对应的内存控制器MC的对应关系；根据所述虚拟地址的信息和所述映射关系，获取所述进程请求访问的内存所对应的MC；将所述内存访问请求消息发送至所述MC。该方法适用于计算机技术领域。
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公开(公告)号：CN108845877A
公开(公告)日：2018-11-20
申请号：CN201810390866.6
申请日：2013-05-17
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F9/50
CPC classification number: G06F3/0604 , G06F3/0629 , G06F3/067 , G06F9/5016 , G06F12/02 , G06F12/08
Abstract: 提供一种管理内存的方法、装置和系统，能够容易地实现内存资源的共享。该方法包括：请求节点发送第一指示信息，该第一指示信息用于指示该请求节点所需内存的长度；该请求节点接收第二指示信息，该第二指示信息用于指示能够提供远程内存的至少一个贡献节点中的目标贡献节点向该请求节点提供的第一远程内存；该请求节点从能够使用的虚拟地址中，确定与该第一远程内存相对应的第一虚拟地址；及当需要读写指针在该第一虚拟地址范围内的第一数据时，该请求节点发送针对该第一数据的第一数据读写指令，该第一数据读写指令包括第三指示信息，该第三指示信息用于指示该第一远程内存中用于存储该第一数据的存储空间。
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公开(公告)号：CN108415728A
公开(公告)日：2018-08-17
申请号：CN201810170641.X
申请日：2018-03-01
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提供一种用于处理器的扩展浮点运算指令执行方法，包括下列步骤：1)取出扩展浮点运算指令，该指令中至少包括定点运算的操作数存放寄存器字段和定点运算结果存放位置字段；2)对扩展浮点运算进行译码，分解成对应于一系列微操作的控制信号；3)将步骤2)所得的控制信号派发至浮点寄存器、定点运算逻辑单元以及存放运算结果的目标寄存器；4)基于被派发的控制信号，处理器寻址到存放定点运算的操作数的浮点寄存器并将操作数取出；5)通过扩展路径将操作数从浮点寄存器传输到定点运算逻辑单元；6)定点运算逻辑单元将运算结果传输到扩展浮点运算指令中的运算结果存放位置。本发明还提供了相应的用于处理器的扩展浮点运算指令执行装置。
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公开(公告)号：CN104657193B
公开(公告)日：2018-07-20
申请号：CN201310594764.3
申请日：2013-11-21
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
CPC classification number: G06F12/1458 , G06F9/4411 , G06F9/4555 , G06F21/00 , G06F21/572 , G06F21/62 , G06F21/78 , G06F2009/45583 , G06F2212/1052 , G06F2221/2141
Abstract: 本发明公开了一种访问物理资源的方法和装置，涉及操作系统技术领域，以限制多内核操作系统中的轻量级系统内核Light OS不能访问其他Light OS的物理资源，保证Light OS之间访问物理资源的安全性。所述方法包括：安全固件接收第一Light OS所要访问的物理资源对应的物理地址；所述安全固件确定所述第一Light OS所要访问的物理资源对应的物理地址是否越界；若所述第一Light OS的访问没有越界，向所述第一Light OS发送继续访问信号；或者，若所述第一Light OS的访问越界，向所述第一Light OS发送访问出错信号。
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Patent Agency Ranking
公开(公告)号：CN104166596B
公开(公告)日：2018-06-26
申请号：CN201310183058.X
申请日：2013-05-17
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
Abstract: 本发明实施例公开了一种内存分配方法及节点，涉及计算机领域，可以避免由于访存敏感度较高的应用程序被分配至远程内存而造成的增大访存延迟的问题，从而可以提高系统性能。具体方案为：第一节点根据待执行的应用程序的标识在预设的访存特征表中查询应用程序的访存特征表项，访存特征表项包括应用程序的访存停顿时间；若访存特征表中包含应用程序的访存特征表项，第一节点则根据应用程序的访存特征表项，结合内存分配策略为应用程序分配第一节点的本地内存和/或第一节点的远程内存。本发明用于节点操作系统执行应用程序的过程中。
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公开(公告)号：CN104899093B
公开(公告)日：2018-06-05
申请号：CN201410076806.9
申请日：2014-03-04
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
CPC classification number: G06F9/5005 , G06F9/50 , G06F9/5022 , G06F9/5027 , G06F2209/5018
Abstract: 本发明实施例提供数据处理方法、装置和系统，在本发明实施例中，操作系统在接收到预留硬件线程的请求后，将任务代码载入预留的硬件线程，由预留的硬件线程执行后续的任务代码，或者，操作系统将任务代码载入硬件线程进行执行的过程中，当硬件线程读取到了小任务代码标识，则将小任务代码载入到预留的硬件线程进行执行，从而不用为每个任务对应的任务代码创建线程。本发明实施例的方案和现有技术的方案中的操作系统在执线程中的任务代码时为每个任务对应的任务代码创建线程并在执行完任务对应的任务代码后释放对应线程相比，尤其是在任务中包括较多小任务的情况下，大幅度节省了系统的开销，提高了系统资源利用率。
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公开(公告)号：CN104281545B
公开(公告)日：2018-02-23
申请号：CN201310291218.2
申请日：2013-07-11
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
CPC classification number: Y02D10/14 , Y02D10/151
Abstract: 本发明实施例公开了一种数据读取方法及设备，涉及计算机领域，降低了大量数据连续读取过程中的操作复杂度和功耗。具体方案为：MC将需要读取的数据在存储器中的行地址发送至存储器，以便存储器将存储器中与行地址对应行的数据存储在存储器的缓冲区中；MC向存储器发送第一命令，以便存储器根据第一命令遍历所有列地址将需要读取的数据发送至MC；其中，需要读取的数据为缓冲区中存储的与行地址对应行的所有数据，第一命令用于激活存储器中的直接存储器存取DMA逻辑；MC接收存储器发送的需要读取的数据。本发明用于数据读取的过程中。
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公开(公告)号：CN105446700B
公开(公告)日：2018-01-02
申请号：CN201410239150.8
申请日：2014-05-30
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
Abstract: 本发明实施例公开了一种指令执行方法以及顺序处理器，用于在顺序处理器中组合指令，减少空拍，更大程度的发挥处理器性能。本发明实施例方法包括：顺序处理器按照指令顺序依次将多条指令融合成指令组合，其中，所述多条指令的执行拍数之和不大于所述最大执行拍数，再依次发射融合出的各指令组合，顺序执行各指令组合中的指令。
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公开(公告)号：CN105095116B
公开(公告)日：2017-12-12
申请号：CN201410211355.5
申请日：2014-05-19
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/0804 , G06F12/126
Abstract: 本发明实施例提供一种缓存替换的方法、缓存控制器和处理器，所述方法包括：缓存控制器通过确定待替换缓存行的关联缓存池，关联缓存池中的各关联缓存行与待替换缓存行属于同一内存行，并且进一步根据关联缓存行的访问信息从关联缓存池中确定待写回缓存行，将待替换缓存行以及待写回缓存行中的数据一起写入内存。由于待替换缓存行和待写回缓存行属于同一内存行，因此，能够提高行缓存区的命中率，从而提高内存访问性能，另外，缓存控制器进一步根据关联缓存行的访问信息从关联缓存池中确定待写回缓存行，只将关联缓存池中的待写回缓存行写回内存，因此，能够减少内存的写次数，提高内存的使用寿命。
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