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公开(公告)号：CN106872780B
公开(公告)日：2019-03-05
申请号：CN201710052697.0
申请日：2017-01-24
Applicant: 东南大学
IPC: G01R25/00
Abstract: 本发明的固支梁T型结间接加热在线式未知频率微波相位检测器由六端口固支梁耦合器，通道选择开关，微波频率检测器，微波相位检测器级联构成；六端口固支梁耦合器由共面波导，介质层，空气层和固支梁构成，两个固支梁之间的共面波导长度为λ/4；六端口固支梁耦合器的第一端口到第三端口、第四端口以及第一端口到第五端口、第五端口的耦合度分别相同，待测信号经第一端口输入，由第二端口输出下级处理电路，由第四端口和第六端口输出微波相位检测器，由第三端口和第五端口输出通道选择开关；通道选择开关的第七端口和第八端口接间接加热式微波功率传感器，通道选择开关的第九端口和第十端口接微波频率检测器；实现了对未知频率信号的0‑360°相位在线检测。
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公开(公告)号：CN106645920B
公开(公告)日：2019-03-05
申请号：CN201710052668.4
申请日：2017-01-24
Applicant: 东南大学
Abstract: 本发明的固支梁T型结间接加热式微波信号检测器由六端口固支梁耦合器，通道选择开关，微波频率检测器，微波相位检测器级联构成；六端口固支梁耦合器由共面波导，介质层，空气层和固支梁构成；六端口固支梁耦合器的第一端口到第三端口、第四端口以及第一端口到第五端口、第六端口的功率耦合度相同，待测信号经第一端口输入，由第二端口输出到第一间接加热式微波功率传感器，由第四端口和第六端口输出到微波相位检测器；由第三端口和第五端口输出到通道选择开关；通道选择开关的第七端口和第八端口分别接间接加热式微波功率传感器，通道选择开关的第九端口和第十端口接微波频率检测器；从而实现了对微波信号功率、相位、频率的检测。
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公开(公告)号：CN104935334B
公开(公告)日：2017-09-29
申请号：CN201510378247.1
申请日：2015-07-01
Applicant: 东南大学
IPC: H03L7/093
Abstract: 本发明的硅基低漏电流双固支梁可动栅NMOS相位检测器，由双固支梁可动栅NMOS管和低通滤波器构成。NMOS管为增强型，制作在Si衬底上，栅极悬浮在栅氧化层上方，与下拉电极和绝缘层共同构成一个固支梁可动结构。固支梁的下拉偏置电压设计等于NMOS管的阈值电压。当双固支梁都被下拉时，输入信号通过双固支梁可动栅NMOS管实现信号相乘，经低通滤波器后完成相位检测。当仅其中一个固支梁被下拉时，器件具有较高击穿电压，被选通的信号经过双固支梁可动栅NMOS管实现信号放大，从而使得同一电路可以在信号放大与相位检测两种不同模式下切换。同时由于固支梁可动栅的设计使得器件减小了漏电流，有效地降低了漏电流功耗。
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公开(公告)号：CN106841771A
公开(公告)日：2017-06-13
申请号：CN201710052712.1
申请日：2017-01-24
Applicant: 东南大学
Abstract: 本发明的固支梁T型结直接加热式微波信号检测器由六端口固支梁耦合器，通道选择开关，微波频率检测器，微波相位检测器，直接加热式微波功率传感器级联构成；两个固支梁之间的共面波导长度为λ/4；六端口固支梁耦合器的第一端口到第三端口、第四端口以及第一端口到第五端口、第六端口的功率耦合度分别相同，待测信号经第一端口输入，并由第二端口输出直接加热式微波功率传感器，由第四端口和第六端口输出微波相位检测器，由第三端口和第五端口输出通道选择开关；通道选择开关的第七端口和第八端口接直接加热式微波功率传感器，通道选择开关的第九端口和第十端口接微波频率检测器；实现了一个芯片同时对微波信号的功率、相位、频率检测。
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公开(公告)号：CN103915459B
公开(公告)日：2016-06-29
申请号：CN201410098094.0
申请日：2014-03-17
Applicant: 东南大学
IPC: H01L27/146
Abstract: 自供电射频收发组件中砷化镓基热电-光电微传感器由几个相同传感器模块组成的阵列结构。其中每个传感器模块由许多组热电偶串联连接。传感器的热端放置在功率放大器热量集中的部位（散热板），而冷端远离热量集中的部分且紧靠金属外壳（热沉板），以达到冷热两端形成较大温差。基于Seebeck效应在传感器阵列结构上产生直流电压的输出，该直流电压对充电电池进行充电储能；在传感器的半导体热偶臂的顶部制作一个PN结，并构成电流通路正向有序排列，并在PN结上方的热沉板开孔以增加光照面积，形成可以收集光能的光电式微传感器。能够同时收集光能、热能的能量实现自供电，相比传统的收集单一能量的自供电传感器，本发明体积更小，供电能力大大提高。同时，射频收发组件工作中散发的热量得到了有效吸收，增强了其散热性能。
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Patent Agency Ranking
公开(公告)号：CN104935334A
公开(公告)日：2015-09-23
申请号：CN201510378247.1
申请日：2015-07-01
Applicant: 东南大学
IPC: H03L7/093
Abstract: 本发明的硅基低漏电流双固支梁可动栅NMOS相位检测器，由双固支梁可动栅NMOS管和低通滤波器构成。NMOS管为增强型，制作在Si衬底上，栅极悬浮在栅氧化层上方，与下拉电极和绝缘层共同构成一个固支梁可动结构。固支梁的下拉偏置电压设计等于NMOS管的阈值电压。当双固支梁都被下拉时，输入信号通过双固支梁可动栅NMOS管实现信号相乘，经低通滤波器后完成相位检测。当仅其中一个固支梁被下拉时，器件具有较高击穿电压，被选通的信号经过双固支梁可动栅NMOS管实现信号放大，从而使得同一电路可以在信号放大与相位检测两种不同模式下切换。同时由于固支梁可动栅的设计使得器件减小了漏电流，有效地降低了漏电流功耗。
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公开(公告)号：CN103915459A
公开(公告)日：2014-07-09
申请号：CN201410098094.0
申请日：2014-03-17
Applicant: 东南大学
IPC: H01L27/146
Abstract: 自供电射频收发组件中砷化镓基热电-光电微传感器由几个相同传感器模块组成的阵列结构。其中每个传感器模块由许多组热电偶串联连接。传感器的热端放置在功率放大器热量集中的部位（散热板），而冷端远离热量集中的部分且紧靠金属外壳（热沉板），以达到冷热两端形成较大温差。基于Seebeck效应在传感器阵列结构上产生直流电压的输出，该直流电压对充电电池进行充电储能；在传感器的半导体热偶臂的顶部制作一个PN结，并构成电流通路正向有序排列，并在PN结上方的热沉板开孔以增加光照面积，形成可以收集光能的光电式微传感器。能够同时收集光能、热能的能量实现自供电，相比传统的收集单一能量的自供电传感器，本发明体积更小，供电能力大大提高。同时，射频收发组件工作中散发的热量得到了有效吸收，增强了其散热性能。
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公开(公告)号：CN114818568B
公开(公告)日：2024-12-24
申请号：CN202210480924.0
申请日：2022-05-05
Applicant: 东南大学
IPC: G06F30/331
Abstract: 本发明公开了针对静态时序分析中CCS模型回代求解的FPGA硬件加速方法，本发明在FPGA上实现矩阵前后向回代过程的并行架构，核心部分为计算PE阵列。该架构与传统CPU相比可以减少时序分析过程中CCS模型求解的运行时间，提高时序分析工具性能。本发明首先将时序分析工具求解后的矩阵数据传输至FPAG内部。FPGA上的PS端ARM通用处理器打开DMA通道将矩阵数据从DRAM中按列搬运至片上内存BRAM中，同时控制数据传输、分配BRAM数据并配置PE，按列顺序将数据前向回代求解。后向回代同理，计算过程采用流水线方式，复用PE阵列、减法器和触发器等模块。计算结果将被写回DRAM中而后传输至PC。
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公开(公告)号：CN117540675A
公开(公告)日：2024-02-09
申请号：CN202311399165.6
申请日：2023-10-26
Applicant: 东南大学
IPC: G06F30/337 , G06F30/3315 , G06N3/042 , G06N3/0455 , G06N3/08
Abstract: 本发明公开一种基于图神经网络的关键路径排序方法，属于计算、推算或计数的技术领域。该方法：首先，通过静态时序分析工具获得网表中的潜在关键路径集；然后，将包含电路功能信息的网表文件转换为图数据结构，并根据相关工艺配置文件获得初始训练集；接着，将初始训练集输入图神经网络训练，获得关键单元预测模型，该关键单元预测模型由深层结构自编码器、非线性属性自编码器和联合误差重建模块三个部分构成；最后，根据网表中的关键单元信息和路径关键性计算算法，量化潜在关键路径集中每个路径的关键性，并得到工艺感知下的关键路径排序。该方法能够有效地对受工艺偏差影响的电路内关键路径进行排序，为电路优化提供有价值的参考。
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公开(公告)号：CN114239444B
公开(公告)日：2023-08-29
申请号：CN202111570389.X
申请日：2021-12-21
Applicant: 东南大学
IPC: G06F30/327 , G06F30/3312 , G06F115/02
Abstract: 本发明提出一种基于块的电路延时模型的建立方法，提高先进工艺近阈值工作电压条件下，电路时序行为描述的准确性，以及大规模电路时序行为分析的速度。首先，采用基于块的统计静态时序分析方法，计算单输入单输出、双输入单输出、多输入单输出的延时特征，均值和方差，并通过仿真建立增量Δ模型，提高延时精度。其次，将组合逻辑电路网表转化成有向无环图，计算延时概率，标注有向无环图每条边的权值，采用平均‑最大联合标签最短路径算法，获得电路关键路径，结合Yen's偏离算法获得关键路径集合。
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