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公开(公告)号:CN105118089B
公开(公告)日:2018-03-20
申请号:CN201510511346.2
申请日:2015-08-19
Applicant: 上海兆芯集成电路有限公司
CPC classification number: G06T15/005 , G06T1/20
Abstract: 本发明的实施例提出一种三维图形管道中的可程序化像素设定方法。从缓存器读取多个第一像素的信息,以及将全部或一部分第一像素的信息打包至设定着色器执行线程,使得设定着色器执行线程执行时将第一像素的信息输出至流处理器进行建构图元拓朴的并行计算。将需要裁切的第二像素的信息打包至可视范围裁切着色器执行线程,使得可视范围裁切着色器执行线程执行时将第二像素的信息输出至流处理器进行像素裁切。从缓存器读取多个第三像素的信息,以及将全部或一部分第三像素的信息打包至属性着色器执行线程,使得属性着色器执行线程执行时将第三像素的信息输出至流处理器进行像素属性的并行计算。
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公开(公告)号:CN105118089A
公开(公告)日:2015-12-02
申请号:CN201510511346.2
申请日:2015-08-19
Applicant: 上海兆芯集成电路有限公司
CPC classification number: G06T15/005 , G06T1/20
Abstract: 本发明的实施例提出一种三维图形管道中的可程序化像素设定方法。从缓存器读取多个第一像素的信息,以及将全部或一部分第一像素的信息打包至设定着色器执行线程,使得设定着色器执行线程执行时将第一像素的信息输出至流处理器进行建构图元拓朴的并行计算。将需要裁切的第二像素的信息打包至可视范围裁切着色器执行线程,使得可视范围裁切着色器执行线程执行时将第二像素的信息输出至流处理器进行像素裁切。从缓存器读取多个第三像素的信息,以及将全部或一部分第三像素的信息打包至属性着色器执行线程,使得属性着色器执行线程执行时将第三像素的信息输出至流处理器进行像素属性的并行计算。
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