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公开(公告)号：CN119788431A
公开(公告)日：2025-04-08
申请号：CN202510278889.8
申请日：2025-03-11
Applicant: 山东华翼微电子技术股份有限公司
IPC: H04L9/40 , H04L61/2517 , H04L61/255
Abstract: 本发明属于计算机网络安全技术领域，具体涉及一种基于FPGA的千兆IPSec大规模安全策略查询方法及装置。所述方法包括：接收用户下发的多条安全策略；接收用户从网络报文中提取的五元组，于每个time_tuple5时间范围内监测是否有用户输入的五元组，若有，则将其填充进tuple5_array中，否则将0作为1个五元组填充进tuple5_array中；当tuple5_array中存在num_tuple5个五元组时，对tuple5_array中的五元组进行多级安全策略查询，并基于末级查询结果生成result(m)_array；判断result(m)_array的正确性，以筛选出其中的有效查询结果并依次输出给用户。
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公开(公告)号：CN116723227A
公开(公告)日：2023-09-08
申请号：CN202310706491.0
申请日：2023-06-14
Applicant: 山东华翼微电子技术股份有限公司
Inventor： 张明瑞
IPC: H04L67/30 , H04W4/30 , G06F8/65 , H04L67/06 , H04W12/033 , H04W12/0431
Abstract: 本发明公开了一种基于5G通信的多FPGA配置文件远程更新方法，属于FPGA应用技术领域，所述方法包括：配置文件远程更新控制器接收5G报文；握手协商模块和发送方协商出本次下发配置文件使用的秘钥；解密模块利用所述秘钥对下发的配置文件进行解密，将配置文件发送到FPGA全局配置控制模块或FPGA动态重构控制模块；SPI切换控制模块向多FPGA切换控制器发送指令；多FPGA切换控制器根据接收到的指令，利用SPI多主多从控制模块实现FPGA配置文件的全局配置，或是利用SPI一主多从控制模块实现FPGA配置文件的局部动态重构。本发明可以同时对多个FPGA进行高效、稳定、远距离的配置文件远程更新。
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公开(公告)号：CN116301272A
公开(公告)日：2023-06-23
申请号：CN202310293908.5
申请日：2023-03-21
Applicant: 山东华翼微电子技术股份有限公司
Abstract: 本发明公开了一种服务器、服务器上电管理系统及方法，属于计算机技术领域，所述服务器包括服务器主板，服务器主板包括上电被控区域和上电管理区域，上电管理区域设有上电控制FPGA、FLASH和上电触发源，其中：上电控制FPGA包括用于与上位机连接的网口通信模块、与网口通信模块连接的加解密模块、与加解密模块的输出端连接的FLASH控制模块、以及与FLASH控制模块的输出端连接的上电管理模块；FLASH控制模块连接FLASH，上电管理模块连接上电被控区域中的被控模块和上电触发源。本发明灵活性高，不需要重新烧写FPGA，即便是主板封闭在机箱中，也能远程管理服务器主板上电时序。
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公开(公告)号：CN119249379A
公开(公告)日：2025-01-03
申请号：CN202411783758.7
申请日：2024-12-06
Applicant: 山东华翼微电子技术股份有限公司
Abstract: 本发明属于信息安全的技术领域，更具体地，涉及一种支持多用户多任务的USB加密卡及其实现方法。所述方法包括一种支持多用户多任务的USB加密卡，采用模块化设计，包括一个管理核心板、多个资源核心板以及底板。管理核心板包括管理CPU、数据中转FPGA、AI加速FPGA以及存储器。资源核心板包括一个资源FPGA及其时钟、电源等外围电路。管理CPU，包括基于AI的资源调度模块、上位机通信模块、加密卡协同模块、算法核配置模块。本发明解决了USB加密卡的两个问题，一是往往只支持单用户，无法同时对多个用户的数据进行加解密处理，二是对单个用户的多个加解密任务，通过串行下发数据的方式实现，无法同时对多个加解密任务进行计算，效率低下。
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公开(公告)号：CN119030796B
公开(公告)日：2024-12-17
申请号：CN202411506621.7
申请日：2024-10-28
Applicant: 山东华翼微电子技术股份有限公司
IPC: H04L9/40 , H04L69/22 , H04L49/9047 , H04L49/90
Abstract: 本发明属于电子数字数据处理的技术领域，更具体地，涉及一种基于SOC和FPGA的万兆IPsec设备及其方法。所述设备包括内网FPGA、外网FPGA、算法FPGA和管理SOC；内网FPGA通过万兆网口与内网相连，通过GT接口与算法FPGA相连，通过GT接口与管理SOC的PL端相连；外网FPGA通过万兆网口与外网相连，通过GT接口与算法FPGA以及管理SOC的PL端相连；算法FPGA通过接口与内网FPGA相连，通过GT接口与外网FPGA和管理SOC相连；管理SOC的PL端通过GT接口与内网FPGA相连，PL端通过GT接口与外网FPGA和算法FPGA相连，PL端通过GT接口与外网相连。本发明减少了数据泄露的风险，实现了万兆网速并降低了设备功耗。
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Patent Agency Ranking
公开(公告)号：CN116723227B
公开(公告)日：2024-11-29
申请号：CN202310706491.0
申请日：2023-06-14
Applicant: 山东华翼微电子技术股份有限公司
Inventor： 张明瑞
IPC: H04L67/30 , H04W4/30 , G06F8/65 , H04L67/06 , H04W12/033 , H04W12/0431
Abstract: 本发明公开了一种基于5G通信的多FPGA配置文件远程更新方法，属于FPGA应用技术领域，所述方法包括：配置文件远程更新控制器接收5G报文；握手协商模块和发送方协商出本次下发配置文件使用的秘钥；解密模块利用所述秘钥对下发的配置文件进行解密，将配置文件发送到FPGA全局配置控制模块或FPGA动态重构控制模块；SPI切换控制模块向多FPGA切换控制器发送指令；多FPGA切换控制器根据接收到的指令，利用SPI多主多从控制模块实现FPGA配置文件的全局配置，或是利用SPI一主多从控制模块实现FPGA配置文件的局部动态重构。本发明可以同时对多个FPGA进行高效、稳定、远距离的配置文件远程更新。
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公开(公告)号：CN117827725A
公开(公告)日：2024-04-05
申请号：CN202410241134.6
申请日：2024-03-04
Applicant: 山东华翼微电子技术股份有限公司
Inventor： 张明瑞
Abstract: FPGA（Field Programmable Gate Array，现场可编程门阵列），具有设计灵活、可反复编程的优点，且具有丰富的GPIO资源。本发明提出一种基于FPGA的EMC接口扩展模块、系统及方法，涉及数字集成电路和电子信息应用领域，采用共享地址架构，将多个EMC接口及其他接口合并到同一个内存总线上，为一些需要大量外部存储器和其他接口扩展的系统提供更为高效和经济的解决方案，提高了系统的扩展性和灵活性。
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公开(公告)号：CN119449501A
公开(公告)日：2025-02-14
申请号：CN202510021448.X
申请日：2025-01-07
Applicant: 山东华翼微电子技术股份有限公司
Abstract: 本发明涉及电子信息应用技术领域，具体是一种具备网络报文处理功能的网卡。包括上位机接口、多通道DMA模块、策略存储模块、网络报文处理模块、存储数据处理模块、网络接口和存储接口。多通道DMA模块包括配置通道、网络输入通道、网络输出通道、存储写入通道、存储读取通道和存储指令通道。策略存储模块与配置通道相连，网络报文处理模块与网络输入通道、网络输出通道相连，存储数据处理模块连接于存储写入通道、存储读取通道、存储指令通道与存储接口之间，同时存储数据处理模块也与网络报文处理模块相连。本发明使网卡承担报文分类、报文安全检测以及存储直连互通的功能，从而分担CPU对网络报文的处理压力，减轻CPU的负载。
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公开(公告)号：CN119420707A
公开(公告)日：2025-02-11
申请号：CN202510018488.9
申请日：2025-01-07
Applicant: 山东华翼微电子技术股份有限公司
Inventor： 张明瑞
IPC: H04L47/43 , H04L45/7453
Abstract: 本发明属于网络通信的技术领域，更具体地，涉及一种基于FPGA的IP报文分片重组方法及系统。所述方法将IP报文分片重组的过程从CPU卸载到FPGA执行，减轻了CPU的负载；所述方法将IP报文分片的存储和重组划分为两个异步流程，存储流程负责将IP报文分片及其状态写入各类表，重组流程负责从各类表中获取IP报文分片及其状态，通过这样一个两级流水线结构提高了IP报文分片重组的效率。本发明采用TCAM进行IP报文分片的匹配，避免了常见的基于哈希运算的匹配方法带来的哈希值冲突问题；同时，采用了动态的资源分配和回收机制，提高了资源利用率。
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公开(公告)号：CN119030796A
公开(公告)日：2024-11-26
申请号：CN202411506621.7
申请日：2024-10-28
Applicant: 山东华翼微电子技术股份有限公司
IPC: H04L9/40 , H04L69/22 , H04L49/9047 , H04L49/90
Abstract: 本发明属于电子数字数据处理的技术领域，更具体地，涉及一种基于SOC和FPGA的万兆IPsec设备及其方法。所述设备包括内网FPGA、外网FPGA、算法FPGA和管理SOC；内网FPGA通过万兆网口与内网相连，通过GT接口与算法FPGA相连，通过GT接口与管理SOC的PL端相连；外网FPGA通过万兆网口与外网相连，通过GT接口与算法FPGA以及管理SOC的PL端相连；算法FPGA通过接口与内网FPGA相连，通过GT接口与外网FPGA和管理SOC相连；管理SOC的PL端通过GT接口与内网FPGA相连，PL端通过GT接口与外网FPGA和算法FPGA相连，PL端通过GT接口与外网相连。本发明减少了数据泄露的风险，实现了万兆网速并降低了设备功耗。
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