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公开(公告)号：CN101897189B
公开(公告)日：2016-07-06
申请号：CN200980101325.6
申请日：2009-10-09
Applicant: 松下电器产业株式会社
IPC: H04N19/70 , H04N19/61 , H04N19/174 , H04N19/44 , H04N19/436 , H04N19/573
CPC classification number: H04N19/573 , H04N19/174 , H04N19/436 , H04N19/44 , H04N19/61 , H04N19/70
Abstract: 包括：流划分部，按编码流中包含的每个图片，将该图片划分为多个MB行，将多个MB行的每一个分配到作为生成对象的四个划分流之中的任一个划分流的一部分，从而生成四个划分流；以及四个解码引擎，对四个划分流的每一个并行进行解码。流划分部，在图片中包含的片被划分为多个片部分而被分配到多个划分流时，按每个划分流，将片部分群重新构成为新的片，以使片部分群被解码引擎识别为片，片部分群是由解码引擎该划分流的至少一个片部分构成的。
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公开(公告)号：CN102439977B
公开(公告)日：2015-06-10
申请号：CN201180002164.2
申请日：2011-03-16
Applicant: 松下电器产业株式会社
IPC: H04N19/13
CPC classification number: H04N19/60 , H04N19/122 , H04N19/44 , H04N19/547
Abstract: 本发明的解码装置(100)，具备；解码部(101)，从上述编码流将确定信息进行解码，该确定信息用于确定在正交变换中利用的正交变换基；正交变换基积蓄部(110)，用于保存在逆正交变换中利用的多个正交变换基；正交变换基存储部(103)，保存被保存的多个正交变换基中的，逆正交变换所需要的正交变换基；逆正交变换部(112)，利用保存在正交变换基存储部(103)中、且由确定信息确定的正交变换基进行逆正交变换；以及正交变换基传送控制部(102)，仅在正交变换基存储部(103)未保存被确定的正交变换基的情况下，从正交变换基积蓄部(110)向正交变换基存储部(103)传送被确定的正交变换基。根据该结构，能够缩减存放了正交变换基的存储器的存储器频带以及减少存储器访问延迟。
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公开(公告)号：CN102176751B
公开(公告)日：2013-12-25
申请号：CN201110143608.6
申请日：2007-12-27
Applicant: 松下电器产业株式会社
CPC classification number: H04N19/00533 , H04N19/44 , H04N19/573 , H04N19/577 , H04N19/58 , H04N19/895
Abstract: 本发明涉及一种运动图像解码装置。包括：图像存储器(103)，将包含运动矢量信息的、以宏块为单位所描述的宏块信息和包含宏块的图像的已解码的图像数据对应起来并保存；错误判定部(104)，判定解码对象图像是否有错误；图像数据置换部(109)，在判定为有错误的情况下，将解码对象图像的图像数据，置换为在解码对象图像之前图像存储器(103)所保存的已解码的图像数据；以及宏块信息置换部(113)，在判定为有错误的情况下，将与包含错误的解码对象图像相对应的宏块信息，置换为与已解码的图像相对应而保存的宏块信息；或者宏块信息保存部(602)，将示出解码对象图像包含错误的信息与解码对象图像的图像数据对应起来并保存。
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公开(公告)号：CN103348678A
公开(公告)日：2013-10-09
申请号：CN201280003437.X
申请日：2012-11-22
Applicant: 松下电器产业株式会社
IPC: H04N7/32
CPC classification number: H04N19/50 , H04N19/433 , H04N19/46 , H04N19/52
Abstract: 图像处理装置具备：第一存储部(101)，用于存储在至少与一个图片对应的多个预测单元的预测图像的生成中所利用的多个预测参数；第二存储部(102)，用于存储在多个预测单元中的两个以上的预测单元的预测图像的生成中所利用的两个以上的预测参数；以及传输部(110)，将用于预测图像的生成的两个以上的预测参数从第一存储部(101)一起传输到第二存储部(102)，或者，将在预测图像的生成中所利用的两个以上的预测参数从第二存储部(102)一起传输到第一存储部(101)。
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公开(公告)号：CN101455087B
公开(公告)日：2011-01-12
申请号：CN200780018978.9
申请日：2007-05-23
Applicant: 松下电器产业株式会社
IPC: H04N7/32
CPC classification number: H04N19/139 , H04N19/105 , H04N19/109 , H04N19/137 , H04N19/176 , H04N19/43 , H04N19/436 , H04N19/51 , H04N19/52 , H04N19/61
Abstract: 本发明提供一种图像编码装置。在通过流水线对每个宏块并行进行图像的压缩编码处理的情况下，在通过MPEG4AVC的跳过模式等对编码对象块进行压缩编码时，需要与编码对象块邻接的邻接块的运动矢量等。但是，根据流水线阶段的结构的不同，有时没有确定邻接块的运动矢量等。在这种情况下，存在不能够通过跳过模式等对编码对象块进行压缩编码处理的问题。计算与编码对象块的前块所能够选择的所有的运动信息相对应的编码对象块的所有的运动信息候补，在确定了前块的运动信息后，在计算出的运动信息候补中，将与对前块的确定的运动信息对应的运动信息作为编码对象块的跳过模式等的运动信息。
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Patent Agency Ranking
公开(公告)号：CN100557565C
公开(公告)日：2009-11-04
申请号：CN200510113272.3
申请日：2005-07-06
Applicant: 松下电器产业株式会社
IPC: G06F9/38
CPC classification number: G06F9/3877 , G06F9/3885
Abstract: 一种具备主处理器和协处理器的运算处理装置，主处理器具有：根据运算指令进行运算时用于保存运算对象或结果的多个寄存器、和逐次解释指令并进行根据指令的控制的指令解释控制部，此指令解释控制部利用操作数来指定：在上述协处理器中应执行的运算处理的种类、表示保存该运算处理对象的第一寄存器的信息和表示应保存上述协处理器进行运算处理的结果的第二寄存器的信息，通过解释用于请求向协处理器的运算的1条指令即协处理器运算指令，从而进行下述控制：在上述协处理器中，将第一寄存器的内容作为运算处理对象以执行该种类的运算处理，进而将由上述协处理器生成的此运算处理结果写入第二寄存器。
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公开(公告)号：CN101569198A
公开(公告)日：2009-10-28
申请号：CN200880000678.2
申请日：2008-05-01
Applicant: 松下电器产业株式会社
IPC: H04N7/26
CPC classification number: H03M7/40 , H04N19/44 , H04N19/61 , H04N19/89 , H04N19/895
Abstract: 提供一种解码装置，其能够通过减少错误的误检测，且有效地检测错误，从而正确地进行错误隐藏。对以块为单位被编码的编码图像进行解码的解码装置(100)具有：可扩展解码部(101)，对编码图像进行解码；错误发生位置决定部(109)，利用量化参数，决定有可能发生了错误的候补块，所述量化参数是通过可扩展解码部(101)按照每个块进行解码而得到的量化参数；以及错误修整部(110)，对错误发生位置决定部(109)所决定的候补块以后的块进行修整。
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公开(公告)号：CN101543082A
公开(公告)日：2009-09-23
申请号：CN200880000638.8
申请日：2008-05-14
Applicant: 松下电器产业株式会社
IPC: H04N7/32
CPC classification number: H04N19/52 , H04N19/433 , H04N19/44 , H04N19/573 , H04N19/61
Abstract: 本发明提供一种运动图像解码装置，对具有编码图像的运动图像数据进行解码，该编码图像是通过编码方式进行编码而得到的编码图像，该编码方式是指最多参考n(n为2以上的整数)幅的图像来进行帧间预测的编码方式，所述运动图像解码装置，包括：H.264解码器，利用帧间预测对运动图像数据中包含的编码图像进行解码；外部存储器，保持已解码图像，以使该已解码图像被输出到外部；内部存储器，能够存储n幅已解码图像，该n幅已解码图像是在帧间预测时能够参考的n幅已解码图像；以及第二传输部，将已解码图像从外部存储器传输到内部存储器，使得在对一幅编码图像开始进行解码之前n幅已解码图像被存储在内部存储器。
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公开(公告)号：CN101010671A
公开(公告)日：2007-08-01
申请号：CN200580026332.6
申请日：2005-08-02
Applicant: 松下电器产业株式会社
IPC: G06F15/80
CPC classification number: G06F15/8007 , G06F1/3203 , G06F9/3842 , G06F9/3885 , H04N19/43 , H04N19/61
Abstract: 一种阵列式运算装置，具有由依次配置的多个处理器单元构成的处理器阵列；在每一个周期发行1个指令；在每一个周期，制作用于控制最初的处理器单元的动作的动作控制信息，根据制作的动作控制信息和1个指令，生成对最初的处理器单元的指令；根据为了控制前1个处理器单元的动作而制作的动作控制信息，制作用于控制其它处理器单元的动作的动作控制信息；根据制作的动作控制信息和由上述指令取得单元取得的1个指令，生成对上述处理器单元的指令。
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公开(公告)号：CN1327340C
公开(公告)日：2007-07-18
申请号：CN200410081755.5
申请日：2004-12-30
Applicant: 松下电器产业株式会社
CPC classification number: G06F9/3853 , G06F9/30145 , G06F9/30156 , G06F9/3016 , G06F9/3822 , G06F9/3885
Abstract: 一种具有指令集的VLIW处理器，其尺寸减小以便需要较小的位数来指定寄存器。该VLIW处理器(10)包括寄存器文件(12)，第一至第三运算单元(14a-14c)等，并且执行特长指令字。该特长指令字包括寄存器指定字段，其指定寄存器文件(12)中最小的一个寄存器和多个指令。每个指令的操作数具有src1 src2和dst位，指示由寄存器指定字段指定的寄存器是否将被用作源寄存器和目的寄存器。
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