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公开(公告)号：CN105159426A
公开(公告)日：2015-12-16
申请号：CN201510387404.5
申请日：2012-09-21
Applicant: 株式会社东芝
Abstract: 公开了控制设备和控制方法。根据一种实施方式，控制设备包括接收单元、判断单元、估计单元、决定单元、指示单元和发送单元。接收单元被配置成接收请求处理设备执行中断处理的中断请求，处理设备包括能够单独地经受电压控制的元件。判断单元被配置成判断元件的状态。估计元件被配置成估计在供电之后元件变成运行模式的启动时间。决定单元被配置成基于元件之间启动时间的差来决定要开始供电的时间。指示单元被配置成指示用于向元件供电的供电单元。发送单元被配置成发送中断请求。
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公开(公告)号：CN103309424A
公开(公告)日：2013-09-18
申请号：CN201310079444.4
申请日：2013-03-13
Applicant: 株式会社东芝
IPC: G06F1/26
CPC classification number: G06F1/26 , G06F1/263 , G06F1/305 , G06F1/3212 , Y02D10/174
Abstract: 本发明涉及状态控制设备、信息处理设备以及半导体设备。根据一实施例，状态控制设备控制信息处理设备的状态转变并且包括：处理器；向处理器供电的电源单元；以及累积电源单元的过剩电力并且在电源单元所供应的电力不足时至少向处理器供应所累积的电力的电存储单元。状态控制设备包括控制器，以便：当电存储单元中所累积的电量减少到第一电量而信息处理设备处于第一状态时，使信息处理设备从第一状态转变到其中处理器的功耗比在第一状态中的功耗低的第二状态，而且，当电存储单元中所累积的电量增加到大于第一电量的第二电量而信息处理设备处于第二状态时，使信息处理设备从第二状态转变到第一状态。
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公开(公告)号：CN103064500A
公开(公告)日：2013-04-24
申请号：CN201210355544.0
申请日：2012-09-21
Applicant: 株式会社东芝
Abstract: 公开了控制设备和控制方法。根据一种实施方式，控制设备包括接收单元、判断单元、估计单元、决定单元、指示单元和发送单元。接收单元被配置成接收请求处理设备执行中断处理的中断请求，处理设备包括能够单独地经受电压控制的元件。判断单元被配置成判断元件的状态。估计元件被配置成估计在供电之后元件变成运行模式的启动时间。决定单元被配置成基于元件之间启动时间的差来决定要开始供电的时间。指示单元被配置成指示用于向元件供电的供电单元。发送单元被配置成发送中断请求。
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公开(公告)号：CN100507878C
公开(公告)日：2009-07-01
申请号：CN200610166789.3
申请日：2006-11-30
Applicant: 株式会社东芝
Abstract: 一种访问控制设备，包括：奇偶校验码生成器，针对要写入存储器的原始数据，生成奇偶校验码；奇偶校验码加法器，通过把奇偶校验码添加到原始数据上，生成添加有奇偶校验码的数据；第一校正子生成器，生成第一掩码数据的第一校正子，以便对所述添加有奇偶校验码的数据进行掩码。所述第一校正子是预先与第一访问代码相关联的并且写入器访问存储器时所用的值。所述设备还包括：第一掩码生成器，根据第一校正子、第一访问代码以及第一存储器地址，生成第一掩码数据；第一异或单元，通过在所述添加有奇偶校验码的数据和所述第一掩码数据之间进行异或计算，获取第一运算后数据；写入单元，把所述第一运算后数据写入存储器。
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公开(公告)号：CN1924880A
公开(公告)日：2007-03-07
申请号：CN200610128028.9
申请日：2006-08-31
Applicant: 株式会社东芝
IPC: G06F21/00
CPC classification number: G06F12/1466 , G06F21/445 , G06F21/57 , G06F2221/2129
Abstract: 一种处理器，包括一个计算单元，用来利用存储在第一存储器和第二存储器中的数据执行计算；一个存储单元，与该计算单元集成在一起，用来存储第一认证信息和第二认证信息；一个读取单元，用来从第一存储器读取第一信息和从第二存储器读取第二信息；一个认证单元，用来通过比较第一信息和第一认证信息来认证该第一存储器，和通过比较第二信息和第二认证信息来认证该第二存储器；和一个控制单元，用来根据该认证单元的认证结果，控制该计算单元和第一存储器间的第一访问，以及控制该计算单元和该第二存储器间的第二访问。
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Patent Agency Ranking
公开(公告)号：CN1203430C
公开(公告)日：2005-05-25
申请号：CN00129285.4
申请日：2000-09-30
Applicant: 株式会社东芝
CPC classification number: G06F9/5055 , G06F9/5027 , G06F2209/5018 , Y10S707/99944 , Y10S707/99945 , Y10S707/99948
Abstract: 本发明提供了一种数据管理系统，包括：数据存储系统，用于存储将要对其进行操作的、具有不同操作内容的数据；操作单元，用于从所述数据存储系统读取所述应用程序所要求的数据，从所述多个数据操作部分中选择一个应对所述数据执行操作的数据操作部分，以使被读出的所述数据与将由所述应用程序用以执行处理的数据模型相适应，并且将由被选择的数据操作部分操作过的数据提供给应用程序；以及对信息进行相关记录的单元，所述信息用于确定在将所述数据存储系统中所存储的数据提供给所述应用程序时，应该选择哪个数据操作部分以及应该采取什么样的顺序对所述数据进行操作；所述操作单元被配置成根据与被读出的数据相关而被记录的所述信息进行操作。
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公开(公告)号：CN1346091A
公开(公告)日：2002-04-24
申请号：CN00129088.6
申请日：2000-09-29
Applicant: 株式会社东芝
IPC: G06F12/00
Abstract: 一个事务处理系统,这个事务处理系统通过多个事务并行工作能够轻易地和有效地实现文件更新处理和在发生故障时实现恢复处理。在这个事务处理系统中,对被读取到一个缓冲器区域的一个文件执行更新处理的多个事务被执行,并且在多个事务中的一个事务进行提交的时刻,一个文件被写入到稳定存储器装置,其中一个文件包括被这一个事务所进行的提交更新内容和其它非提交事务所进行的非提交更新内容,和用于取消非提交更新所需要的信息。
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公开(公告)号：CN105446453A
公开(公告)日：2016-03-30
申请号：CN201510566816.5
申请日：2015-09-08
Applicant: 株式会社东芝
IPC: G06F1/32
CPC classification number: G06F1/3287 , Y02D10/171 , Y02D50/20
Abstract: 一种电子装置，包括多个功能模块和多个转换器。所述功能模块包括处理器，状态保持单元，接收单元，以及控制器。处理器包括在其中存储状态信息的存储器。每一转换器将电源电压转换成额定电压并供应到至少一个功能模块。当处理器切换到待机状态时，控制器停止到除了状态保持单元、接收单元、以及控制器之外的功能模块的额定电压的供应，并停止未连接到状态保持单元、接收单元、以及控制器的转换器的操作。状态保持单元保持处理器切换到待机状态前的状态信息。接收单元接收返回信号。响应于由接收单元接收到返回信号，处理器将状态保持单元中保持的状态信息写回存储器。状态保持单元、接收单元、以及控制器被连接到来自转换器中的相同的转换器。
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公开(公告)号：CN104460937A
公开(公告)日：2015-03-25
申请号：CN201410471444.3
申请日：2014-09-16
Applicant: 株式会社东芝
CPC classification number: G09G3/2096 , G06F3/0483 , G09G3/3453 , G09G5/028 , G09G5/34 , G09G2310/04 , G09G2310/08 , G09G2330/021 , G09G2380/14
Abstract: 本发明涉及一种控制装置、显示装置、控制方法和程序产品。根据实施例的一种控制装置可以控制电子纸中的目标区域的更新。所述装置可包括分割器单元、管理器单元和更新指示单元。所述分割器单元可被配置为将所述目标区域分割成多个子区域。所述管理器单元可被配置为配置每个子区域的更新开始定时，以使得在子区域的更新处发生的闪烁在不同的定时处出现。所述更新指示单元可被配置为指示以根据更新开始定时执行每个子区域的更新过程。
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公开(公告)号：CN103530064A
公开(公告)日：2014-01-22
申请号：CN201310046903.9
申请日：2013-02-06
Applicant: 株式会社东芝
CPC classification number: G06F1/3237 , G06F1/04
Abstract: 本发明涉及存储器控制设备、半导体设备与系统板。根据一种实施例，一种存储器控制设备控制由处理器从其读数据/向其写数据的存储器。该存储器控制设备包括时钟开关和控制信号开关。时钟开关接收第一时钟和处于比第一时钟更高频率的第二时钟作为输入，把第一时钟提供给存储器，直到第二时钟变得稳定，并且在第二时钟变得稳定之后提供第二时钟。在第一时钟提供给存储器的同时，控制信号开关开始向存储器提供用于把该存储器初始化成允许由处理器进行数据读/写的状态的第一控制信号，并且，在第二时钟提供给存储器且存储器初始化之后，根据处理器进行的数据读/写向存储器提供第二控制信号。
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