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公开(公告)号：CN118467311A
公开(公告)日：2024-08-09
申请号：CN202410444363.8
申请日：2024-04-12
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F11/34
Abstract: 本发明公开了一种服务器能效测试方法、装置、设备及介质，涉及服务器测试技术领域。该方法中，通过神经网络模型预测待测服务器的在当前配置时的能效值，大大减少了测试的时长，提高了测试效率；将样本服务器中的非数值类的配置参数转换为数值类的配置参数，使得非数值类的配置参数可以作为神经网络模型的训练数据，且转换时，直接依据样本服务器中的非数值类的配置参数转换为数值类的配置参数的转换规则进行转换，使得待测服务器中的非数值类的配置参数能够输入至神经网络模型中，提高了神经网络模型预测的能效值的准确性；根据中央处理器的架构类型和服务器的类型建立了多种类型的神经网络模型，实现了对各种类型的服务器能效值的较准确地预测。
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公开(公告)号：CN116069711B
公开(公告)日：2023-07-14
申请号：CN202310362884.4
申请日：2023-04-07
Applicant: 浪潮电子信息产业股份有限公司
Abstract: 本申请公开了一种直接内存访问控制器、异构设备、内存访问方法及介质，涉及内存访问技术领域。该直接内存访问控制器包括：多个读描述符管理模块、多个写描述符管理模块、读数据搬移器和写数据搬移器；一个读描述符管理模块/写描述符管理模块对应一个物理功能/虚拟功能的管理通道；读描述符管理模块用于将描述符寄存器中内容转换为读描述符，将读描述符数据转换为读描述符；写描述符管理模块用于将写描述符数据转换为写描述符；读数据搬移器用于根据读描述符向上位机发送读请求，接收读请求对应的第一数据并进行数据处理；写数据搬移器用于根据写描述符读取对应的第二数据，基于第二数据生成写请求发送给上位机。能支持单根I/O虚拟化。
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公开(公告)号：CN111736867A
公开(公告)日：2020-10-02
申请号：CN202010506249.5
申请日：2020-06-05
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F8/65
Abstract: 本申请公开了一种FPGA更新设备、方法以及存储介质。FPGA更新设备包括控制芯片以及逻辑运算芯片，逻辑运算芯片通过协议转换接口以及指令接口分别与控制芯片连接，在此基础上，逻辑运算芯片通过指令接口接收控制芯片传入的FPGA更新指令，并利用协议转换接口接收基于初始传输协议传入的FPGA固件，进而根据FPGA更新指令控制协议转换接口将FPGA固件以目标传输协议传输至FPGA的配置接口，以此实现了对FPGA的更新。此外，本申请还提供一种FPGA更新方法以及存储介质，有益效果同上所述。
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公开(公告)号：CN119766709A
公开(公告)日：2025-04-04
申请号：CN202510252588.8
申请日：2025-03-05
Applicant: 浪潮电子信息产业股份有限公司
IPC: H04L43/50 , H04L43/0894
Abstract: 本发明公开了一种回环测试方法、装置、系统、电子设备、介质及程序产品，涉及通信技术领域。部署在不支持寄存器控制收发两端的回环读写的处理器上，并测试其网络质量的回环测试装置包括数据缓存模块和读写控制逻辑模块。数据缓存模块与处理器自身的分段式接口与网络通信模块相连，其对通过网络通信模块和分段式接口收发的数据包进行缓存。读写控制逻辑模块与数据缓存模块相连，其根据数据包的包结束位置可在当数据缓存模块达到临界存储阈值条件时，保证从数据缓存模块中读写完最后一个数据包。本发明可以解决相关技术在对处理器进行MAC测试时，控制逻辑复杂的问题，能够高效简单地实现对处理器的MAC回环测试，控制逻辑简单且资源占用少。
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公开(公告)号：CN115800992B
公开(公告)日：2023-06-02
申请号：CN202310070901.7
申请日：2023-02-07
Applicant: 浪潮电子信息产业股份有限公司
IPC: H03K19/0175
Abstract: 本发明公开了一种握手信号的拆分电路、方法、装置、设备及存储介质，属于数字电路领域，用于对握手信号进行拆分。逻辑控制电路可以在与第二电平处理模块的配合下，在前端模块的有效信号输出端输出第一电平且自身对应的后端模块的反馈信号输出端输出第二电平时，仅控制自身对应的后端模块完成本次握手，并在前端模块完成本次握手前，向自身对应的后端模块的有效信号接收端输出与第一电平相反的电平，以防其再次接收数据，并向第一电平处理模块输出第二电平，以便第一电平处理模块在所有后端模块完成本次握手后输出第二电平，使前端模块完成本次握手，使多个后端模块可以同时/分时接收数据，提升了后端数据计算的灵活性，扩展了应用场景。
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Patent Agency Ranking
公开(公告)号：CN111857303B
公开(公告)日：2022-05-17
申请号：CN202010616589.3
申请日：2020-06-30
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F1/24 , G06F8/61 , G06F9/4401
Abstract: 本申请提供一种FPGA复位方法，包括：判断服务器与FPGA的通信状态是否是异常状态；若通信状态是异常状态，则卸载FPGA驱动；发送重置指令至MCU，以使MCU将对应的镜像文件传输至FPGA，实现FPGA的复位。可见，本申请中通过在服务器与FPGA的通信状态是异常状态后，卸载FPGA驱动，避免了重置前后FPGA的驱动信息不一致的情况，解决了由于变动引起的服务器重启的问题，然后发送重置指令至MCU，以使MCU将镜像文件传输至FPGA，加载镜像文件使FPGA复位。本申请同时还提供了一种FPGA复位装置、电子设备和FPGA复位系统，均具有上述有益效果。
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公开(公告)号：CN118152749A
公开(公告)日：2024-06-07
申请号：CN202410141518.0
申请日：2024-01-31
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F18/20 , G06F18/214 , G06F18/241 , G06F11/30
Abstract: 本申请公开了一种服务器能耗预测方法，包括：获取基于信息增益计算选取得到的各能耗相关性能参数种类；根据各能耗相关性能参数种类采集待预测服务器当前时刻的各目标性能参数；将各目标性能参数输入至基于Elman神经网络的目标服务器能耗预测模型进行能耗预测，得到待预测服务器当前时刻的服务器能耗预测值。应用本申请所提供的服务器能耗预测方法，降低了数据中心的运维成本，降低了模型训练难度，提升了能耗预测可靠性和准确性。本申请还公开了一种服务器能耗预测装置、设备及存储介质，具有相应技术效果。
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公开(公告)号：CN116684506B
公开(公告)日：2023-11-07
申请号：CN202310961853.0
申请日：2023-08-02
Applicant: 浪潮电子信息产业股份有限公司
Abstract: 本发明公开了一种数据处理方法、系统、电子设备及计算机可读存储介质，涉及通信领域，为解决现有处理系统仅包括单块数字芯片导致的逻辑资源不足的问题，本发明的数据处理方法包括：当获取到操作命令，根据操作命令获取传输数据；基于目标传输协议对传输数据进行封装得到访问数据包，并将访问数据包发送至第二数字芯片，以便第二数字芯片返回基于访问数据包得到的响应数据包；第二数字芯片为多个数字芯片中与第一数字芯片对应的数字芯片；解析响应数据包得到第一返回数据，将第一返回数据发送给目标设备。本发明能够保证数字芯片的逻辑资源充足，满足加速开发应用的要求。
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公开(公告)号：CN116861448A
公开(公告)日：2023-10-10
申请号：CN202310498243.1
申请日：2023-04-27
Applicant: 浪潮电子信息产业股份有限公司
IPC: G06F21/60
Abstract: 本申请提供一种异构加密数据处理方法，包括：获取明文数据；将所述明文数据的配置数据下发至设备端；将所述明文数据传输至所述设备端；所述设备端收到所述配置信息对所述明文数据进行迭代压缩运算，得到哈希值；接收所述设备端返回的哈希值。本申请将逻辑运算和并行运算进行拆分，分别拆分至适合的主机端和设备端执行，充分考虑的异构加密算法的运算特点，适配SM3等算法的异构运行，提高了加密算法异构实现的性能，提升了设备端执行并行计算的运行效率。本申请还提供一种异构加密数据处理系统、计算机可读存储介质和电子设备，具有上述有益效果。
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公开(公告)号：CN116719755A
公开(公告)日：2023-09-08
申请号：CN202311001144.4
申请日：2023-08-10
Applicant: 浪潮电子信息产业股份有限公司
Abstract: 本发明涉及数字电路技术领域，公开了一种多应用内存访问的方法、装置、设备，对获取的多路命令进行轮询汇聚，以将多路命令转换为单路命令；将单路命令拆分为数据信息和地址信息；依据数据信息将获取的数据转换为标准化数据，并将标准化数据写入对应的存储位置；依据地址信息在内存空间中完成对应数据的读写操作。本发明的有益效果在于，通过将多路命令转换为单路命令，在多应用同时访问内存空间时无需再执行访问仲裁，用户接口更简单灵活，使用资源更少。通过将单路命令拆分为数据信息和地址信息，实现了数据和地址的异步处理，并且可以对地址信息进行预先处理，从而提前为读写数据做好准备，有效的提升了内存访问的处理效率。
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