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公开(公告)号：CN101714106A
公开(公告)日：2010-05-26
申请号：CN200910222700.4
申请日：2009-09-30
Applicant: 英特尔公司
IPC: G06F11/00
CPC classification number: G06F12/0895 , G06F1/3203 , G06F1/3275 , G06F1/3296 , G06F12/0864 , Y02D10/13 , Y02D10/14 , Y02D10/172
Abstract: 本发明为在低电压操作期间禁用高速缓存部分，描述了涉及在低电压操作期间禁用一个或多个高速缓存部分的方法和装置。在一些实施方式中，用于部分高速缓存的一个或多个附加位，指示所述部分高速缓存在Vccmin电平或小于Vccmin电平是否可操作。也描述并请求保护了其他实施方式。
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公开(公告)号：CN109583152B
公开(公告)日：2024-09-03
申请号：CN201810996839.3
申请日：2018-08-29
Applicant: 英特尔公司
IPC: G06F21/12
Abstract: 本文公开了用于计算的装置。在实施例中，装置可以包括一个或多个处理器、存储器和编译器，编译器用于由一个或多个处理器操作以编译计算机程序。编译器可以包括一个或多个分析器，用于解析和分析计算机程序的生成指针或取消引用指针的源代码。编译器还可以包括耦合到一个或多个分析器的代码生成器，用于生成用于计算机程序的源代码的可执行指令，包括至少部分地基于分析的结果将附加的加密或解密可执行指令插入到计算机程序中，以对所述源代码的存储器访问操作进行认证。
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公开(公告)号：CN117790508A
公开(公告)日：2024-03-29
申请号：CN202311095255.6
申请日：2023-08-29
Applicant: 英特尔公司
IPC: H01L27/092 , H01L27/02
Abstract: 本文中描述与低和超低阈值电压晶体管单元相关的集成电路管芯、设备、系统和技术。第一晶体管单元包括由单独栅电极所接触的单独半导体主体，所述栅电极之间具有介电材料。第二晶体管单元包括由共享栅电极所接触的单独半导体主体，所述共享栅电极耦合到两种半导体主体。由于来自共享栅电极的半导体主体上的增加应变，第二晶体管单元的晶体管可操作在比第一晶体管单元的那些晶体管更低的阈值电压。
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公开(公告)号：CN112955869A
公开(公告)日：2021-06-11
申请号：CN201980043306.6
申请日：2019-04-16
Applicant: 英特尔公司
Inventor： M·R·哈格海特 , K·杜什 , A·J·赫德瑞奇 , A·莫汉 , R·R·伊耶 , M·孙 , K·布扬 , T·J·吴 , M·J·库马 , M·普林克 , M·勒梅 , L·佩雷德 , J-S·蔡 , D·M·杜汉姆 , J·D·张伯伦 , V·A·苏霍姆利诺夫 , E·J·达伦 , S·巴格索克希 , H·萨内 , A·梅利克-阿达米扬 , R·萨希塔 , D·Y·巴博金 , I·M·斯坦纳 , A·巴赫穆斯基 , A·劳 , M·张 , N·K·简恩 , A·菲鲁兹沙希安 , B·V·帕特尔 , W·黄 , Y·拉戈胡拉姆
Abstract: 系统、装置和方法的实施例向用户提供了增强的功能即服务(FaaS)，该用户诸如计算机开发人员和云服务提供商(CSP)。一种被配置成提供此类增强的FaaS服务的计算系统包括：一个或多个控制架构子系统、软件和编排子系统、网络和存储子系统、以及安全子系统。该计算系统响应于用户触发的事件在由架构子系统提供的执行环境中执行功能，该架构子系统表示执行管理的抽象并且使用户免于管理执行的负担。软件和编排子系统通过将用于功能代码的容器智能地旋转加速和旋转减速来分配用于功能执行的计算资源，以在维持安全执行的同时实现降低的实例化等待时间和增大的执行可缩放性。此外，该计算系统使得消费者能够仅在他们的代码得以执行时才进行支付，以实现降至毫秒级增量的粒度计费。
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Patent Agency Ranking
公开(公告)号：CN101714106B
公开(公告)日：2013-09-25
申请号：CN200910222700.4
申请日：2009-09-30
Applicant: 英特尔公司
IPC: G06F11/00
CPC classification number: G06F12/0895 , G06F1/3203 , G06F1/3275 , G06F1/3296 , G06F12/0864 , Y02D10/13 , Y02D10/14 , Y02D10/172
Abstract: 本发明的名称为在低电压操作期间禁用高速缓存部分，描述了涉及在低电压操作期间禁用一个或多个高速缓存部分的方法和装置。在一些实施方式中，用于部分高速缓存的一个或多个附加位，指示所述部分高速缓存在Vccmin电平或小于Vccmin电平是否可操作。也描述并请求保护了其他实施方式。
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公开(公告)号：CN101208800A
公开(公告)日：2008-06-25
申请号：CN200680023059.6
申请日：2006-06-28
Applicant: 英特尔公司
IPC: H01L23/522 , H01L23/64
CPC classification number: H01L23/5223 , H01L23/50 , H01L23/5228 , H01L2924/0002 , H01L2924/3011 , H05K1/023 , H01L2924/00
Abstract: 利用管芯侧电容器和嵌入式电阻器可以实现有利的电力输送网络。在一些实施例中，嵌入式电阻器可以是更精确可控的。可通过将嵌入式电阻器与这些电容器组合来减少管芯侧电容器的数目，以便降低成本。嵌入式电阻器可以设置在金属化层内，在上层或者在下层。
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公开(公告)号：CN1146185C
公开(公告)日：2004-04-14
申请号：CN00804314.0
申请日：2000-01-12
Applicant: 英特尔公司
CPC classification number: H04N7/163 , H04L9/3013 , H04L9/321 , H04L2209/603
Abstract: 一种在第一设备(24)和第二设备(26)之间保密地传送内容的方法和设备，包括把第一和第二设备的标识信息发送到第三设备(14)。该第三设备(14)根据该标识信息产生预定的消息。使用该预定的消息对第一和第二设备(24，26)进行鉴权。
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公开(公告)号：CN1341310A
公开(公告)日：2002-03-20
申请号：CN00804314.0
申请日：2000-01-12
Applicant: 英特尔公司
CPC classification number: H04N7/163 , H04L9/3013 , H04L9/321 , H04L2209/603
Abstract: 一种在第一设备(24)和第二设备(26)之间保密地传送内容的方法和设备,包括把第一和第二设备的标识信息发送到第三设备(14)。该第三设备(14)根据该标识信息产生预定的消息。使用该预定的消息对第一和第二设备(24,26)进行鉴权。
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公开(公告)号：CN101111775B
公开(公告)日：2011-07-06
申请号：CN200680003910.9
申请日：2006-01-27
Applicant: 英特尔公司
IPC: G01R31/3185
CPC classification number: G01R31/318566 , G01R31/31816 , G01R31/318541 , G01R31/318572 , G11C2029/3202
Abstract: 在一个实施例中，提供了一种带有系统电路、扫描输出电路和差错检测电路的设备。所述系统电路适于响应于数据输入信号和系统时钟信号生成第一输出信号。所述扫描输出电路适于响应于所述数据输入信号和所述系统时钟信号生成第二输出信号。所述差错检测电路连接至所述系统电路和所述扫描输出电路，其适于响应于所述第一输出信号和所述第二输出信号之间的相对条件生成差错信号。
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