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公开(公告)号：CN106415515A
公开(公告)日：2017-02-15
申请号：CN201580028295.6
申请日：2015-06-05
Applicant: 英特尔公司
IPC: G06F13/38
CPC classification number: G06F13/1673 , G06F5/065 , G06F5/14 , G06F9/30043 , G06F9/30087 , G06F9/3834 , G06F9/3851 , G06F9/3855 , G06F12/0875 , G06F13/28 , G06F13/4282 , G06F2205/067 , G06F2205/126 , G06F2212/452 , G06F2213/0026
Abstract: 用于使用不具有sfence的优化的PIO写入序列来发送分组的方法和装置。在支持乱序执行的处理器处接收用于将分组数据写入经编程的输入/输出(PIO)发送存储器的PIO写入指令的序列。以原始的顺序接收且乱序地执行PIO写入指令，每一条PIO写入指令将数据的存储单元写入存储缓冲器或将数据的存储块写入存储缓冲器。为存储缓冲器提供逻辑以检测存储块何时被填充，从而导致在那些存储块中的数据经由PCIe投递的写入而耗尽，所述PCIe投递的写入被写入由PIO写入指令定义的地址处的PIO发送存储器中的发送块。采用逻辑以检测分组的填充尺寸并检测分组的发送块何时已被填充，从而使分组数据能够有资格流出。
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公开(公告)号：CN106415513B
公开(公告)日：2019-06-04
申请号：CN201580028319.8
申请日：2015-06-05
Applicant: 英特尔公司
Abstract: 用于实现用于分组发送的优化的信用返回机制的方法和装置。将经编程的输入/输出(PIO)发送存储器分区为多个发送上下文，每一个发送上下文都包括存储器缓冲器，所述存储器缓冲器包括配置成用于存储分组数据的多个发送块。使用FIFO语义、利用与相应FIFO槽相关联的每一个发送块实现存储方案。响应于接收到写入发送块的分组数据并检测到那些发送块中的数据已从发送上下文流出，检测到对应被释放的FIFO槽，并且确定还未为其返回信用返回的最低槽。随后，通过所述最低槽确定被释放的槽序列中的最高槽，并且返回对应的信用返回标记。在一个实施例中，利用经由对PIO发送存储器写入的软件而跟踪的相关联的绝对信用发送计数来为每一个发送上下文实现绝对信用返回计数，其中上述两个绝对信用用于流控制。
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公开(公告)号：CN106415513A
公开(公告)日：2017-02-15
申请号：CN201580028319.8
申请日：2015-06-05
Applicant: 英特尔公司
Abstract: 用于实现用于分组发送的优化的信用返回机制的方法和装置。将经编程的输入/输出(PIO)发送存储器分区为多个发送上下文，每一个发送上下文都包括存储器缓冲器，所述存储器缓冲器包括配置成用于存储分组数据的多个发送块。使用FIFO语义、利用与相应FIFO槽相关联的每一个发送块实现存储方案。响应于接收到写入发送块的分组数据并检测到那些发送块中的数据已从发送上下文流出，检测到对应被释放的FIFO槽，并且确定还未为其返回信用返回的最低槽。随后，通过所述最低槽确定被释放的槽序列中的最高槽，并且返回对应的信用返回标记。在一个实施例中，利用经由对PIO发送存储器写入的软件而跟踪的相关联的绝对信用发送计数来为每一个发送上下文实现绝对信用返回计数，其中上述两个绝对信用用于流控制。
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公开(公告)号：CN106415515B
公开(公告)日：2019-06-25
申请号：CN201580028295.6
申请日：2015-06-05
Applicant: 英特尔公司
IPC: G06F13/38
CPC classification number: G06F13/1673 , G06F5/065 , G06F5/14 , G06F9/30043 , G06F9/30087 , G06F9/3834 , G06F9/3851 , G06F9/3855 , G06F12/0875 , G06F13/28 , G06F13/4282 , G06F2205/067 , G06F2205/126 , G06F2212/452 , G06F2213/0026
Abstract: 用于使用不具有sfence的优化的PIO写入序列来发送分组的方法和装置。在支持乱序执行的处理器处接收用于将分组数据写入经编程的输入/输出(PIO)发送存储器的PIO写入指令的序列。以原始的顺序接收且乱序地执行PIO写入指令，每一条PIO写入指令将数据的存储单元写入存储缓冲器或将数据的存储块写入存储缓冲器。为存储缓冲器提供逻辑以检测存储块何时被填充，从而导致在那些存储块中的数据经由PCIe投递的写入而耗尽，所述PCIe投递的写入被写入由PIO写入指令定义的地址处的PIO发送存储器中的发送块。采用逻辑以检测分组的填充尺寸并检测分组的发送块何时已被填充，从而使分组数据能够有资格流出。
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