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公开(公告)号：CN113452501B
公开(公告)日：2022-06-17
申请号：CN202110539186.8
申请日：2021-05-18
Applicant: 鹏城实验室
IPC: H04L7/00
Abstract: 本发明公开了一种时间同步中分数延时值确定方法、装置、终端及存储介质，方法包括：将接收数据划分为L路并行数据，根据当前的分数延时值对第n次L路数据进行数据内插，得到目标并行数据；确定所述目标并行数据的定时误差序列，其中，所述定时误差序列中包括L个误差值；对所述目标并行数据的定时误差序列中的L个误差值求和得到求和结果，根据所述求和结果对所述分数延时值进行更新。本发明在确定分数延时值时不需要对定时误差序列进行求模的过程，处理效率高。
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公开(公告)号：CN113452501A
公开(公告)日：2021-09-28
申请号：CN202110539186.8
申请日：2021-05-18
Applicant: 鹏城实验室
IPC: H04L7/00
Abstract: 本发明公开了一种时间同步中分数延时值确定方法、装置、终端及存储介质，方法包括：将接收数据划分为L路并行数据，根据当前的分数延时值对第n次L路数据进行数据内插，得到目标并行数据；确定所述目标并行数据的定时误差序列，其中，所述定时误差序列中包括L个误差值；对所述目标并行数据的定时误差序列中的L个误差值求和得到求和结果，根据所述求和结果对所述分数延时值进行更新。本发明在确定分数延时值时不需要对定时误差序列进行求模的过程，处理效率高。
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公开(公告)号：CN115426028B
公开(公告)日：2023-10-20
申请号：CN202211042244.7
申请日：2022-08-29
Applicant: 鹏城实验室
IPC: H04B7/185
Abstract: 本发明公开了一种数据编译码的故障容错方法、系统及高速通信系统，通过将多核的编译码核设置分为DMR编译码资源池和TMR编译码资源池两个部分，编译码核的运行状态包括：DMR模式和TMR模式；默认编译码核的配置为DMR模式，并对DMR模式下各个链路中的数据是否一致进行判断，当有链路中出现数据不一致的情况时，则触发数据比对不一致的DMR链路进入TMR模式，从而实现以DMR和TMR相结合的方式实现通信数据的编译码，不仅避免了DMR技术只能检错而不能纠错的问题，而且比单独使用TMR技术节约了资源，有效提高了整个编译码处理过程的可靠性，保证了高速通信的顺利进行。
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公开(公告)号：CN115426028A
公开(公告)日：2022-12-02
申请号：CN202211042244.7
申请日：2022-08-29
Applicant: 鹏城实验室
IPC: H04B7/185
Abstract: 本发明公开了一种数据编译码的故障容错方法、系统及高速通信系统，通过将多核的编译码核设置分为DMR编译码资源池和TMR编译码资源池两个部分，编译码核的运行状态包括：DMR模式和TMR模式；默认编译码核的配置为DMR模式，并对DMR模式下各个链路中的数据是否一致进行判断，当有链路中出现数据不一致的情况时，则触发数据比对不一致的DMR链路进入TMR模式，从而实现以DMR和TMR相结合的方式实现通信数据的编译码，不仅避免了DMR技术只能检错而不能纠错的问题，而且比单独使用TMR技术节约了资源，有效提高了整个编译码处理过程的可靠性，保证了高速通信的顺利进行。
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