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公开(公告)号：CN113728551B
公开(公告)日：2024-11-01
申请号：CN201980084651.4
申请日：2019-12-03
Applicant: AMS有限公司
IPC: H03F3/45
Abstract: 具有自适应偏置的跨导器电路(10)包括用于施加第一输入信号(inp)的第一输入端子(E1Oa)和用于施加第二输入信号(inn)的第二输入端子(E1Ob)。控制电路(200)配置为响应于第一电流路径(101)的第一节点(N1)的第一电位和第二电流路径(102)的第二节点(N2)的第二电位中的至少一者来控制第一电流路径(101)中的第一可控电流源(110)和第二电流路径(102)中的第二可控电流源(120)。第一节点(N1)位于第一晶体管(150)与第一可控电流源(110)之间，并且第二节点(N2)位于第二晶体管(160)与第二可控电流源(120)之间。
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公开(公告)号：CN113728551A
公开(公告)日：2021-11-30
申请号：CN201980084651.4
申请日：2019-12-03
Applicant: AMS有限公司
IPC: H03F3/45
Abstract: 具有自适应偏置的跨导器电路(10)包括用于施加第一输入信号(inp)的第一输入端子(E1Oa)和用于施加第二输入信号(inn)的第二输入端子(E1Ob)。控制电路(200)配置为响应于第一电流路径(101)的第一节点(N1)的第一电位和第二电流路径(102)的第二节点(N2)的第二电位中的至少一者来控制第一电流路径(101)中的第一可控电流源(110)和第二电流路径(102)中的第二可控电流源(120)。第一节点(N1)位于第一晶体管(150)与第一可控电流源(110)之间，并且第二节点(N2)位于第二晶体管(160)与第二可控电流源(120)之间。
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公开(公告)号：CN108702135A
公开(公告)日：2018-10-23
申请号：CN201680068359.X
申请日：2016-11-08
Applicant: AMS有限公司
CPC classification number: H03F1/26 , H03F3/005 , H03F3/423 , H03F3/4521 , H03F3/45645 , H03F2200/129 , H03F2200/264 , H03F2200/372 , H03F2200/555 , H03F2200/75 , H03F2203/45012 , H03F2203/45082 , H03F2203/45088 , H03F2203/45091 , H03F2203/45116 , H03F2203/45134 , H03F2203/45156 , H03F2203/45171 , H03F2203/45174 , H03F2203/45176 , H03F2203/45208 , H03F2203/45221 , H03F2203/45244 , H03F2203/45352 , H03F2203/45416 , H03F2203/45434 , H03F2203/45461 , H03F2203/45481 , H03F2203/45512 , H03F2203/45544 , H03F2203/45551 , H03F2203/45561 , H03F2203/45616
Abstract: 本发明公开了一种放大器装置，其包括：具有第一晶体管对的第一差分级，具有第一和第二晶体管对的第二差分级，每对的共源极连接被耦接到第一差分级的相应晶体管的漏极端。放大器装置还具有第一互补差分级和第二互补差分级，其中第一互补差分级具有与第一差分级的晶体管对导电类型相反的晶体管对，第二互补差分级具有互补导电类型的第一和第二晶体管对。相对于第一和第二差分级，第一和第二互补差分级对称地连接。第二互补差分级的互补晶体管对称地连接到第二差分级的晶体管，使得形成相应的第一、第二、第三和第四电流路径。一对输出端耦接到第一和第四电流路径。每级的晶体管的栅极端耦接到相应的一对输入端。
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公开(公告)号：CN108702135B
公开(公告)日：2022-03-22
申请号：CN201680068359.X
申请日：2016-11-08
Applicant: AMS有限公司
Abstract: 本发明公开了一种放大器装置，其包括：具有第一晶体管对的第一差分级，具有第一和第二晶体管对的第二差分级，每对的共源极连接被耦接到第一差分级的相应晶体管的漏极端。放大器装置还具有第一互补差分级和第二互补差分级，其中第一互补差分级具有与第一差分级的晶体管对导电类型相反的晶体管对，第二互补差分级具有互补导电类型的第一和第二晶体管对。相对于第一和第二差分级，第一和第二互补差分级对称地连接。第二互补差分级的互补晶体管对称地连接到第二差分级的晶体管，使得形成相应的第一、第二、第三和第四电流路径。一对输出端耦接到第一和第四电流路径。每级的晶体管的栅极端耦接到相应的一对输入端。
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