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公开(公告)号：KR100968202B1
公开(公告)日：2010-07-06
申请号：KR1020070129211
申请日：2007-12-12
Applicant: 한국전자통신연구원
CPC classification number: G06F1/3203 , G06F1/3287 , G06F9/505 , G06F9/5094 , Y02D10/171 , Y02D10/22
Abstract: 본 발명은 클러스터 시스템의 부하에 따라 클러스터 수준에서 전원을 제어하여 전력 소모를 감소시킬 수 있는 클러스터 시스템 및 그의 전원 관리 방법을 제공하는 것으로, 클러스터 시스템이 수행해야 하는 실제 작업을 수행하는 다수의 관리 대상 노드들; 외부망을 통해 들어온 사용자 요구를 상기 관리 대상 노들들에게 분배하는 로드밸런서/스위치; 및 전체 시스템의 부하를 감시하고, 상기 로드밸런서/스위치와 상기 관리 대상 노드들을 제어하여 전원 관리를 수행하는 전원 관리 마스터;를 구비하되, 상기 전원 관리 마스터는 시스템의 현재 부하와 시간/부하 프로파일에 따라 상기 관리 대상 노드들을 전원 켜짐 그룹과 전원 꺼짐 그룹으로 분류하여 전원 관리를 수행하는 것을 특징으로 한다.
클러스터시스템, 소비전력감소, 전원관리-
公开(公告)号：KR1020100064440A
公开(公告)日：2010-06-15
申请号：KR1020080122874
申请日：2008-12-05
Applicant: 한국전자통신연구원
CPC classification number: G11C16/06 , B82Y10/00 , G11C11/16 , G11C13/0002 , G11C13/0004 , G11C13/0007 , G11C13/0014 , G11C13/025 , G11C16/10 , G11C16/26
Abstract: PURPOSE: Sequential circuits, integrated circuits and a method for driving the same are provided to rapidly block and reapply power by replacing all memory devices with non-volatile memory devices. CONSTITUTION: A combinational logic generates a new state variable using a stored state variable during a driving operation. A non-volatile memory device(100) provides a state variable as a combinational logic. The non-volatile memory device stores the new state variable. A read circuit(30) reads the state variable which is stored in the non-volatile memory during the driving operation and provides the stored state variable as the combinational logic. A wire circuit(10) writes a new state variable in the non-volatile memory.
Abstract translation: 目的：提供顺序电路，集成电路及其驱动方法，以通过用非易失性存储器件替换所有存储器件来快速阻断和重新供电。 组合：组合逻辑在驾驶操作期间使用存储的状态变量生成新的状态变量。 非易失性存储器件（100）提供状态变量作为组合逻辑。 非易失性存储器件存储新的状态变量。 读取电路（30）读取在驱动操作期间存储在非易失性存储器中的状态变量，并将存储的状态变量提供为组合逻辑。 有线电路（10）将新的状态变量写入非易失性存储器。
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公开(公告)号：KR100944911B1
公开(公告)日：2010-03-03
申请号：KR1020070096924
申请日：2007-09-21
Applicant: 한국전자통신연구원
IPC: G06F1/26
Abstract: 본 발명은 파워 써플라이로부터 공급되는 하나의 직류전원전압을 별도의 전력 소모없이 다중 변환시켜 서로 다른 레벨의 전원전압을 각 전자모듈에 공급할 수 있는 전원공급 시스템 및 방법을 제공하는 것으로, 본 발명의 전원공급 시스템은, 하나의 제 1 직류전압을 발생하는 전압공급수단; 및 상기 제 1 직류전압을 다중 변환시켜 서로 다른 레벨의 제 2 직류전압들을 발생시켜 각 전자모듈에 공급하는 다중 전압조정수단;을 포함하는 것을 특징으로 한다.
다중전압조정장치, 파워써플라이, 전압-
公开(公告)号：KR100934215B1
公开(公告)日：2009-12-29
申请号：KR1020070109206
申请日：2007-10-29
Applicant: 한국전자통신연구원
CPC classification number: G06F9/30003
Abstract: Provided are a microprocessor based on event-processing instruction set and an event-processing method using the same. The microprocessor includes an event register controlling an event according to an event-processing instruction set provided in an instruction set architecture (ISA) and an event controller transmitting externally generated events into the microprocessor. Therefore, the microprocessor may be useful to reduce its unnecessary power consumption by suspending the execution of its program when an instruction decoded to execute the program is an event-processing instruction, and also to cut off its unnecessary power consumption that is caused for an interrupt delay period since the program of the microprocessor may be executed again by immediately re-running the microprocessor with the operation of the event register and the event controller when external events are generated.
Abstract translation: 提供了一种基于事件处理指令集的微处理器和使用该微处理器的事件处理方法。 微处理器包括事件寄存器，事件寄存器根据指令集体系结构（ISA）中提供的事件处理指令集和事件控制器将外部产生的事件传送到微处理器中来控制事件。 因此，当被解码为执行程序的指令是事件处理指令时，微处理器可以通过暂停其程序的执行来减少其不必要的功耗，并且还切断其由于中断而导致的不必要的功耗 由于微处理器的程序可以通过在外部事件产生时通过事件寄存器和事件控制器的操作立即重新运行微处理器而被再次执行。
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公开(公告)号：KR100921682B1
公开(公告)日：2009-10-15
申请号：KR1020070096926
申请日：2007-09-21
Applicant: 한국전자통신연구원
Abstract: 본 발명은 데이터 센터내의 전력공급장치 및 시스템에 관한 것으로서, 각 컴퓨팅 장치에 장착되던 PSU를 제거하고 랙 레벨에서 단일 PSU를 장착하여 랙에 장착되는 각 컴퓨팅 장치에 DC 전압을 공급하는 형태로의 랙 전원 공급방식을 제공한다.
이를 위하여 본 발명은 데이터센터 PDU에서 AC 전압을 공급받아 랙의 각 컴퓨팅 장치에 12V 또는 48V DC 단일 전압을 공급하는 랙전원공급장치(RPSU)를 새롭게 제시한다. 또한, RPSU는 각 컴퓨팅 장치의 부하에 따른 전류조절 기능 및 전류 차단 기능, 전력 모니터링 기능 등을 갖추어 효율적인 랙 전원관리 기능을 수행한다. RPSU에서 입력되는 12V 또는 48V DC 전원을 사용하는 컴퓨팅 장치의 경우, 기존의 PSU를 제거하고 외부 입력전압을 AC 100V ~ 220V 가 아닌 DC 12V 또는 48V로 설계한다. 컴퓨터 내부 장치에 사용되는 다양한 DC 전압은 고효율의 VRM을 통해 얻게 된다.
본 발명에 따르면 기존과 같이 각 컴퓨팅 장치별로 PSU를 사용할 경우보다 전력변환 효율이 증대되어 전력절감 효과를 얻게 된다. 또한 데이터 센터의 전력관리에 대해서도, 랙 레벨에서 효율적으로 관리하여 안정된 데이터센터 전력설계를 이루게 된다.
데이터 센터, 전력 공급, 전력 제어, 랙, 랙별 전원공급장치-
Patent Agency Ranking156.发明公开
公开(公告)号：KR1020090065125A
公开(公告)日：2009-06-22
申请号：KR1020070132576
申请日：2007-12-17
Applicant: 한국전자통신연구원
CPC classification number: H05K7/20745
Abstract: A combination rack system for separating hot air exhaust, a cooling system of a datacenter using the combination rack system and a method thereof are provided to separately exhaust flow of hot air occurring in the rack system from inner cool air, thereby performing efficient cooling. In a rack system, rear sides of the first and second racks face each other. The first rack and the second rack are spaced by a predetermined gap. A plurality of cooling fans(230,231,232) is arranged in a lower end part between the first rack and the second rack, a middle part and an upper end part. A coupling unit couples a spaced gap between the first rack and the second rack.
Abstract translation: 提供了用于分离热排气的组合架系统，使用组合齿条系统的数据中心的冷却系统及其方法，以将内部冷空气中产生的热空气的流动分开排出，从而进行有效的冷却。 在机架系统中，第一和第二机架的后侧彼此面对。 第一机架和第二机架间隔开预定的间隙。 多个冷却风扇（230,231,232）设置在第一齿条与第二齿条之间的下端部，中间部和上端部。 耦合单元将第一机架和第二机架之间的间隔连接。
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公开(公告)号：KR100898345B1
公开(公告)日：2009-05-20
申请号：KR1020070098193
申请日：2007-09-28
Applicant: 한국전자통신연구원
Abstract: 본 ＴＯＥ(TCP Offload Engine)의 패킷 수신 하드웨어 장치 및 ＴＯＥ 패킷 수신 하드웨어를 이용한 수신 시스템 및 방법에 관한 것으로, 더욱 상세하게는 IP 계층으로부터 수신되는 패킷의 종류를 분석하여 프로세서에서 직접 처리하기 위해 필요한 정보는 패킷 수신 하드웨어에 내장된 큐에 저장하여 프로세서가 직접 이용할 수 있도록 하고, 호스트메모리에 저장할 정보는 외부 메모리에 저장하여 프로세서에 의해 프로토콜 처리가 완료된 후에 호스트메모리로 전달하는 기술적 구성을 통해 프로세서가 실제 패킷의 수신시간과 비동기적으로 움직일 수 있고, 불필요한 정보를 처리하는 오버헤드를 줄일 수 있는 효과가 있다.
TOE(TCP Offload Engine), 큐, 패킷 수신 하드웨어-
公开(公告)号：KR1020080053137A
公开(公告)日：2008-06-12
申请号：KR1020060125157
申请日：2006-12-08
Applicant: 한국전자통신연구원
IPC: G06F7/52
CPC classification number: G06F7/5332
Abstract: A method for finding an MSD(Minimal Signed Digit) with variable multi-bit coding is provided to implement an additional operation easily for calculating a value of a signed digit occurring as bits get bigger, and minimize an area/time needed for implementing a program and making hardware by finding the signed digit with grouped numbers. Each group is checked when a predetermined multi-bit applying a Booths algorithm is scanned and grouped(S302). A positive or negative coding mode is determined depending on a type of each group(S303). Grouping is terminated when the grouped MSB(Most Significant Bit) is not identical with a value of a previous bit if the type of the group is not found. A signed number is found by converting and using a value of each group based on a predetermined mode when the coding mode is the positive coding mode(S304). Bitwise inversion for the value of each group is performed when the coding mode is the negative coding mode. The signed number is found according to the converted value by converting the bitwise-converted multi-bit according to the predetermined mode(S306).
Abstract translation: 提供了一种利用可变多比特编码寻找MSD（最小签名数字）的方法，用于轻松实现附加操作，用于计算随着比特变大而发生的有符号数字的值，并将实现程序所需的面积/时间最小化 并通过找到具有分组号码的带符号数字来制作硬件。 当扫描并分组布局算法的预定多位时，检查每个组（S302）。 根据每组的类型确定正或负编码模式（S303）。 当分组的MSB（最高有效位）与前一位的值不相同时，如果未找到该组的类型，则分组终止。 当编码模式是正编码模式时，通过基于预定模式转换和使用每个组的值来找到有符号的数字（S304）。 当编码模式为负编码模式时，执行每组的值的逐位反转。 通过根据预定模式转换按位转换的多位来根据转换的值找到带符号的数字（S306）。
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159.发明公开
公开(公告)号：KR1020080051022A
公开(公告)日：2008-06-10
申请号：KR1020070098193
申请日：2007-09-28
Applicant: 한국전자통신연구원
Abstract: A packet receiving hardware apparatus for a TCP(Transmission Control Protocol) offload engine and a system and a method by using a TOE(TCP Offload Engine) packet receiving hardware are provided to receive the normal packet effectively by analyzing the receiving packet and separately managing information needed in the processor from information stored in an external memory. A header process part(120) analyzes the header of a packet transmitted from an IP(Internet Protocol) layer, and classifies the packet, and extracts the information being transmitted to the processor and stores in a queue(130). A memory interface part(160) extracts the information being stored in a host memory from the packet according to the analysis result of the header process part and stores information being stored in the host memory in an external memory by using the address allocated from a memory table(170). The header process part comprises at least two queues so as for the queue to access to a receiving processor and a transmission processor respectively. The header process also stores a payload in the external memory by using a memory interface in case that the transmitted packet is the TCP packet having the payload or UDP(User Datagram Protocol) packet. A check sum calculator(140) calculates the check sum of a packet, and a packet reception controller(150) controls a header processor(120), a memory interface part(160) and the check sum calculator.
Abstract translation: 提供了一种用于TCP（传输控制协议）卸载引擎的分组接收硬件装置，以及通过使用TOE（TCP卸载引擎）分组接收硬件的系统和方法，通过分析接收分组并分别管理信息来有效地接收普通分组 在存储在外部存储器中的信息在处理器中需要。 标题处理部分（120）分析从IP（因特网协议）层发送的分组的报头，并对分组进行分类，并将正在发送的信息提取到处理器并存储在队列（130）中。 存储器接口部分（160）根据报头处理部分的分析结果从分组中提取存储在主机存储器中的信息，并通过使用从存储器分配的地址将存储在主机存储器中的信息存储在外部存储器中 表（170）。 报头处理部分包括至少两个队列，以便队列分别访问接收处理器和传输处理器。 在发送的分组是具有有效载荷或UDP（用户数据报协议）分组的TCP分组的情况下，报头处理还通过使用存储器接口来将有效载荷存储在外部存储器中。 校验和计算器（140）计算分组的校验和，分组接收控制器（150）控制报头处理器（120），存储器接口部分（160）和校验和计算器。
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公开(公告)号：KR100791229B1
公开(公告)日：2008-01-03
申请号：KR1020060119056
申请日：2006-11-29
Applicant: 한국전자통신연구원
IPC: H03K5/26
CPC classification number: H04L25/49 , H04L25/0264 , H04L25/4906
Abstract: A low electrostatic powered delay insensitive data transfer apparatus is provided to decrease electrostatic power by encoding data 1 into a 2I current level, a space state into a current level below 0.5I, and data 0 into an I current level in an encoder. A low electrostatic powered delay insensitive data transfer apparatus includes the N number of encoders(301) and decoders(302). The encoder includes a reference current generating unit which generates the currents of I and 2I levels, and a voltage/current converting unit which outputs the current of a '0' level to notify a space state according to a request signal inputted from a data transmitting unit, outputs the current of the I level in case of a data signal '0' in a state in which the request signal is in an active state, and outputs the current of the 2I level in case of the data signal '1'. The decoder includes a threshold current generating unit which generates first and second threshold currents, an input current mirror circuit which differentiates the first and second threshold currents in response to the level of input current inputted from the encoder, and a current/voltage converting unit which detects the differentiated threshold current, recovers a voltage input value, and extracts the data signal and the request signal from the signal of the recovered voltage level.
Abstract translation: 提供了一种低静电动力延迟不敏感数据传输装置，通过将数据1编码为2I电流电平，将空间状态编码为低于0.5I的电流电平，将数据0编码为I电平来降低静电功率。 低静电动力延迟不敏感数据传输装置包括N个编码器（301）和解码器（302）。 编码器包括产生I和2I电平的电流的参考电流产生单元和输出“0”电平的电流以根据从数据发送输入的请求信号通知空间状态的电压/电流转换单元 在请求信号处于活动状态的状态下，在数据信号“0”的情况下输出I电平的电流，并且在数据信号“1”的情况下输出2I电平的电流。 解码器包括产生第一和第二阈值电流的阈值电流产生单元，响应于从编码器输入的输入电流的电平来区分第一和第二阈值电流的输入电流镜电路和电流/电压转换单元， 检测微分阈值电流，恢复电压输入值，并从恢复的电压电平的信号中提取数据信号和请求信号。
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