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11.发明授权플래시 메모리 장치의 셀 간 간섭을 최소화하기 위한 격자 부호 변조 방법, 이를 이용하는 격자 부호 변조 회로, 오류 정정 회로 및 플래시 메모리 장치의 데이터 입력 방법과 플래시 메모리 장치 有权网格编码调制方法，用于减少闪存器件，网格编码调制电路，误差校正电路和使用其的闪存器件的小区间干扰
公开(公告)号：KR101250672B1
公开(公告)日：2013-04-09
申请号：KR1020100122415
申请日：2010-12-03
Applicant: 한국과학기술원
Abstract: 플래시 메모리 장치의 셀 간 간섭을 최소화하기 위한 격자 부호 변조 방법, 이를 이용하는 격자 부호 변조 회로, 오류 정정 회로 및 플래시 메모리 장치의 데이터 입력 방법과 플래시 메모리 장치를 공개한다. 플래시 메모리를 위한 격자 부호 변조에서 신호 성상으로 생성 가능한 모든 포인트로부터 사용하지 않는 포인트들을 제거함에 있어서 E-PH 패턴을 포함한 포인트를 우선적으로 제거하므로, 셀간 간섭이 크게 발생하는 E-PH 패턴으로 인한 오류율의 증가를 감소시켜 오류율의 이득을 얻을 수 있다.
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12.发明公开다차원 격자－ＲＳ 연접 부호의 다계층 복호 회로 및 방법, 이를 이용한 플래쉬 메모리 장치를 위한 오류 정정 회로, 및 플래쉬 메모리 장치 失效具有内TCM和外多级RS串联代码的级联代码的多级解码电路和方法，使用相同的闪存的误差校正电路和使用相同的闪存器件
公开(公告)号：KR1020120122234A
公开(公告)日：2012-11-07
申请号：KR1020110040285
申请日：2011-04-28
Applicant: 한국과학기술원
CPC classification number: G11C29/40 , G06F11/1048 , G06F11/1068 , G06F11/1072 , H03M13/41
Abstract: PURPOSE: A multilayer decoding circuit of a multi-dimensional trellis-RS concatenated code, a method thereof, an error correcting circuit for a flash memory device using the same, and the flash memory device are provided to improve error correction capability by preventing the transition of an error through multilayer decoding. CONSTITUTION: A first stage decoding unit(210) receives a part of trellis-RS(Reed-Solomon) concatenated code and outputs a first output data by successively performing a multidimensional demodulation, viterbi decoding, and RS decoding. A second stage decoding unit(230) output a second output data by RS-decoding after the remaining trellis-RS concatenated code is multi-dimensionally demodulated through the first output data. [Reference numerals] (200) Flash memory core; (210) First stage decoding unit; (211) First multi-directional demodulator; (213) Viterbi decider; (215) First RS decoder; (230) Second stage decoding unit; (231) Second multi-dimensional demodulator; (233) Second RS decoder
Abstract translation: 目的：提供多维网格-RS级联代码的多层解码电路，其方法，使用其的闪存器件的纠错电路和闪速存储器件，以通过防止转换来提高纠错能力 的错误通过多层解码。 构成：第一级解码单元（210）接收网格-RS（Reed-Solomon）级联代码的一部分，并通过连续执行多维解调，维特比解码和RS解码来输出第一输出数据。 第二级解码单元（230）在通过第一输出数据进行多维解调后，通过RS解码输出第二输出数据。 （附图标记）（200）闪存核心; （210）第一级解码单元; （211）第一多向解调器; （213）维特比决策者; （215）第一RS解码器; （230）第二级解码单元; （231）第二多维解调器; （233）第二RS解码器
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