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公开(公告)号：KR1020040053723A
公开(公告)日：2004-06-24
申请号：KR1020030010718
申请日：2003-02-20
Applicant: 한국전자통신연구원
IPC: H04L27/26
Abstract: PURPOSE: A frequency domain channel compensation circuit without division is provided to estimate and compensate a channel by using a pilot signal of a received signal and remove ISI(Inter Symbol Interference) and ICI(Inter Chip Interference) by using a single tap equalizer. CONSTITUTION: A frequency domain channel compensation circuit without division includes a pilot channel compensation circuit and a single tap equalizer. The pilot channel compensation circuit is used for estimating an error after a pilot signal passes a channel. In addition, the pilot channel compensation circuit is used for obtaining an approximate value of a pilot channel compensation coefficient by estimating the error. The single tap equalizer is used for improving an initial symbol coefficient by using an output of the pilot channel compensation circuit.
Abstract translation: 目的：提供不分频的频域信道补偿电路，通过使用接收信号的导频信号来估计和补偿信道，并通过使用单抽头均衡器去除ISI（符号间干扰）和ICI（片间干扰）。 构成：无分频的频域通道补偿电路包括导频信道补偿电路和单抽头均衡器。 导频信道补偿电路用于在导频信号通过信道之后估计误差。 此外，导频信道补偿电路用于通过估计误差来获得导频信道补偿系数的近似值。 单抽头均衡器用于通过使用导频信道补偿电路的输出来改善初始符号系数。
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公开(公告)号：KR100198922B1
公开(公告)日：1999-06-15
申请号：KR1019960003722
申请日：1996-02-15
IPC: G06F12/08
Abstract: 본 발명은 저장 확인 기능을 갖는 지연에 무관한(delay insensitive) 비동기형 FIFO 장치에 관한 것으로서, 저장셀 인에이블 신호를 출력하여 입력 데이터가 저장되었음을 알리는 저장 확인 신호를 수신하면 제어신호를 전단과 후단에 출력하는 다수의 제어수단(21); 입력된 데이터를 상기 제어수단(21)의 저장셀 인에이블 신호에 의해 저장하여 출력하는 다수의 셀 저장 수단(22); 및 상기 셀 저장 수단(22)에 입력되는 데이터와 출력 데이터를 입력받고, 상기 제어수단(21)의 저장셀 인에이블 신호를 입력받아 상기 셀 저장 수단(22)에 입력된 데이터의 저장 여부를 출력하는 다수의 저장 확인 신호 발생 수단(23)을 구비하여 셀 저장 수단(22)과 제어수단(21)의 지연 문제를 극복하고, FIFO 장치에 일정 동안만 데이터를 억세스 할 수 있는 인에이블 기능을 부여하여 인에이블 신호가 '하이'상태 동안만 데이터를 억세스할 수 있도록 하여 입력되는 데이터를 부분적으로 선택할 수 있어 FIFO 장치의 동작 범위를 증대할 수 있는 효과가 있다.
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