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    Verfahren und Vorrichtung, um Turboleistung für das Event-Handling zu verbessern
    5.
    发明专利
    Verfahren und Vorrichtung, um Turboleistung für das Event-Handling zu verbessern 未知

    公开(公告)号：DE102010045743B4

    公开(公告)日：2022-10-13

    申请号：DE102010045743

    申请日：2010-09-17

    Applicant: INTEL CORP

    Inventor： WELLS RYAN D ,  FALIK OHAD ,  ALLAREY JOSE P

    IPC: G06F9/50 ,  G06F1/32 ,  G06F9/46

    Abstract: Vorrichtung, umfassend:ein erstes Verarbeitungselement (131), wobei das erste Verarbeitungselement (131) ein aktives Verarbeitungselement ist;ein zweites Verarbeitungselement (132), wobei das zweite Verarbeitungselement (132) ein untätiges Verarbeitungselement ist;eine Turbo-Modus-Logik (140), um die Verarbeitungselemente (131, 132) so zu steuern, dass das aktive Verarbeitungselement (131) in einem Turbo-Modus arbeitet, während das untätige Verarbeitungselement (132) untätig bleibt; undeine Task-Routing-Logik (130),um auf Basis einer Information von der Turbo-Modus-Logik (140) zu bestimmen, ob eines der Verarbeitungselemente in einem Turbo-Modus arbeitet, undum basierend auf mindestens einem Vergleich von potentiellen Leistungsverlusten zwischen dem ersten Verarbeitungselement (131) und dem zweiten Verarbeitungselement (132) zur Ausführung einer Task (101) auszuwählen, wenn eines der Verarbeitungselemente (131) in einem Turbo-Modus arbeitet und das andere der Verarbeitungselemente (132) untätig ist, wobei die potentiellen Leistungsverluste einen Aufweck-Leistungsverlust verbunden mit dem Auswählen des untätigen Verarbeitungselements (132) zur Ausführung der Task (101) und einen aktiven Leistungsverlust verbunden mit dem Auswählen des Verarbeitungselements (131) im Turbo-Modus zur Ausführung der Task (101) aufweisen, wobei die Task-Routing-Logik (130) betriebsfähig ist, das untätige Verarbeitungselement (132) zur Ausführung der Task (101) auszuwählen, wenn der Aufweck-Leistungsverlust verbunden mit dem Auswählen des untätigen Verarbeitungselements (132) zur Ausführung der Task (101) kleiner ist als der aktive Leistungsverlust verbunden mit dem Auswählen des Verarbeitungselements (131) im Turbo-Modus zur Ausführung der Task (101).

    Indicating critical battery status in mobile devices
    7.
    发明专利
    Indicating critical battery status in mobile devices 未知

    公开(公告)号：GB2512201A

    公开(公告)日：2014-09-24

    申请号：GB201402706

    申请日：2014-02-17

    Applicant: INTEL CORP

    Inventor： MEJIA IVAN HERRERA ,  SHOEMAKER KENNETH D ,  WELLS RYAN D

    IPC: G06F1/32 ,  G06F9/4401 ,  G06F9/445

    Abstract: An integrated circuit 100 such as a system on chip (SoC) may indicate critical battery status without powering-on a substantial portions of the circuit including the host processing cores. The SoC includes a power control unit 150 that generates an indicator to indicate that the battery charge of battery 190 has reached or decreased below a critical battery charge level. In response to the indicator, microcontroller 135, sends a request to power management unit 150 to power up static memory 134 and display unit 160 and configures one or more configuration registers with configuration values. Controller 135 also causes critical battery status data to be stored in static memory 134. Display controller 165, in response to the configuration values, retrieves such data from the static memory to display critical battery status data in a visual form (e.g. a battery symbol) on display screen (280). The other portions of the SoC including dynamic memory, system agent, media processors, and memory controller hubs may be powered-down while critical battery status is displayed on the screen. One or more blocks may be powered on based on identifiers of the blocks. A special boot sequence may be initiated by controller 135.

    ANZEIGEN EINES KRITISCHEN BATTERIESTATUS IN MOBILEN EINRICHTUNGEN
    8.
    发明专利
    ANZEIGEN EINES KRITISCHEN BATTERIESTATUS IN MOBILEN EINRICHTUNGEN 未知

    公开(公告)号：DE102014002370A1

    公开(公告)日：2014-09-11

    申请号：DE102014002370

    申请日：2014-02-18

    Applicant: INTEL CORP

    Inventor： MEJIA IVAN HERRERA ,  SHOEMAKER KENNETH D ,  WELLS RYAN D

    IPC: G06F11/30 ,  G06F1/26 ,  G06F9/4401

    Abstract: Eine integrierte Schaltung, wie etwa ein SoC, kann den kritischen Batteriestatus ohne Einschalten eines wesentlichen Abschnitts, der die Host-Verarbeitungskerne enthält, anzeigen. Das SoC kann einen Mikro-Controller enthalten, der bewirken kann, dass die Daten über den kritischen Batteriestatus in einem statischen Speicher gespeichert werden, und die Display-Einheit kann solche Daten aus dem statischen Speicher abrufen, um auf dem Schirm ein Sichtsymbol anzuzeigen. Die anderen Abschnitte des SoC, wie etwa der dynamische Speicher, der System Agent, Medienprozessoren und Memory Controller Hubs, können ausgeschaltet werden, während der kritische Batteriestatus in der Sichtform auf dem Schirm angezeigt wird.

    Distributing power to heterogenous compute elements of a processor
    10.
    发明专利
    Distributing power to heterogenous compute elements of a processor 未知

    公开(公告)号：GB2518568A

    公开(公告)日：2015-03-25

    申请号：GB201500873

    申请日：2013-06-28

    Applicant: INTEL CORP

    Inventor： SCHLUESSLER TRAVIS T ,  WELLS RYAN D ,  ROMANO YAAKOV

    IPC: G06F1/32

    Abstract: In one embodiment, the present invention includes a processor having a first domain with a first compute engine and a second domain with a second compute engine, where each of these domains can operate at an independent voltage and frequency. A first logic may be present to update a power bias value used to control dynamic allocation of power between the first and second domains based at least in part on a busyness of the second domain. In turn, a second logic may dynamically allocate at least a portion of a power budget for the processor between the domains based at least in part on this power bias value. Other embodiments are described and claimed.

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