公开(公告)号：CN111868915A

公开(公告)日：2020-10-30

申请号：CN201980019973.0

申请日：2019-03-22

Applicant: SOITEC公司

Inventor： G·戈丹 ,  D·兰德鲁 ,  B·吉塞伦

IPC: H01L21/762 ,  H01L27/06

Abstract: 本发明涉及一种用于生产供体衬底(20)的方法，所述供体衬底(20)用于制造三维集成结构(40)，所述方法包括以下步骤：‑提供半导体衬底(10)，所述半导体衬底(10)包括称为有源层的表面层(14)和包括多个空腔(12)的层(11)，所述空腔(12)在有源层下方延伸，每个空腔(12)通过隔离体(13)而与相邻的空腔分隔开，‑在与空腔(12)垂直的有源层(14)的区域(14A)中形成电子装置(15)，‑在有源层(14)上沉积保护掩膜(17)，以覆盖所述电子装置(15)，而同时暴露与每个隔离体(13)垂直的有源层的区域(16)，穿过被掩膜暴露的有源层的区域而植入原子物种，以在每个隔离体(13)中形成弱化区域(19)。

公开(公告)号：CN111868915B

公开(公告)日：2024-07-23

申请号：CN201980019973.0

申请日：2019-03-22

Applicant: SOITEC公司

Inventor： G·戈丹 ,  D·兰德鲁 ,  B·吉塞伦

IPC: H01L21/762 ,  H01L27/06

Abstract: 本发明涉及一种用于生产供体衬底(20)的方法，所述供体衬底(20)用于制造三维集成结构(40)，所述方法包括以下步骤：‑提供半导体衬底(10)，所述半导体衬底(10)包括称为有源层的表面层(14)和包括多个空腔(12)的层(11)，所述空腔(12)在有源层下方延伸，每个空腔(12)通过隔离体(13)而与相邻的空腔分隔开，‑在与空腔(12)垂直的有源层(14)的区域(14A)中形成电子装置(15)，‑在有源层(14)上沉积保护掩膜(17)，以覆盖所述电子装置(15)，而同时暴露与每个隔离体(13)垂直的有源层的区域(16)，穿过被掩膜暴露的有源层的区域而植入原子物种，以在每个隔离体(13)中形成弱化区域(19)。