DC-DC Converter with Steady State Current Limitation

    公开(公告)号:FR3096152A1

    公开(公告)日:2020-11-20

    申请号:FR1905194

    申请日:2019-05-17

    Inventor: CIMAZ LIONEL

    Abstract: Convertisseur continu-continu à limitation de courant en régime établi La présente invention concerne un procédé de limitation d’un courant d’entrée ou de sortie (Iin, Iout) d’un convertisseur continu-continu comprenant : en réaction au dépassement ou au passage au-dessous d’un premier seuil (Ith) par le courant d’entrée ou de sortie (Iin, Iout), le stockage d’une première valeur représentative du niveau d’une tension de sortie (Vout) du convertisseur continu-continu ; et la modification du signal de commande (CTRL’) à partir de cette première valeur. Figure pour l’abrégé : Figure 5

    Signal modulé en fréquence
    2.
    发明专利

    公开(公告)号:FR3114711A1

    公开(公告)日:2022-04-01

    申请号:FR2008835

    申请日:2020-08-31

    Inventor: CIMAZ LIONEL

    Abstract: Signal modulé en fréquence La présente description concerne un procédé et un dispositif d'exécution d'un jeu d'instructions successives, dans lequel : chaque instruction correspond à une commutation d'un signal (ctrl, n_ctrl, I, Q), un délai (T3, T3', T4, T5, T6, T7), et une condition sélectionnée parmi une première, une deuxième et une troisième conditions ; chaque exécution d'une instruction comprend : - effectuer, à l'expiration dudit délai, ladite commutation dudit signal si la condition est la première condition, si la condition est la deuxième condition et qu'un drapeau (flag) est à un état actif, et si la condition est la troisième condition et que le drapeau (flag) est à un état inactif, et - ne pas effectuer ladite commutation si la condition est la deuxième condition et que le drapeau (flag) est à l'état inactif, et si la condition est la troisième condition et que le drapeau (flag) est à l'état actif ; et une première instruction est représentative d'une première commutation d'un premier signal (ctrl), d'un premier délai (T3) et de la deuxième condition et est immédiatement suivie d'une deuxième instruction représentative de ladite première commutation dudit premier signal (ctrl), d'un deuxième délai (T3') et de la troisième condition. Figure pour l'abrégé : Fig. 6

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