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公开(公告)号:CN107402892B
公开(公告)日:2023-06-27
申请号:CN201710343722.0
申请日:2017-05-16
Applicant: 瑞萨电子株式会社
IPC: G06F12/14
Abstract: 在现有技术的半导体器件中存以下问题:不能针对在主算术单元中执行的程序使用的子算术单元对共享存储器的访问执行存储器保护。根据一个实施例,半导体器件包括:子算术单元,被配置为执行主算术单元执行的程序的一部分的处理,以及由主算术单元和子算术单元共享的共享存储器,其中所述子算术单元包括:存储器保护单元,被配置为基于从所述主算术单元提供的访问允许范围地址值来允许或禁止对所述共享存储器的访问,对所述共享存储器的访问是由子算术单元执行的处理产生的访问。
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公开(公告)号:CN113157622A
公开(公告)日:2021-07-23
申请号:CN202110332377.7
申请日:2015-03-12
Applicant: 瑞萨电子株式会社
Abstract: 本发明涉及一种数据处理设备和数据处理系统。该数据处理设备包括:数据选择器电路,该数据选择器电路根据数据的分类将多个数据划分成划分数据;多个压缩电路,该多个压缩电路根据该多个数据中的每一个彼此并行地将该划分数据分别压缩成具有不同格式的压缩数据;以及数据发送电路,该数据发送电路向终端发送该压缩数据。其中,当从已经发送了一组多个数据的电路接收到数据控制信号时,该数据选择器电路对该一组多个数据进行划分;其中,与该多个数据分离地接收该数据控制信号,并且该数据控制信号包含指定该一组多个数据中的该多个数据中的每一个的结构的信息;以及其中,该数据选择器电路基于该数据控制信号对该一组多个数据进行划分。
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公开(公告)号:CN106164877B
公开(公告)日:2021-05-04
申请号:CN201580001866.7
申请日:2015-03-12
Applicant: 瑞萨电子株式会社
IPC: G06F13/00
Abstract: 数据选择器电路(2)将包括多种类型的数据的数据的集合划分成所述多种类型的数据。第一压缩电路(4a)和第二压缩电路(4b)按照所述多种类型的数据中的每个,彼此并行地分别压缩所述多种类型的数据。第一压缩电路(4a)压缩数据(b1)并且得到压缩数据(b2)。第二压缩电路(4b)压缩数据(c1)并且得到压缩数据(c2)。数据发送电路(6)将压缩数据(b2)和压缩数据(c2)发送到终端。
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公开(公告)号:CN105847819B
公开(公告)日:2020-03-06
申请号:CN201510969813.6
申请日:2015-12-22
Applicant: 瑞萨电子株式会社
IPC: H04N19/423
Abstract: 本发明涉及图像处理设备和半导体设备。在图像处理设备中,运动图像解码处理从输入流提取待解码的目标图像的特征量,并且基于所述特征量,改变从外部存储器到高速缓存存储器的高速缓存填充的读取大小。所述特征量代表例如一个图片(帧或场)中的帧内宏块比例或运动向量变化。当帧内宏块比例高时,所述高速缓存填充的读取大小减小。
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公开(公告)号:CN105763872B
公开(公告)日:2019-06-14
申请号:CN201510875698.6
申请日:2015-12-03
Applicant: 瑞萨电子株式会社
CPC classification number: H04N19/46 , H04N17/004 , H04N19/44 , H04N19/65 , H04N19/89
Abstract: 视频编码/解码系统及其诊断方法。视频编码/解码系统包括视频编码装置和视频解码装置。视频编码装置包括用于对诊断图像或正常图像进行编码的编码部分。视频解码装置包括:解码部分,用于对由编码部分编码的图像进行解码;校验信号产生部分,用于产生解码图像的校验信号;存储部分,用于存储诊断图像的校验信号的预期值或由校验信号产生部分产生的校验信号;和比较部分,用于将存储在存储部分中的校验信号与由校验信号产生部分产生的校验信号进行比较,以便检测从视频编码装置的图像输入部分到视频解码装置的图像输出部分的所有路径中的故障。
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公开(公告)号:CN107820086A
公开(公告)日:2018-03-20
申请号:CN201710600897.5
申请日:2017-07-21
Applicant: 瑞萨电子株式会社
IPC: H04N19/17 , H04N21/845
CPC classification number: H04N19/107 , G06T9/007 , H04N19/105 , H04N19/122 , H04N19/17 , H04N19/436 , H04N19/44 , H04N19/573 , H04N21/4728 , H04N21/816 , H04N21/8455
Abstract: 本发明涉及半导体装置、移动图像处理系统、控制半导体装置的方法。可以平滑地移动显示区域。半导体装置顺序地接收多个整体图像,每个整体图像包括多个小画面图像,并且每个整体图像在时间上是连续的并且形成移动图像;并且对接收到的整体图像进行解码。这里,半导体装置包括:接收单元,接收包括小画面图像的整体图像;确定单元,确定包括要解码的小画面图像并且被包括在整体图像中的解码区域;和,解码单元,解码由确定单元确定并且被包括在整体图像中的解码区域中的小画面图像。当在解码区域中出现帧内帧的小画面图像时,确定单元确定新的解码区域。
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公开(公告)号:CN118741131A
公开(公告)日:2024-10-01
申请号:CN202410292448.9
申请日:2024-03-14
Applicant: 瑞萨电子株式会社
IPC: H04N19/176 , H04N19/423 , H04N19/86 , H04N19/91
Abstract: 本公开涉及一种视频数据处理装置和视频数据处理方法,其中视频数据处理装置包括:至少一个第一功能模块,其执行针对每个第一处理单元数据而预设的第一处理;至少一个第二功能模块,其执行针对小于第一处理单元数据的每个第二处理单元数据而预设的第二处理;以及控制单元,其通过控制第一功能模块和第二功能模块进行操作的定时来控制针对第一处理单元数据的流水线处理的执行顺序。控制单元控制后续级,使得第一功能模块和第二模块根据前级的结束响应于相应处理的完成而开始。
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公开(公告)号:CN106355543B
公开(公告)日:2021-08-10
申请号:CN201610556581.6
申请日:2016-07-14
Applicant: 瑞萨电子株式会社
Abstract: 本发明提供了一种数据处理系统,包括:多个数据处理装置,该多个数据处理装置基于初始设置数据并行地进行数据处理。数据处理装置各自具有唯一的ID,并且包括存储初始设置数据的多个寄存器和传送电路。传送电路接收数据包,该数据包包括作为初始设置数据的有效负载、共享信息、目的地ID和目的地地址,并且,当共享信息指示有效负载是将被共同地设置到包括其自己的数据处理装置的多个数据处理装置中的初始设置数据时,将有效负载传送至目的地地址所指示的寄存器,而不考虑在目的地ID与其自己的ID之间的不匹配。
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公开(公告)号:CN107402892A
公开(公告)日:2017-11-28
申请号:CN201710343722.0
申请日:2017-05-16
Applicant: 瑞萨电子株式会社
IPC: G06F12/14
CPC classification number: G06F3/0637 , G06F3/0619 , G06F3/0632 , G06F3/0673 , G06F9/468 , G06F12/1433 , G06F12/1441 , G06F21/79
Abstract: 在现有技术的半导体器件中存以下问题:不能针对在主算术单元中执行的程序使用的子算术单元对共享存储器的访问执行存储器保护。根据一个实施例,半导体器件包括:子算术单元,被配置为执行主算术单元执行的程序的一部分的处理,以及由主算术单元和子算术单元共享的共享存储器,其中所述子算术单元包括:存储器保护单元,被配置为基于从所述主算术单元提供的访问允许范围地址值来允许或禁止对所述共享存储器的访问,对所述共享存储器的访问是由子算术单元执行的处理产生的访问。
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公开(公告)号:CN105245899A
公开(公告)日:2016-01-13
申请号:CN201510393593.7
申请日:2015-07-07
Applicant: 瑞萨电子株式会社
IPC: H04N19/423 , H04N19/433 , H04N19/176
CPC classification number: H04N19/159 , H04N19/105 , H04N19/12 , H04N19/16 , H04N19/176 , H04N19/433 , H04N19/436 , H04N19/597
Abstract: 本发明涉及图片编码设备、图片解码设备和图片通信系统。在图片编码设备和图片解码设备中,对参考帧存储器的访问被抑制。图片编码设备由用于图片内编码的第一编码器、用于图片间编码的第二编码器和中间缓冲器组成。由第一编码器生成的本地解码图片作为参考图片被存储在中间缓冲器中,并且第二编码器的图片间编码通过参考中间缓冲器中的本地解码图片执行。图片解码设备由用于图片内解码的第一解码器、用于图片间解码的第二解码器和中间缓冲器组成。由第一解码器生成的本地解码图片作为参考图片被存储在中间缓冲器中,并且第二解码器的图片间解码通过参考中间缓冲器中的本地解码图片执行。
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