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公开(公告)号:CN101064514B
公开(公告)日:2010-06-16
申请号:CN200710097248.4
申请日:2007-04-28
Applicant: 索尼株式会社
Inventor: 中川俊之
CPC classification number: G11B20/1426 , G11B2020/1457 , H03M5/145
Abstract: 本文披露了一种调制装置,包括:第一转换装置,用于根据将用作第一数据模式的偶/奇性保存转换模式与第一码模式关联的第一表,将作为与第一数据模式匹配的部分的、包括在处理数据中的部分转换成第一码模式;第二转换装置,用于根据将用作第二数据模式的偶/奇性保存违反转换模式与第二码模式相关联的第二表,将作为与第二数据模式匹配的部分的、包括在处理数据中的部分转换成第二码模式;以及选择装置,用于选择第一码模式或第二码模式,其中,如果已将DSV控制比特插入处理数据中,则禁止由第二转换装置执行的将所述部分转换为第二码模式的处理。
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公开(公告)号:CN1301595C
公开(公告)日:2007-02-21
申请号:CN03800087.3
申请日:2003-01-22
Applicant: 索尼株式会社
CPC classification number: G11B20/1426 , H03M5/145
Abstract: 一种调制装置和方法及DSV控制比特生成方法,能够准确地确定要插入到数据串中的DSV控制比特值。1-7PP数据转换单元(52)将调制分界点信息包括使用表2的转换表的数据串调制分界点信息提供给调制分界点检测单元(81),并且将DSV分段分界点信号包括已插入DSV控制比特的数据串的DSV分段分界点位置信息提供给有效分界点检测单元(82)。根据所提供的调制分界点信息,调制分界点检测单元(81)检测调制分界点位置,并且将调制分界点信号提供给有效分界点检测单元(82)。根据所提供的DSV分段分界点信号,有效分界点检测单元(82)从由所提供的调制分界点信号表示的调制分界点位置中,检测控制对应DSV分段的DSV控制比特的判决定时的有效分界点位置。本发明可以应用于调制装置。
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公开(公告)号:CN1739147A
公开(公告)日:2006-02-22
申请号:CN200380108730.3
申请日:2003-12-26
Applicant: 索尼株式会社
IPC: G11B7/0065 , G11C13/04 , G03H1/26 , G06K7/12
CPC classification number: G11B7/0065 , G03H2225/11 , G03H2225/24
Abstract: 在使用一维光调制器的全息记录和全息记录再现中,其中布置了多个光调制像素的一维光调制器调制激光束,以在全息记录介质上记录数字数据信号,部分光调制像素在保持预定间隔的两个或者多个位置在所述全息记录介质上记录同步信号,从而减少全息记录介质的变形等对记录在全息记录介质上的信息的再现或者读出的妨碍以及信噪比的降低。
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公开(公告)号:CN1496566A
公开(公告)日:2004-05-12
申请号:CN03800072.5
申请日:2003-01-15
Applicant: 索尼株式会社
CPC classification number: H03M5/145 , G11B20/1426 , H04L25/4908 , H04L25/4915
Abstract: 本发明涉及一种调制设备和方法,其中的调制设备是由简单电路结构实现的,并且易于应用到其它系统中。模式转换单元32根据转换表,将DSV控制位确定和插入单元31提供的,具有基本数据长度为2位的数据转换成具有基本代码长度为3位的变长代码。最小展开长度限制代码检测单元33从包含DSV控制位的数据序列中检测从模式转换单元32转换的信道位串开始连续的最小展开的位置。连续最小展开置换单元34根据由最小展开长度限制代码检测单元33提供的位置信息,将由模式转换单元32提供的信道位串的预定部分置换成预定的模式,并且将最小展开长度限制在预定的数值或更小。本发明可应用于调制设备中。
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公开(公告)号:CN1627425B
公开(公告)日:2010-06-16
申请号:CN200410100508.5
申请日:2004-07-07
Applicant: 索尼株式会社
Inventor: 中川俊之
CPC classification number: G11B20/18 , G11B5/012 , G11B2005/001 , G11B2020/10916
Abstract: 本发明涉及使用盘记录介质的数据记录/再现装置,盘记录介质具有多个形成其上的同心或者螺旋的轨道,每个轨道被分成多个扇区。该装置包括:用于搜索目标轨道的搜索元件;用于在通过搜索到达的目标轨道上存取数据的数据存取元件;和纠错元件,用于基于纠错元件出于纠错目的产生的纠错码在数据中进行纠错。纠错元件为每个预定数据量确定第一纠错码增量,根据盘记录介质上的状态信息为多个第一纠错码增量确定第二纠错码增量,并形成纠错块,每个纠错块由多个第一纠错码增量和加到第一纠错码增量的第二纠错码增量构成。
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