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公开(公告)号：CN1269076C
公开(公告)日：2006-08-09
申请号：CN01801735.5
申请日：2001-04-23
Applicant: 松下电器产业株式会社
Abstract: 本发明是用以执行滤波处理的像素运算装置，设有16个像素处理部分1～16及用以供给16个像素数据与滤波器系数的输入缓冲器群22；各像素处理部分，在用输入缓冲器群22供给的像素数据与滤波器系数进行运算后，从邻接的像素处理部分取得像素数据，用所取得的像素数据运算并将运算结果累积。通过重复进行这样的取得与累积操作，进行按重复次数而定的抽头数的滤波处理。
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公开(公告)号：CN1262929C
公开(公告)日：2006-07-05
申请号：CN99101872.9
申请日：1999-02-04
Applicant: 松下电器产业株式会社
IPC: G06F12/02 , G11C11/406
CPC classification number: G06F13/1647 , G11C7/1072 , G11C7/22
Abstract: 本发明揭示一种存储器控制装置和存储器控制方法以及存储程序的媒体传送对象单元(11)输出与数据读写有关的命令。地址生成单元(12)根据命令生成控制信号，同时输出读取的最初传送字节数。命令生成单元(13)根据控制信号生成控制命令后控制同步存储器(15)。命令生成单元(13)判断传送字节数后进行控制，使得根据数据传送效率高的命令执行。数据处理单元(14)根据控制命令在传送对象单元(11)与同步存储器(15)之间担任数据传送中介。
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公开(公告)号：CN1246772C
公开(公告)日：2006-03-22
申请号：CN03138541.9
申请日：2003-06-03
Applicant: 松下电器产业株式会社
IPC: G06F9/30
CPC classification number: G06F9/30014 , G06F9/30018 , G06F9/30036 , G06F9/30145 , G06F9/30167 , G06F9/3885 , G06F9/3887 , G06F15/8015
Abstract: 提供一种执行对作为SIMD运算对象的操作数位置的约束少、弹性高的SIMD运算的处理器。具备解码部(20)和运算部(40)等，若解码部(20)译码命令[vxaddh Rc，Ra，Rb]，则算术逻辑、比较运算器(41)等(i)将寄存器Ra的上位16位与寄存器Rb的下位16位相加，将结果存储在寄存器Rc的上位16位中，同时，(ii)将寄存器Ra的下位16位与寄存器Rb的上位16位相加，将结果存储在寄存器Rc的下位16位中。
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公开(公告)号：CN1156171C
公开(公告)日：2004-06-30
申请号：CN98108829.5
申请日：1998-04-04
Applicant: 松下电器产业株式会社
CPC classification number: H04N19/90 , H04N5/4401 , H04N21/426 , H04N21/42607 , H04N21/42653 , H04N21/42692 , H04N21/4302 , H04N21/4341
Abstract: 本发明的图象声音处理装置配有：输入输出处理部分，进行由外部要因非同步产生的输入输出处理；和解码处理部分，通过与所述输入输出处理并行，进行以在存储器存储的数据流的解码为主的解码处理。输入输出处理包括：输入从外部非同步输入的所述数据流，并存储于存储器；和把在存储器存储的数据流提供给解码处理部分。对于数据流，解码处理部分构成以条件判断为主的按序处理和除去压缩图象数据的标题解析的压缩图象数据的解码，以便与按序处理并行进行定型处理。
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公开(公告)号：CN1427335A
公开(公告)日：2003-07-02
申请号：CN02151868.8
申请日：2002-11-08
Applicant: 松下电器产业株式会社
IPC: G06F9/38
CPC classification number: G06F9/4843
Abstract: 根据本发明的电路组控制系统，具有从主处理器接收作为顺序的第一命令列和第二命令列，按照基于各命令列的顺序将各命令传送到可执行该命令的电路来分别执行应在多个电路中指定电路中执行的命令的功能，在与执行第一命令列中命令的电路(第一电路)不同的任一电路(第二电路)中，通过执行可由该第二电路执行的第二命令列中的命令，实现对多个命令列的并列执行。
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Patent Agency Ranking
公开(公告)号：CN101626475B
公开(公告)日：2011-05-04
申请号：CN200910164114.9
申请日：2005-04-01
Applicant: 松下电器产业株式会社
IPC: H04N5/775
CPC classification number: G06F13/4027 , H04N5/775 , H04N5/781 , H04N5/85 , H04N5/907 , H04N9/7921 , H04N9/8042
Abstract: 提供能够将在影像声音设备的开发中得到的设计资源也转用到其他种类的影像声音设备中的影像声音处理用集成电路。具备：微型计算机块(2)，具有CPU；流I/O块(4)，与外部装置进行影像及声音流的输入输出；媒体处理块(3)，执行媒体处理，该媒体处理包括输入到流I/O块(4)中的影像及声音流等的压缩及扩展中的至少1个；AVIO块(5)，将由媒体处理块(3)进行媒体处理后的影像及声音流变换为影像及声音信号，并输出给外部设备等；存储器IF块(6)，控制微型计算机块(2)、流I/O块(4)、媒体处理块(3)及AVIO块(5)与外部存储器(9)之间的数据传送。
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公开(公告)号：CN1879092B
公开(公告)日：2010-05-12
申请号：CN200480033377.1
申请日：2004-09-08
Applicant: 松下电器产业株式会社
CPC classification number: G06F12/0842 , G06F12/0848 , G06F12/121 , G06F12/126
Abstract: 本发明的高速缓冲存储器为N-路组联方式的高速缓冲存储器，包括：控制寄存器，示出N个通路中的1个或多个通路；控制单元，使控制寄存器示出的通路激活；以及更新单元，对控制寄存器的内容进行更新，上述控制单元对由控制寄存器所示出的激活通路以外的通路至少限制置换。
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公开(公告)号：CN100557565C
公开(公告)日：2009-11-04
申请号：CN200510113272.3
申请日：2005-07-06
Applicant: 松下电器产业株式会社
IPC: G06F9/38
CPC classification number: G06F9/3877 , G06F9/3885
Abstract: 一种具备主处理器和协处理器的运算处理装置，主处理器具有：根据运算指令进行运算时用于保存运算对象或结果的多个寄存器、和逐次解释指令并进行根据指令的控制的指令解释控制部，此指令解释控制部利用操作数来指定：在上述协处理器中应执行的运算处理的种类、表示保存该运算处理对象的第一寄存器的信息和表示应保存上述协处理器进行运算处理的结果的第二寄存器的信息，通过解释用于请求向协处理器的运算的1条指令即协处理器运算指令，从而进行下述控制：在上述协处理器中，将第一寄存器的内容作为运算处理对象以执行该种类的运算处理，进而将由上述协处理器生成的此运算处理结果写入第二寄存器。
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公开(公告)号：CN100517274C
公开(公告)日：2009-07-22
申请号：CN200580009226.7
申请日：2005-03-16
Applicant: 松下电器产业株式会社
IPC: G06F12/08
CPC classification number: G06F12/0862 , G06F2212/6028
Abstract: 本发明的高速缓冲存储器具有预测处理部(39)，该预测处理部(39)根据由处理器所输出的存储器的访问的进行状况来预测下一个应该预取的线地址；预测处理部(39)具有预取部(414)和触摸部(415)，该预取部(414)从存储器中将所预测的线地址的数据预取到高速缓冲存储器中，该触摸部(415)不将数据从存储器中加载到高速缓冲存储器上，而是将所预测的线地址作为标签设定到高速缓存项，并使有效标志有效。
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公开(公告)号：CN100373331C
公开(公告)日：2008-03-05
申请号：CN200510125175.6
申请日：1997-08-27
Applicant: 松下电器产业株式会社
CPC classification number: G06F9/4843 , G06F9/3009 , G06F9/3822 , G06F9/3851
Abstract: 一种执行多个指令流的多线程处理器，包括：多个功能单元，执行指令；多个指令解码器，与各指令流对应地设置，解码各个指令，完成作为执行该指令的功能单元要求将解码指令发给该功能单元的指令发出要求；优先权存储器，存储各指令流的优先权，各优先权与其他指令流的优先权独立，并通过专用指令变更；自停止数据存储器，在各指令流中存储指令流处于执行状态还是处于停止状态的自停止数据；调解器，接收来自多个指令解码部分通知的指令发出要求，2个以上的指令发出要求同时指定一个功能单元的情况下，根据优先权存储器中存储的优先权，确定向该功能单元要发出的解码指令；停止器，根据所述自停止数据，停止与正处于停止状态的指令流相应的指令解码部分向调解器的指令发出要求的通知。
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