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公开(公告)号：CN107258000B
公开(公告)日：2021-12-03
申请号：CN201680012269.9
申请日：2016-02-10
Applicant: 英特尔公司
IPC: G11C11/4091 , G11C11/4093 , G11C11/4096
Abstract: 描述的是一种装置，其包括：具有相关联的源感测放大器的存储器单元的源阵列；具有相关联的目的地感测放大器的存储器单元的目的地阵列；以及用以激活源字线（WL）来在源阵列内选择存储器单元的行以使得所选的存储器单元的行中的数据被相关联的源感测放大器锁存的逻辑，其中该逻辑用来激活目的地WL来在目的地阵列内选择存储器单元的行以使得所选的存储器单元的行中的数据被相关联的目的地感测放大器锁存，并且其中存储器单元的源和目的地阵列在存储器的同一存储体内。
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公开(公告)号：CN108780657A
公开(公告)日：2018-11-09
申请号：CN201780019474.2
申请日：2017-02-22
Applicant: 英特尔公司
Inventor： S.富岛
CPC classification number: G11C11/1673 , G11C11/1657 , G11C11/1659 , G11C11/1675
Abstract: 在一个实施例中，按照本说明书的电源切换的双单元存储器比特单元中的比特状态可通过将电源线耦合到比特单元的公共节点以驱动互补电流驱动通过用于比特单元的一对互补比特线信号线的互补电阻状态存储单元来读。比特单元的比特状态可通过感测该对第一和第二互补比特线信号线上的互补比特状态信号来读。在一个实施例中，每个电阻状态存储单元具有电阻状态铁磁装置，诸如磁遂穿结（MTJ）。在一个实施例中，按照本说明书的电源切换的双单元存储器比特单元可没有源线或选择线（SL）信号线。本文描述了其它方面。
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公开(公告)号：CN108780657B
公开(公告)日：2022-12-20
申请号：CN201780019474.2
申请日：2017-02-22
Applicant: 英特尔公司
Inventor： S.富岛
Abstract: 在一个实施例中，按照本说明书的电源切换的双单元存储器比特单元中的比特状态可通过将电源线耦合到比特单元的公共节点以驱动互补电流驱动通过用于比特单元的一对互补比特线信号线的互补电阻状态存储单元来读。比特单元的比特状态可通过感测该对第一和第二互补比特线信号线上的互补比特状态信号来读。在一个实施例中，每个电阻状态存储单元具有电阻状态铁磁装置，诸如磁遂穿结（MTJ）。在一个实施例中，按照本说明书的电源切换的双单元存储器比特单元可没有源线或选择线（SL）信号线。本文描述了其它方面。
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公开(公告)号：CN107258000A
公开(公告)日：2017-10-17
申请号：CN201680012269.9
申请日：2016-02-10
Applicant: 英特尔公司
IPC: G11C11/4091 , G11C11/4093 , G11C11/4096
CPC classification number: G11C11/4091 , G11C5/025 , G11C7/08 , G11C7/1006 , G11C7/1045 , G11C7/20 , G11C7/22 , G11C11/4072 , G11C11/4076 , G11C11/4093 , G11C11/4096 , G11C2207/005 , G11C2207/105 , G11C2207/107
Abstract: 描述的是一种装置，其包括：具有相关联的源感测放大器的存储器单元的源阵列；具有相关联的目的地感测放大器的存储器单元的目的地阵列；以及用以激活源字线（WL）来在源阵列内选择存储器单元的行以使得所选的存储器单元的行中的数据被相关联的源感测放大器锁存的逻辑，其中该逻辑用来激活目的地WL来在目的地阵列内选择存储器单元的行以使得所选的存储器单元的行中的数据被相关联的目的地感测放大器锁存，并且其中存储器单元的源和目的地阵列在存储器的同一存储体内。
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