Integrated reception apparatus
    93.
    发明公开
    Integrated reception apparatus 审中-公开
    Integrierte Empfangsvorrichtung

    公开(公告)号:EP1107498A2

    公开(公告)日:2001-06-13

    申请号:EP00125906.8

    申请日:2000-11-27

    Abstract: In an integrated reception apparatus, information received from a plurality of sources is supplied to an A/D (7) and a DSP (8); a controller (8a) of the DSP (8) determines an order of priority of the information, and processes the information based on the order of priority. The order of priority is determined based on an error correction ability, allowable error ratio, or degree of importance of the information and, by performing demodulation of the signals lower in priority with interruption or curtailment processing, the capacity of the DSP (8) is efficiently used.

    Abstract translation: 在综合接收装置中,从多个源接收的信息被提供给A / D(7)和DSP(8); DSP(8)的控制器(8a)确定信息的优先顺序,并且基于优先级顺序处理该信息。 基于纠错能力,允许误差率或信息重要度确定优先顺序,通过中断或削减处理对优先级较低的信号进行解调,DSP(8)的容量为 有效地使用。

    無線通信システムにおける同期処理回路、同期処理方法

    公开(公告)号:JPWO2010082431A1

    公开(公告)日:2012-07-05

    申请号:JP2010546572

    申请日:2009-12-21

    Abstract: 無線通信システムにおける同期処理回路において、複数の無線方式における種々の同期処理に対応させるため、相関演算部を再構成可能な並列構成とし、柔軟性を向上させる。無線通信システムにおける同期処理回路において、相関演算を行う複数の相関演算モジュール31〜3Nを備え、相関演算モジュールが、複数の相関器60と、相関コードをシフトするための複数のシフトレジスタ50と、シフトした相関コードをタイミング相関処理用に隣接する相関演算装置に渡すインタフェースと、外部から個別に入力したコード相関処理用の相関コードと隣接する相関演算装置から渡された相関コードとを選択して相関コードとする相関コード選択部40を含む。

    Reconfigurable signal processing module
    100.
    发明专利

    公开(公告)号:JP2007507018A

    公开(公告)日:2007-03-22

    申请号:JP2006515406

    申请日:2004-10-15

    CPC classification number: H04W8/245 H04B2201/70711

    Abstract: 本発明は特に無線通信端末のための再構成可能な信号処理モジュールに関係するが、それに限るものではない。 一般論として、一形態では本発明は、異なる機能を実施するソフトウェア・モジュールと同様に、ASIC及びフィールド・プログラム可能論理ゲート・アレイ(FPGA)を含む再構成可能ハードウェア・ブロックといった、いくつかの再構成可能な資源を持つ信号処理モジュールを再構成するためのシステムを提供し、それは信号処理モジュール内のDSPまたは他の処理プラットホーム上で実行される。 そのモジュールは例えば無線通信システムにおける移動体端末または基地局である。 そのシステムは資源に関する構成命令を含む命令データ構造を生成する手段を具備し、さらにこのデータ構造を信号処理モジュールに通信する手段を具備する。 そのモジュールはこのデータ構造を用いて自身を再構成する手段を有する。 一般的に、データ構造は適切な資源への発送に適したタイムスタンプされた構成及びランタイム命令を持つ処理時間表であろう。
    【選択図】図2

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