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    codificador, decodificador, método de codificação e método de decodificação
    23.
    发明专利
    codificador, decodificador, método de codificação e método de decodificação 未知

    公开(公告)号：BR112020019800A2

    公开(公告)日：2021-01-05

    申请号：BR112020019800

    申请日：2019-05-16

    Applicant: PANASONIC IP CORP AMERICA

    Inventor： KIYOFUMI ABE ,  RYUICHI KANOH ,  TADAMASA TOMA ,  TAKAHIRO NISHI

    IPC: H04N19/117 ,  H04N19/167 ,  H04N19/182 ,  H04N19/86

    Abstract: codificador, decodificador, método de codificação e método de decodificação a presente invenção refere-se a um codificador (100) inclui um conjunto de circuitos (160) e uma memória (162). utilizando-se a memória, o conjunto de circuitos determina um filtro a ser utilizado para a filtragem de desbloqueio dentre uma pluralidade de filtros, incluindo um primeiro filtro e um segundo filtro (s102); e realiza a filtragem de desbloqueio em um limite de bloco utilizando o filtro determinado (s103). o primeiro filtro utiliza m pixels localizados em um lado superior do limite de bloco e m pixels localizados em um lado inferior do limite de bloco, e o segundo filtro utiliza os primeiros pixels localizados no lado superior do limite de bloco e os segundos pixels localizados no lado inferior do limite de bloco, onde m é um inteiro igual a pelo menos 2. o número de primeiros pixels é qualquer um dentre uma pluralidade de primeiros valores candidatos, e o número de segundos pixels é qualquer um dentre uma pluralidade de segundos valores candidatos. a pluralidade de primeiros valores candidatos a pixel e a pluralidade de segundos valores candidatos a pixel são, cada uma, um valor superior a ou igual a m.

    codificador, decodificador, método de codificação, e método de decodificação
    24.
    发明专利
    codificador, decodificador, método de codificação, e método de decodificação 未知

    公开(公告)号：BR112020013554A2

    公开(公告)日：2020-12-01

    申请号：BR112020013554

    申请日：2019-01-30

    Applicant: PANASONIC IP CORP AMERICA

    Inventor： KIYOFUMI ABE ,  RYUICHI KANOH ,  TADAMASA TOMA ,  TAKAHIRO NISHI

    IPC: H04N19/109 ,  H04N19/157 ,  H04N19/176 ,  H04N19/513 ,  H04N19/577

    Abstract: a presente invenção refere-se a dispositivo de codificação (codificador) (100) que é provido com circuito (160) e memória (162). o circuito (160) determina qual modo dentre múltiplos modos incluindo um primeiro modo no qual processamento de predição é executado com base em um vetor de movimento de bloco por bloco em uma imagem em movimento, e um segundo modo no qual o modo de predição executado com base em um vetor de movimento de sub-bloco por sub-bloco é usado para executar o processamento de predição, o sub-bloco sendo obtido ao dividir o bloco, se o modo de predição for executado no primeiro modo, avalia se é ou não para executar processamento de correção em uma imagem de predição obtida ao executar o processamento de predição, usando um gradiente espacial de valores de pixels na imagem de predição, e executa o processamento de correção se for avaliado que o processamento de correção é para ser executado, e se o processamento de predição for executado no segundo modo, não executa o processamento de correção.

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