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公开(公告)号：KR101844300B1
公开(公告)日：2018-05-15
申请号：KR1020120007884
申请日：2012-01-26
IPC: H03D1/20
Abstract: 동적으로제어가능한포락선검파장치는입력신호에응답하여상기입력신호의포락선을출력하는포락선검파기; 상기입력신호에응답하여원하는(desired) 검파대역을판단하는검파대역판단부; 및상기판단된검파대역을기초로상기포락선검파기의검파대역을제어하기위하여상기포락선검파기로제공되는제어신호를생성하는검파대역제어기를포함한다.
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32.发明公开
公开(公告)号：KR1020160102367A
公开(公告)日：2016-08-30
申请号：KR1020160104287
申请日：2016-08-17
Applicant: 한국과학기술원
IPC: G01R29/08 , G01N21/3586 , H01Q13/08
CPC classification number: G01R29/0878 , G01N21/3586 , H01Q13/08
Abstract: 본발명은, 고속데이터출력용테라헤르츠수신기로서, 수신안테나를통해수신된테라헤르츠파신호를전류로변환하는전계효과트랜지스터(FET)를구비하는검출기및 상기검출기로부터출력되는전류를읽는(readout) 측정기를포함할수 있다.
Abstract translation: 本发明涉及一种适用于太赫兹通信的高速数据输出的太赫兹接收机，因为反应性变化程度小。 用于高速数据输出的太赫兹接收器包括：具有用于将通过接收天线接收的太赫兹信号转换为电流的场效应晶体管（FET）的检测器; 以及用于读出从检测器输出的电流的测量器。
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33.发明授权실시간 테라헤르츠 이미징을 위해 주파수 변환을 이용한 이미징 센서 장치 및 초점면 배열 이미징 장치 有权成像传感器设备和正面平面阵列设备使用频率转换实时TERAHERTZ IMAGINIG
公开(公告)号：KR101533236B1
公开(公告)日：2015-07-02
申请号：KR1020140056538
申请日：2014-05-12
Applicant: 한국과학기술원
Abstract: 본발명의일 실시예와관련된실시간테라헤르츠이미징을위해주파수변환을이용한이미징센서장치는수신안테나를통해수신된테라헤르츠파신호를검출하는검출기와, 상기검출기의출력전압에따라발진주파수를출력하는전압제어발진기및 전압제어발진기로부터출력된발진주파수를디지털신호로변환하는주파수디지털변환기를포함한다.
Abstract translation: 与本发明的实施例相关的使用实时太赫兹成像的频率变换的成像传感器装置包括：用于检测通过接收天线接收的太赫兹波的检测器; 电压控制振荡器，用于根据检测器的输出电压输出振荡频率; 以及频率数字转换器，用于将由压控振荡器输出的振荡频率转换为数字信号。
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公开(公告)号：KR1020150025767A
公开(公告)日：2015-03-11
申请号：KR1020130103777
申请日：2013-08-30
Applicant: 한국과학기술원
IPC: H03F3/60
CPC classification number: H03F3/601 , H03F3/193 , H03F2200/543 , H03G1/0029
Abstract: 본 발명은 결합 선로의 일단부들은 AC 단락시키고, 타단부들은 트랜지스터의 게이트 단자와 드레인 단자에 각각 연결하고, 상기 결합 선로의 길이는 동작 주파수에서의 λ/4보다 소정 길이가 짧도록 설계하여, 상기 결합 선로에 의해 상기 트랜지스터의 입력단, 상기 트랜지스터의 게이트와 드레인 사이 및 상기 트랜지스터의 출력단에 각각 연결된 인덕터로 등가 회로화하는 것을 특징으로 하는 증폭기의 설계 방법으로 게이트와 드레인 사이의 커패시턴스를 제거함으로써 역방향 격리 성능을 향상시켜 증폭기의 이득을 향상시킨 효과가 발생한다.
Abstract translation: 本发明涉及使用耦合线及其放大器的放大器的中和设计方法。 本发明断开了耦合线路的一端，并将晶体管的栅极端子和漏极端子连接到耦合线路的另一端。 耦合线的长度设计为比操作频率上的特定长度短λ/ 4。 电感器通过耦合线和晶体管的输出端子以及晶体管的栅极和漏极分别连接到晶体管的输入端子。 本发明通过去除栅极和漏极之间的电容来改善反向分离性能来改善放大器的晶粒的效果。
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公开(公告)号：KR101402945B1
公开(公告)日：2014-06-05
申请号：KR1020120047682
申请日：2012-05-04
Applicant: 한국과학기술원
IPC: H03B5/12
Abstract: 시링킹팩터(shrinking factor)를 보다 더 작게 만들 수 있고 1-최하위 비트(LSB)에 따라 변하는 유닛 캐패시턴스(unit capacitance)를 더 줄어들게 하는 것이 가능하도록, 인덕터와 캐패시터로 구성되는 엘씨탱크(LC-tank)와, 엘씨탱크에 병렬로 연결되는 제1트랜지스터 및 제2트랜지스터와, 제1트랜지스터와 캐스코드(cascode) 방식으로 연결되는 제3트랜지스터와, 제2트랜지스터와 캐스코드 방식으로 연결되는 제4트랜지스터와, 제3트랜지스터와 제4트랜지스터의 소스에 연결되는 유닛 캐패시터와, 하나는 제3트랜지스터의 드레인과 소스에 연결되고 다른 하나는 제4트랜지스터의 드레인과 소스에 연결되는 한쌍의 보조캐패시터를 포함하는 양자화 잡음을 감소시킨 고해상도 디지털 제어 발진기를 제공한다.
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Patent Agency Ranking
公开(公告)号：KR1020130124064A
公开(公告)日：2013-11-13
申请号：KR1020120047682
申请日：2012-05-04
Applicant: 한국과학기술원
IPC: H03B5/12
CPC classification number: H03B5/124 , H03B5/1212 , H03B5/1228 , H03B5/24 , H03B2200/0088
Abstract: Provided is a high-resolution DCO structure for reducing quantization noise which is capable of making shrinking factors smaller and reducing unit capacitance varying according to 1-least significant bits (LSBs), comprising: an LC-tank comprising an inductor and a capacitor; a first transistor and a second transistor connected to the LC-tank in parallel; a third transistor connected to the first transistor in a cascade mode; a fourth transistor connected to the second transistor in the cascade mode; a unit capacitor connected to sources of the third transistor and the fourth transistor, respectively; a pair of sub capacitors in which one is connected to the drain and source of the third transistor and the other is connected to the drain and source of the fourth transistor.
Abstract translation: 提供了一种用于降低量化噪声的高分辨率DCO结构，其能够使缩小因子更小并且减小单位电容根据1-最低有效位（LSB）而变化，包括：包括电感器和电容器的LC槽; 并联连接到LC箱的第一晶体管和第二晶体管; 以级联模式连接到第一晶体管的第三晶体管; 以级联模式连接到第二晶体管的第四晶体管; 分别连接到第三晶体管和第四晶体管的源极的单位电容器; 一对副电容器，其中一个连接到第三晶体管的漏极和源极，另一个连接到第四晶体管的漏极和源极。
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公开(公告)号：KR1020130098063A
公开(公告)日：2013-09-04
申请号：KR1020120019879
申请日：2012-02-27
Applicant: 한국과학기술원
IPC: H03F3/45 , G09G3/20 , H03K19/0175
CPC classification number: H03F3/45237 , G09G3/2085 , H03K19/018528
Abstract: PURPOSE: A low power and high speed buffer amplifying circuit for driving an LCD is provided to improve the internal slew rate and the external slew rate at the same time according to a slewing condition. CONSTITUTION: An input unit (10) outputs current by being input with an input signal from a differential input end. A comparison unit (20) activates a current transmission path by making the output current of the input unit to be flowed when the change of an input signal which is input from the input unit is more than a reference value. A current transmission unit (30) transmits current to the input unit or to an output end by being activated by the comparison unit, and comprises multiple current transmission paths. A reverse amplifying unit (40) delivers the current through the current transmission unit, and charges or discharges the current of the output end at the same time. [Reference numerals] (10) Input unit; (21) First comparison unit; (22) Second comparison unit; (31) First current transmission unit; (32) Second current transmission unit; (41) First reverse amplifying unit; (42) Second reverse amplifying unit; (AA) Input end; (BB) Output end
Abstract translation: 目的：提供用于驱动LCD的低功耗和高速缓冲放大电路，以根据回转条件同时提高内部转换速率和外部转换速率。 构成：输入单元（10）通过从差分输入端输入的输入信号输出电流。 当从输入单元输入的输入信号的改变大于参考值时，比较单元（20）通过使输入单元的输出电流流动来激活当前传输路径。 当前传输单元（30）通过由比较单元激活而将电流传输到输入单元或输出端，并且包括多个当前传输路径。 反向放大单元（40）将电流传送通过电流传输单元，同时对输出端的电流进行充电或放电。 （附图标记）（10）输入单元; （21）第一比较单位; （22）第二比较单位; （31）第一电流传输单元; （32）第二电流传输单元; （41）第一反相放大单元; （42）第二反向放大单元; （AA）输入端; （BB）输出端
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公开(公告)号：KR101286226B1
公开(公告)日：2013-07-15
申请号：KR1020120019876
申请日：2012-02-27
Applicant: 한국과학기술원
CPC classification number: H03M1/66 , G09G3/36 , G09G5/006 , H03M2201/62 , H03M2201/932
Abstract: PURPOSE: A digital analog converter, a driving apparatus including the same, and a display apparatus are provided to remove the loading effect without any additional current. CONSTITUTION: A digital analog converter (1500) comprises an R- DAC (Digital to Analog Converter) (1510, 1520, 1530) connected with a cascade and a buffer (1540). The R- DAC (1510) comprises multiple resistance strings (R1) and a decoder (1512). The R-DAC (1520) comprises multiple resistance strings (R2) which connected to the R-DAC (1510) and a decoder (1522). The R-DAC (1530) comprises multiple resistance strings (R3) which connected to the R-DAC (1520) and a decoder (1532). The buffer is connected to the output terminal of the R-DAC (1530). [Reference numerals] (1512,1532) Four bits decoder; (1522) Two bits decoder
Abstract translation: 目的：提供数字模拟转换器，包括该数字模拟转换器的驱动装置和显示装置，以便在没有任何附加电流的情况下去除负载效应。 构成：数字模拟转换器（1500）包括与级联连接的R-DAC（数模转换器）（1510,1520,1530）和缓冲器（1540）。 R-DAC（1510）包括多个电阻串（R1）和解码器（1512）。 R-DAC（1520）包括连接到R-DAC（1510）的多个电阻串（R2）和解码器（1522）。 R-DAC（1530）包括连接到R-DAC（1520）的多个电阻串（R3）和解码器（1532）。 缓冲器连接到R-DAC（1530）的输出端。 （附图标记）（1512,1532）四位解码器; （1522）两位解码器
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公开(公告)号：KR101009421B1
公开(公告)日：2011-01-19
申请号：KR1020080111207
申请日：2008-11-10
Abstract: 본 발명은 저전력 초재생수신장치 및 초재생수신장치에서 전력감소 방법에 관한 것이다. 본 발명의 초재생수신장치는 발진을 시작하는 가동시간이 입력신호의 존재여부 따라 상이한 오실레이터 및 오실레이터의 가동시간 내에서만 전원을 인가하는 전원제어부를 포함한다. 전원제어부는 오실레이터가 가동하는 구간 내에서만 전체 초재생수신장치를 구동하도록 함으로써 전력을 감소시킨다.
Abstract translation: 提供超再生接收机和用于在超再生接收机中节电的方法，以调整占空比以降低平均功耗以周期性地关闭超再生接收机的功率，从而降低接收机的平均功率。 根据振荡器（530）中是否存在输入信号来改变振荡的操作时间。 功率控制器（510）仅在振荡器操作的时段期间向隔离放大器（520），振荡器，包络检测器（540）和放大器（550）供电。
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公开(公告)号：KR100909067B1
公开(公告)日：2009-07-23
申请号：KR1020070133740
申请日：2007-12-18
CPC classification number: H04W52/0229 , Y02D70/122 , Y02D70/166
Abstract: 본 발명은 USN용 센서 노드의 무선 송수신 장치에서 소모되는 전력을 최소화하기 위한 저전력 전파 감응 웨이크업 수신기 및 그 구조를 제안함을 목적으로 한다. 본 발명에 따른 웨이크업 수신기는 웨이크업 데이터를 수신하기 위한 데이터 수신부, 일정 순환 주기 안에서 미리 설정된 시간 구간마다 버스트 신호를 수신하기 위한 버스트 신호 수신부, 상기 일정 순환 주기 안에서 미리 설정된 시간 구간 동안 버스트 신호 수신부를 활성화시키는 신호를 발생하는 듀티 사이클 신호 발생부 및 활성화되면 듀티 사이클 신호 발생부를 디세이블시키고 데이터 수신부에 전원을 인가하여 웨이크업 데이터를 수신하도록 하는 스위칭부를 포함하며, 스위칭부는 상기 버스트 신호 수신부로부터 수신된 유효한 버스트 신호의 검출에 의해 턴온되고 내부의 프로그램 가능한 카운터에 의해 턴오프되며, 웨이크업 처리부에 의해서도 턴오프 가능하다.
Abstract translation: 提供一种对电波敏感的低功率唤醒接收器，通过该接收器，泛在传感器网络（USN）中的传感器节点的射频（RF）收发器所消耗的功率被最小化。 唤醒接收器唤醒主收发器包括占空比信号发生单元，其控制占空比信号的占空比; 突发信号检测单元，基于占空比信号接收包括突发信号和数据信号的输入信号，放大输入信号，并且如果放大的输入信号是突发信号，则输出控制信号; 以及数据信号检测单元，基于控制信号重新放大放大的输入信号，并且如果再放大的输入信号是数据信号，则输出唤醒信号。 提供给占空比信号生成单元的电力基于控制信号被中断，并且基于唤醒信号将电力重新提供给占空比信号生成单元。
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