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公开(公告)号：KR1020150120620A
公开(公告)日：2015-10-28
申请号：KR1020140046377
申请日：2014-04-18
Applicant: 삼성전자주식회사
IPC: G09G3/20
CPC classification number: G09G5/008 , G09G3/2096 , G09G2330/021 , G09G2330/06 , G09G2340/0435 , G09G2370/10
Abstract: 본발명의실시예에따른디스플레이드라이버 IC는제1드라이버블록과, 제2드라이버블록과, 픽셀데이터그룹들을포함하는직렬데이터패킷을픽셀데이터그룹별로디시리얼라이즈하고, 디시리얼라이즈된픽셀데이터그룹들각각을상기제1드라이버블록과상기제2드라이버블록으로번갈아전송하는전송제어회로를포함한다. 상기전송제어회로는, 제어신호에기초하여, 첫번째로디시리얼라이즈된픽셀데이터그룹을상기제1드라이버블록과상기제2드라이버블록중에서어느하나로전송한다.
Abstract translation: 根据本发明的实施例的显示驱动器IC包括：第一驱动器块; 第二个驱动块; 以及发送控制电路，其对包括像素数据组的串行数据分组进行逐个序列化，并且将每个解除序列化的像素数据组交替地发送到第一驱动器块和第二驱动器块。 传输控制电路基于控制信号将第一解串行像素数据组发送到来自第一驱动器块和第二驱动器块的任何一个。
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公开(公告)号：KR1020160038154A
公开(公告)日：2016-04-07
申请号：KR1020140130188
申请日：2014-09-29
Applicant: 삼성전자주식회사
CPC classification number: G09G3/3688 , G09G2310/0286 , G09G2310/0291 , G09G2310/0297 , G09G2310/08
Abstract: 본발명의실시예에따른소스드라이버회로는: 기준주기만큼서로지연되는복수의클럭들로부터, 디스플레이패널로전송되는데이터신호의출력타이밍을제어하는 DMS 신호들을생성하는복수의 DMS 블록들을포함할수 있다. 각각의 DMS 블록은복수의서브블록들을포함하고, 각각의서브블록은: 상기복수의클럭들중 선택된클럭들을이용하여상기 DMS 신호들중 타깃 DMS 신호들을출력하기위한인에이블신호를생성하는인에이블신호생성부; 그리고상기 DMS 신호들이상기기준주기만큼서로지연되어순차적으로출력될수 있도록상기 DMS 신호들을지연시키는지연부를포함할수 있다. 본발명의실시예에따르면, 디스플레이장치의화소의충전시간부족문제를해결할수 있고, 영상데이터가출력되는타이밍을정확하게제어할수 있다.
Abstract translation: 显示装置技术领域本发明涉及显示装置，更具体地涉及控制输出到显示面板的图像数据的源驱动器。 根据本发明的实施例的源驱动器可以包括：多个DMS块，其生成DMS信号，其适于从相对于彼此延迟的多个时钟中控制发送到显示面板的数据信号的输出定时 参考期。 每个DMS块包括多个子块。 每个子块可以包括：使能信号生成单元，其生成适于通过使用在时钟中选择的时钟来输出DMS信号的目标DMS信号的使能信号; 以及延迟单元，其延迟DMS信号，使得DMS信号相对于彼此延迟参考周期并被顺序输出。 根据本发明的实施例，可以克服显示装置的像素缺乏充电时间的问题，并且可以正确地控制输出图像数据的定时。
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公开(公告)号：KR1019940008209B1
公开(公告)日：1994-09-08
申请号：KR1019910007953
申请日：1991-05-16
Applicant: 삼성전자주식회사
IPC: G11C16/00
Abstract: The prelaser testing method of a die having a redundancy column line and a redundancy row line includes the steps of disconnecting a fuse commonly fastened to the redundancy column and row lines during an occurrence of a defect, and logging defective bits to 4:1 on an address position of an error catch RAM, thereby raising the efficiency of test equipment.
Abstract translation: 具有冗余列线和冗余行线的管芯的预激光器测试方法包括以下步骤：在发生缺陷期间断开通常紧固到冗余列和行线的熔丝，并将缺陷位记录在4：1上 错误捕获RAM的地址位置，从而提高测试设备的效率。
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公开(公告)号：KR1020140109135A
公开(公告)日：2014-09-15
申请号：KR1020130023462
申请日：2013-03-05
Applicant: 삼성전자주식회사
IPC: G09G3/36
CPC classification number: G09G3/3685 , G09G3/3688 , G09G2310/027 , G09G2310/0291 , H03K5/04 , H03K19/00361
Abstract: Disclosed are an output buffer circuit which can compensate a slew rate and a source driving circuit including the same. The output buffer circuit comprises a bias current control signal generating circuit and a channel amplification circuit. The current control signal generating circuit comprises a reference operational amplifier and carries out an exclusive OR for an input signal and an output signal of the reference operational amplifier to generate a bias current control signal. The channel amplification circuit compensates the slew rate in response to the bias current control signal. The buffering is carried out for multiple input voltage signals to generate multiple output voltage signals. Therefore, the source driving circuit comprising the output buffer circuit can be used in a high-resolution and large-size panel, and reduces the power consumption.
Abstract translation: 公开了一种可以补偿压摆率的输出缓冲电路和包括该输出缓冲电路的源极驱动电路。 输出缓冲电路包括偏置电流控制信号发生电路和通道放大电路。 电流控制信号发生电路包括参考运算放大器，并对输入信号和参考运算放大器的输出信号执行异或以产生偏置电流控制信号。 通道放大电路根据偏置电流控制信号补偿压摆率。 对多个输入电压信号执行缓冲以产生多个输出电压信号。 因此，包括输出缓冲电路的源极驱动电路可以用于高分辨率和大尺寸面板，并且降低功耗。
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