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公开(公告)号：KR1020120094640A
公开(公告)日：2012-08-27
申请号：KR1020110014022
申请日：2011-02-17
Applicant: 성균관대학교산학협력단
CPC classification number: H03L7/0891 , H03L7/087 , H03L7/099 , H03L7/0998
Abstract: PURPOSE: A phase locked loop having a phase interpolation function and a method for phase interpolation in a phase locked loop are provided to generate a spectrum spread clock which can reduce electromagnetic interference in a high frequency by using phase-locked loop having the phase interpolation function. CONSTITUTION: A voltage controlled oscillator(110) generates a plurality of output clocks having different phases at the same phase interval. A MUX(Multiplexer)(120) selects two neighboring clocks from the output clocks which are generated from the voltage controlled oscillator. A frequency divider(160) respectively inputs clocks selected from the MUX. Two phase comparators(131,132) respectively compare divided two clocks with a reference clock coming from the outside. Two charge pumps(141,142) output currents according to signals which are generated from the phase comparator.
Abstract translation: 目的：提供具有相位插值功能的锁相环和锁相环中的相位插值方法，以产生频谱扩展时钟，通过使用具有相位插值函数的锁相环可以降低高频电磁干扰 。 构成：压控振荡器（110）以相同的相位间隔产生具有不同相位的多个输出时钟。 MUX（多路复用器）（120）从由压控振荡器产生的输出时钟中选择两个相邻时钟。 分频器（160）分别输入从MUX选择的时钟。 两相比较器（131,132）分别比较了两个时钟与来自外部的参考时钟。 两个电荷泵（141,142）根据从相位比较器产生的信号输出电流。
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公开(公告)号：KR101207072B1
公开(公告)日：2012-11-30
申请号：KR1020110014022
申请日：2011-02-17
Applicant: 성균관대학교산학협력단
Abstract: 본 발명에 따른 위상 보간 기능을 갖는 위상고정루프(100)는 동일한 위상 간격의 서로 다른 위상을 갖는 복수 개의 출력 클락(OUT_CLK)을 생성하는 전압 제어 발진기(VCO; 110), 전압 제어 발진기(VCO; 110)에서 생성되는 출력 클락(OUT_CLK) 중 인접한 2개의 클락을 선택하는 먹스(MUX; 120), 먹스(120)에서 선택된 클락이 각각 입력되는 주파수 분주기(DIV; 160), 분주된 2개의 클락(DIV_CLK 0, DIV_CLK 1)과 외부에서 들어온 기준 클락(REF_CLK)을 각각 비교하는 2개의 위상 비교기(PFD; 131, 132) 및 위상 비교기(131, 132)에서 출력되는 신호에 따라 전류가 출력되는 2개의 전하 펌프(141, 142)를 포함한다.
위상고정루프(100)에 복수 개의 전하 펌프(140)와 먹스(120)를 구비하여 별도의 위상 보간기 없이 위상고정루프 자체에서 클락의 위상 보간이 가능하다.
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