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公开(公告)号：KR101912537B1
公开(公告)日：2018-10-26
申请号：KR1020170095422
申请日：2017-07-27
Applicant: 주식회사 바이오알파 , (주)시지바이오 , 전북대학교산학협력단 , 재단법인 아산사회복지재단
IPC: A61F2/01 , A61B17/221
CPC classification number: A61F2/01 , A61B17/221 , A61F2/013 , A61F2002/011 , A61F2250/0096
Abstract: 혈전제거용스텐트에관한것이며, 혈전제거용스텐트는, 길이방향으로양단이개방된원통형구조를가지며, 혈전이위치한혈관벽으로확장되는몸체부; 및상기몸체부의길이방향일단에결합되고, 상기몸체부를통해상기길이방향일단측으로이동되는물질을선택적으로필터링하는필터부를포함하되, 상기필터부는상기혈전으로부터이탈되는미세혈전을수용하고상기미세혈전보다작은크기의물질을통과시키도록구비될수 있다.
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Patent Agency Ranking
公开(公告)号：KR100928245B1
公开(公告)日：2009-11-24
申请号：KR1020070074353
申请日：2007-07-25
Applicant: 고려대학교 산학협력단 , 전북대학교산학협력단
IPC: H03M1/12
Abstract: 본 발명은 연산증폭기를 공유하는 방식의 파이프라인 아날로그 디지털 변환기의 공유되는 연산 증폭기의 구성을 변경하도록 하여 메모리 효과를 제거한 아날로그 디지털 변환기에 관한 것으로, 이를 위하여 입력단을 복수로 구성한 연산 증폭기를 공유하도록 하고 사용되지 않는 입력단에는 공통 전압이 인가되도록 함으로써, 아날로그-디지털 변환기에서 발생하는 메모리 효과를 제거하여 정밀도를 높일 수 있는 효과가 있다. 또한, 동일한 공유 증폭기를 적용하더라도 해당 증폭기가 높은 수준의 증폭기가 요구되지 않는 스테이지에서는 낮은 증폭 기능을 가지는 연산 증폭기로 동작하도록 함으로써, 동일한 구성의 연산 증폭기를 모든 공유 스테이지들에 적용하더라도 전력 소모를 줄일 수 있는 효과가 있다.
OP AMP, 연산 증폭기, 공유 증폭기, 파이프라인 ADC, ADCAbstract translation: 本发明涉及一种模拟数字转换器，以除去记忆效应，从而改变了在管线模拟数字转换器的系统的共享共用运算放大器的运算放大器的结构中，以共享配置成输入多个向该运算放大器 公共电压施加到未使用的输入端子，从而消除了模数转换器中产生的存储效应，从而提高了准确度。 另外，即使施加在阶段相同的共享放大器，放大器不需要通过在具有低放大的运算放大器来操作所述放大器的高电平，它被施加到相同的配置的运算放大器的所有共享阶段，以减少功率消耗 可以有效。
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公开(公告)号：KR1020090011099A
公开(公告)日：2009-02-02
申请号：KR1020070074353
申请日：2007-07-25
Applicant: 고려대학교 산학협력단 , 전북대학교산학협력단
IPC: H03M1/12
CPC classification number: H03M1/0617 , H03M1/002 , H03M1/1009 , H03M1/122 , H03M1/14 , H03M2201/6107 , H03M2201/76
Abstract: An analog to digital converter removing a memory effect is provided to reduce power consumption by sharing an operational amplifier composed of a plurality of input terminals. A pipeline analog to digital has the multiple stages in which a sample mode and a hold mode are alternated. A folded-cascode amplifier including a cascode amplifier is applied in a pair of stages among the plurality of stages. In the pair of stages, the input terminal of the folded-cascode amplifier is connected when the state with high significance is in a hold mode and the input terminal of the cascode amplifier is connected when the stage with low significance is in the hold mode.
Abstract translation: 通过共享由多个输入端组成的运算放大器来提供消除存储器效应的模数转换器来降低功耗。 模拟到数字管线具有交替采样模式和保持模式的多个阶段。 包括共源共栅放大器的折叠共源共栅放大器被施加在多个级之间的一对级中。 在一对级中，当具有高有效性的状态处于保持模式时，折叠共源共栅放大器的输入端连接，并且当具有低重要性的级处于保持模式时，共源共栅放大器的输入端连接。
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公开(公告)号：KR1020090011094A
公开(公告)日：2009-02-02
申请号：KR1020070074345
申请日：2007-07-25
Applicant: 고려대학교 산학협력단 , 전북대학교산학협력단
IPC: G05F1/455
CPC classification number: G05F1/565 , H02M1/08 , H02M2001/0096
Abstract: A current source is provided to supply stable currents insensitively to environmental change while obtaining wide output ranges even at low power supply voltage, thereby preventing excessive power consumption. A voltage regulator determines an output voltage by using an input voltage. A plurality of transistors(40) is connected in parallel between the output terminal of the voltage regulator and a ground. A detecting unit(30) selects any one of the plurality of transistors on the basis of phase changes in the delayed clock. The selected transistor is operated.
Abstract translation: 提供电流源，即使在低电源电压下也能获得宽的输出范围，从而不利地提供稳定的电流，从而防止过大的功耗。 电压调节器通过使用输入电压来确定输出电压。 多个晶体管（40）并联连接在电压调节器的输出端和地之间。 检测单元（30）基于延迟时钟的相位变化来选择多个晶体管中的任一个。 所选晶体管工作。
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公开(公告)号：KR101778087B1
公开(公告)日：2017-09-13
申请号：KR1020160089012
申请日：2016-07-14
Applicant: 전북대학교산학협력단
CPC classification number: A61F2/852 , A61F2/844 , A61F2/94 , A61F2210/0004 , A61F2210/0014 , A61F2210/0061 , A61F2210/0076 , A61L31/022 , A61L31/04 , A61L31/148
Abstract: 본발명은동맥류치료용스텐트조립체에관한것으로서, 특히동맥류에공급되는혈액을차단하여동맥류를제거하도록하는동맥류치료용스텐트조립체에관한것이다. 본발명의동맥류치료용스텐트조립체는, 금속이루어지고중공형상을갖는스텐트부재와; 고분자나노섬유로이루어지고, 상기스텐트부재의내부에삽입배치되는중공형상의튜브부재와; 상기튜브부재의내부에삽입배치되어상기튜브부재를상기스텐트부재의내벽에가압밀착시키는가압부재;를포함하여이루어진것을특징으로한다.
Abstract translation: 本发明涉及一种支架组件，用于治疗动脉瘤涉及用于治疗动脉瘤的支架组件，特别是阻止的供血动脉瘤，以便除去动脉瘤。 本发明的用于治疗动脉瘤的支架组件包括：由金属制成并具有中空形状的支架构件; 由聚合物纳米纤维制成并插入并设置在支架构件内部的中空管构件; 并且挤压构件插入管构件中以将管构件压靠在支架构件的内壁上。
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公开(公告)号：KR100900083B1
公开(公告)日：2009-06-01
申请号：KR1020070074345
申请日：2007-07-25
Applicant: 고려대학교 산학협력단 , 전북대학교산학협력단
IPC: G05F1/455
Abstract: 본 발명은 공정, 전원 전압 및 온도의 변화에 둔감하고 출력 전압 범위가 넓은 저소비 전력 전류원에 관한 것으로, 이를 위하여 낮은 전원 전압에서도 넓은 출력 범위를 가지면서 외부 환경 변화에 둔감하게 안정적인 전류를 제공함과 아울러, 이러한 환경 변화에 대한 보상을 디지털 방식으로 처리하도록 하여 보상에 필요한 전력 소모를 최대한 억제하여 불필요한 설계 여유로 인한 과도한 전력 낭비를 방지할 수 있는 뛰어난 효과가 있다. 또한, 외부 환경 변화에 대한 변동이 큰 저항을 수동 소자가 아닌 특성이 상이한 복수의 트랜지스터 저항을 대신 적용하도록 하고, 외부 환경 변화를 디지털 검출을 통해 파악한 후 상기 트랜지스터 저항들 중 하나를 선택하는 방식으로 전류를 유지하도록 하여 안정적인 고정 전류를 제공할 수 있는 효과가 있다.
전류원, PVT, 지연, 트랜지스터 저항, MOS 저항
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