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    3.
    发明专利
    未知

    公开(公告)号：FR2536610A1

    公开(公告)日：1984-05-25

    申请号：FR8219562

    申请日：1982-11-23

    Applicant: CIT ALCATEL

    Inventor： LEVY MICHEL ,  SURIE SERGE

    IPC: H04L25/49 ,  H04L11/00 ,  H04Q3/02 ,  H04Q5/00

    Abstract: In a QPSK system using one cycle of a squared-off sinusoid per Baud period to represent the data dibits, the following are disclosed: (1) a direct detection circuit using samples taken only during the second and third quarters of the Baud period; (2) timing recovery by recognition of the opposite polarity of any QPSK signal compared to a half-Baud-delayed version of itself; and (3) an encoding scheme wherein only one of the two dibits is differentially encoded.

    Bit transfer unit for digital transmission system - wih memory and write and read control circuits
    4.
    发明专利
    Bit transfer unit for digital transmission system - wih memory and write and read control circuits 未知

    公开(公告)号：FR2304146A1

    公开(公告)日：1976-10-08

    申请号：FR7507646

    申请日：1975-03-12

    Applicant: CIT ALCATEL

    Inventor： VERNEZY JACQUES ,  SURIE SERGE

    IPC: H04J3/06 ,  H04Q11/04 ,  G11C19/14 ,  G08C19/28

    Abstract: The bit transfer unit, forming part of a digital transmission system, is used to transfer a group of bits from a first bit train to a second synchronous bit train. The group of bits are supplied to a memory (5) via a write control circuit (11) and output from the memory (5) via a read control circuit. The write control circuit (11) is associated with an adjustable register (10, 13), receiving information from the first train, and logic means (14, 17, 18), such that the recording of the information in the memory is displayed by the register for a fixed interval, to avoid recording of information simultaneous with a memory read-out operation.

    EGALISEUR AUTOMATIQUE POUR TRANSMISSION NUMERIQUE
    5.
    发明专利
    EGALISEUR AUTOMATIQUE POUR TRANSMISSION NUMERIQUE 未知

    公开(公告)号：CA1279380C

    公开(公告)日：1991-01-22

    申请号：CA562943

    申请日：1988-03-30

    Applicant: CIT ALCATEL

    Inventor： SURIE SERGE

    IPC: H04L25/03 ,  H04L25/04

    Abstract: Cet égaliseur automatique comporte un circuit de commande automatique de gain tendant à maintenir constante l'amplitude crête du signal égalisé ainsi qu'un réseau variable d'égalisation pourvu d'une commande permettant de modifier la pente de sa caractéristique de transfert de gain sans toucher à la valeur de son gain à la demi-fréquence Baud et un asservissement de mise en forme du spectre des fréquences qui contrôle cette commande et qui est constitué d'un circuit de détection de l'erreur moyenne de phase, par rapport aux milieux des intervalles Baud, des passages par zéro des traînes des impulsions apparaissant dans le signal de transmission numérique reçu et égalisé.

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