相位调整电路
    1.
    发明授权

    公开(公告)号:CN102318192B

    公开(公告)日:2013-11-20

    申请号:CN200980156476.1

    申请日:2009-07-14

    CPC classification number: H03L7/0814 H03L7/0996 H03L7/23

    Abstract: 本发明提供一种相位调整电路,在将2倍频率时钟进行二分频而得到占空比50%的时钟的相位调整电路中,第一具有相位反相功能的二分频电路(40),生成相位与相位基准时钟(1)和相位调整时钟(4)分离的中间基准时钟(6)。第一相位控制电路(60),相对于所述相位基准时钟(1),将所述中间基准时钟(6)的相位控制在所希望的相位状态。第二相位控制电路(70),相对于所述中间基准时钟(6),将所述相位调整时钟(4)的相位控制在所希望的相位状态。因此,在对相位基准时钟与作为二分频输出时钟的相位调整时钟进行相位比较来控制相位调整时钟的相位的情况下,即使当相位调整时钟被相位调整为相位基准时钟的接近相位时,该两时钟之间的相位差由于时钟抖动而发生变动,也能够正确且稳定地进行该相位差的判定。

    PLL老化电路以及半导体集成电路

    公开(公告)号:CN101573870A

    公开(公告)日:2009-11-04

    申请号:CN200780048484.5

    申请日:2007-12-20

    CPC classification number: H03L7/099 H03L7/0995

    Abstract: 本发明提供一种PLL老化电路以及半导体集成电路。在未内置环路滤波器的PLL中,使用较少的电路结构构成用于以适当的振荡频率对压控振荡器进行老化测试的附加电路。经由开关(12a)在压控振荡器(10)内的电压电流变换晶体管(11)的栅极端子上连接与晶体管(11)相同极性的进行了二极管连接的晶体管(13)的栅极,在晶体管(13)的漏极端子上连接电流源(14),适当地调整电流源(14)供给的电流值、晶体管(11)以及晶体管(13)的尺寸比,从而可以对压控振荡器(10)内的环形振荡器供给用于进行老化测试而所需的电流。

    PLL电路
    3.
    发明授权

    公开(公告)号:CN101361271B

    公开(公告)日:2012-07-25

    申请号:CN200780000773.8

    申请日:2007-03-29

    CPC classification number: H03L7/099 H03L7/0896 H03L7/18 H03L2207/06

    Abstract: 在PLL电路中,在电压控制振荡器4中具有2个电压电流转换电路(40、41)、和选择这些电压电流转换电路(40、41)的任一个的输出的选择电路(42)。由选择电路(42)所选择的一个电压电流转换电路的输出被输入到电流控制振荡器(45)。一个电压电流转换电路(41)的输入端与环路滤波器(3)的输出端相连接,另一个电压电流转换电路(40)的输入端与电压控制振荡器(4)的振荡特性评价用的输入端子(8)相连接。因此,能够有效地抑制由将用于评价电压控制振荡器的振荡特性的输入端子经由开关与环路滤波器相连接的结构而产生的环路滤波器的电压的时间变化和PLL电路的输出频率的时间变化。

    PLL电路
    6.
    发明公开

    公开(公告)号:CN101361271A

    公开(公告)日:2009-02-04

    申请号:CN200780000773.8

    申请日:2007-03-29

    CPC classification number: H03L7/099 H03L7/0896 H03L7/18 H03L2207/06

    Abstract: 在PLL电路中,在电压控制振荡器4中具有2个电压电流转换电路(40、41)、和选择这些电压电流转换电路(40、41)的任一个的输出的选择电路(42)。由选择电路(42)所选择的一个电压电流转换电路的输出被输入到电流控制振荡器(45)。一个电压电流转换电路(41)的输入端与环路滤波器(3)的输出端相连接,另一个电压电流转换电路(40)的输入端与电压控制振荡器(4)的振荡特性评价用的输入端子(8)相连接。因此,能够有效地抑制由将用于评价电压控制振荡器的振荡特性的输入端子经由开关与环路滤波器相连接的结构而产生的环路滤波器的电压的时间变化和PLL电路的输出频率的时间变化。

    PLL老化电路以及半导体集成电路

    公开(公告)号:CN101573870B

    公开(公告)日:2011-12-21

    申请号:CN200780048484.5

    申请日:2007-12-20

    CPC classification number: H03L7/099 H03L7/0995

    Abstract: 本发明提供一种PLL老化电路以及半导体集成电路。在未内置环路滤波器的PLL中,使用较少的电路结构构成用于以适当的振荡频率对压控振荡器进行老化测试的附加电路。经由开关(12a)在压控振荡器(10)内的电压电流变换晶体管(11)的栅极端子上连接与晶体管(11)相同极性的进行了二极管连接的晶体管(13)的栅极,在晶体管(13)的漏极端子上连接电流源(14),适当地调整电流源(14)供给的电流值、晶体管(11)以及晶体管(13)的尺寸比,从而可以对压控振荡器(10)内的环形振荡器供给用于进行老化测试而所需的电流。

    相位调整电路
    9.
    发明公开

    公开(公告)号:CN102318192A

    公开(公告)日:2012-01-11

    申请号:CN200980156476.1

    申请日:2009-07-14

    CPC classification number: H03L7/0814 H03L7/0996 H03L7/23

    Abstract: 本发明提供一种相位调整电路,在将2倍频率时钟进行二分频而得到占空比50%的时钟的相位调整电路中,具有第一相位反相功能的二分频电路(40),生成相位与相位基准时钟(1)和相位调整时钟(4)分离的中间基准时钟(6)。第一相位控制电路(60),相对于所述相位基准时钟(1),将所述中间基准时钟(6)的相位控制在所希望的相位状态。第二相位控制电路(70),相对于所述中间基准时钟(6),将所述相位调整时钟(4)的相位控制在所希望的相位状态。因此,在对相位基准时钟与作为二分频输出时钟的相位调整时钟进行相位比较来控制相位调整时钟的相位的情况下,即使当相位调整时钟被相位调整为相位基准时钟的接近相位时,该两时钟之间的相位差由于时钟抖动而发生变动,也能够正确且稳定地进行该相位差的判定。

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