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公开(公告)号：CN110032708B
公开(公告)日：2024-11-08
申请号：CN201910016966.7
申请日：2019-01-08
Applicant: 三星电子株式会社
Inventor： 克里希纳·T·马拉迪 , 谷芃 , 郑宏忠 , 罗伯特·瑞南
IPC: G06F17/15 , G06N3/0464 , G06N3/063
Abstract: 本发明涉及一种使用查找表的计算加速器。所述加速器可通过从查找表检索两个浮点操作数的乘积的小数部分或通过从查找表检索两个浮点操作数的乘积来加速浮点乘法，或者所述加速器可从查找表检索浮点向量的点积。所述加速器可实施在三维存储总成中。所述加速器可使用近似法、乘法查找表的对称性及零跳过来改善性能。也提供计算乘积的方法及系统和计算点积及计算卷积的方法。
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公开(公告)号：CN109508307B
公开(公告)日：2024-01-05
申请号：CN201810945829.7
申请日：2018-08-16
Applicant: 三星电子株式会社
Inventor： 克里希纳·T·马拉迪 , 郑宏忠 , 罗伯特·瑞南
IPC: G06F13/16
Abstract: 本发明提供一种高带宽存储(HBM)系统，包含高带宽存储装置和逻辑电路。逻辑电路从主机装置接收第一命令且将接收到的第一命令转换成通过第二接口发送到高带宽存储装置的存储器内处理(PIM)命令。从主机装置接收到第一命令时与高带宽存储系统准备好从主机装置接收另一命令时之间的时间是确定性的。逻辑电路还从主机装置接收第四命令和第五命令。第五命令请求时间估计信息，所述时间估计信息和接收到第五命令时与高带宽存储系统准备好从主机装置接收另一命令时之间的时间相关。时间估计信息包含确定性时间段和非确定性时间段的估计时间段。
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公开(公告)号：CN110362515B
公开(公告)日：2024-11-26
申请号：CN201910223119.8
申请日：2019-03-22
Applicant: 三星电子株式会社
Abstract: 本发明的实施例包括一种驱动器至驱动器存储系统，所述驱动器至驱动器存储系统包括：主机服务器，具有主机中央处理器及主机存储驱动器；一个或多个远程存储驱动器；以及对等链路，将所述主机存储驱动器连接到所述一个或多个远程存储驱动器。所述主机存储驱动器包括处理器及存储器，其中所述存储器上存储有指令，所述指令在由所述处理器执行时使所述处理器在所述主机中央处理器发出写入命令时将数据从所述主机存储驱动器经由所述对等链路传送到所述一个或多个远程存储驱动器。也提供一种主机存储驱动器和一种存储数据的方法。
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Patent Agency Ranking
公开(公告)号：CN109388595B
公开(公告)日：2023-12-01
申请号：CN201810903592.6
申请日：2018-08-09
Applicant: 三星电子株式会社
Inventor： 郑宏忠 , 罗伯特·瑞南 , 金晋贤 , 金亨硕 , 克里希纳·特佳·马拉迪
IPC: G06F13/16
Abstract: 本发明公开一种高带宽存储器系统以及一种逻辑管芯。所述高带宽存储器系统包括：主机，其包括中央处理单元、图形处理单元、专用集成电路或现场可编程门阵列中的至少一个；以及包括一个配置在另一个上方的多个高带宽存储器模块及配置在多个高带宽存储器模块下方的逻辑管芯的高带宽存储器堆叠。逻辑管芯配置成从主机卸载处理操作。本发明公开一种在高带宽存储器的逻辑管芯中提供特定计算能力的系统架构，以及支持硬件及软件架构、逻辑管芯微架构以及存储器接口信令选项。提供使用高带宽存储器堆叠下方的逻辑管芯的存储器内处理能力的各种新方法。另外，本发明公开各种新的信令协议以使用高带宽存储器接口。还描述逻辑管芯微架构及支持系统框架。
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公开(公告)号：CN109388595A
公开(公告)日：2019-02-26
申请号：CN201810903592.6
申请日：2018-08-09
Applicant: 三星电子株式会社
Inventor： 郑宏忠 , 罗伯特·瑞南 , 金晋贤 , 金亨硕 , 克里希纳·特佳·马拉迪
IPC: G06F13/16
Abstract: 本发明公开一种高带宽存储器系统以及一种逻辑管芯。所述高带宽存储器系统包括：主机，其包括中央处理单元、图形处理单元、专用集成电路或现场可编程门阵列中的至少一个；以及包括一个配置在另一个上方的多个高带宽存储器模块及配置在多个高带宽存储器模块下方的逻辑管芯的高带宽存储器堆叠。逻辑管芯配置成从主机卸载处理操作。本发明公开一种在高带宽存储器的逻辑管芯中提供特定计算能力的系统架构，以及支持硬件及软件架构、逻辑管芯微架构以及存储器接口信令选项。提供使用高带宽存储器堆叠下方的逻辑管芯的存储器内处理能力的各种新方法。另外，本发明公开各种新的信令协议以使用高带宽存储器接口。还描述逻辑管芯微架构及支持系统框架。
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公开(公告)号：CN110362515A
公开(公告)日：2019-10-22
申请号：CN201910223119.8
申请日：2019-03-22
Applicant: 三星电子株式会社
Abstract: 本发明的实施例包括一种驱动器至驱动器存储系统，所述驱动器至驱动器存储系统包括：主机服务器，具有主机中央处理器及主机存储驱动器；一个或多个远程存储驱动器；以及对等链路，将所述主机存储驱动器连接到所述一个或多个远程存储驱动器。所述主机存储驱动器包括处理器及存储器，其中所述存储器上存储有指令，所述指令在由所述处理器执行时使所述处理器在所述主机中央处理器发出写入命令时将数据从所述主机存储驱动器经由所述对等链路传送到所述一个或多个远程存储驱动器。也提供一种主机存储驱动器和一种存储数据的方法。
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公开(公告)号：CN110032708A
公开(公告)日：2019-07-19
申请号：CN201910016966.7
申请日：2019-01-08
Applicant: 三星电子株式会社
Inventor： 克里希纳·T·马拉迪 , 谷芃 , 郑宏忠 , 罗伯特·瑞南
Abstract: 本发明涉及一种使用查找表的计算加速器。所述加速器可通过从查找表检索两个浮点操作数的乘积的小数部分或通过从查找表检索两个浮点操作数的乘积来加速浮点乘法，或者所述加速器可从查找表检索浮点向量的点积。所述加速器可实施在三维存储总成中。所述加速器可使用近似法、乘法查找表的对称性及零跳过来改善性能。也提供计算乘积的方法及系统和计算点积及计算卷积的方法。
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公开(公告)号：CN109508307A
公开(公告)日：2019-03-22
申请号：CN201810945829.7
申请日：2018-08-16
Applicant: 三星电子株式会社
Inventor： 克里希纳·T·马拉迪 , 郑宏忠 , 罗伯特·瑞南
IPC: G06F13/16
Abstract: 本发明提供一种高带宽存储(HBM)系统，包含高带宽存储装置和逻辑电路。逻辑电路从主机装置接收第一命令且将接收到的第一命令转换成通过第二接口发送到高带宽存储装置的存储器内处理(PIM)命令。从主机装置接收到第一命令时与高带宽存储系统准备好从主机装置接收另一命令时之间的时间是确定性的。逻辑电路还从主机装置接收第四命令和第五命令。第五命令请求时间估计信息，所述时间估计信息和接收到第五命令时与高带宽存储系统准备好从主机装置接收另一命令时之间的时间相关。时间估计信息包含确定性时间段和非确定性时间段的估计时间段。
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