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公开(公告)号：CN1439197A
公开(公告)日：2003-08-27
申请号：CN01807370.0
申请日：2001-03-27
Applicant: 松下电器产业株式会社
IPC: H03M13/37
CPC classification number: H03M13/1555 , H03M13/15 , H03M13/1515 , H03M13/1535 , H03M13/37
Abstract: 防止在对扩大里德—索罗门码解码时误纠错。包括从输入数据计算输入数据故障位以及从根据输入数据所求出的第1纠错数据计算纠错数据故障位的故障位计算部、输出根据输入数据故障位的误码评价多项式以及误码位置多项式的各次数的系数和误码大小的评价多项式·位置多项式导出部、输出误码位置多项式的根的钱氏搜索部、将输入数据中存在误码时对输入数据进行了纠错处理的数据和不存在误码时的输入数据作为第1纠错数据输出并且将第1纠错数据中存在误码时对进行复原后获得的输入数据和不存在误码时的第1纠错数据作为第2纠错数据输出的纠错部。
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公开(公告)号：CN1263383A
公开(公告)日：2000-08-16
申请号：CN99124966.6
申请日：1999-12-10
Applicant: 松下电器产业株式会社
Inventor： 福冈俊彦
IPC: H03M13/00
CPC classification number: H03M13/1535 , H03M13/1515
Abstract: 本发明提供一种里德－索洛蒙解码装置,包括监视超过纠错能力的错误的发生和纠错的程度的装置。里德－索洛蒙解码装置包括里德－索洛蒙解码器1和纠错状态监视器2。纠错状态监视器2检测出里德－索洛蒙解码器1内的欧几里德互除计算器4和链检索器5的处理错误的有无,生成表示输入数据的错误程度的信号。
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公开(公告)号：CN100539576C
公开(公告)日：2009-09-09
申请号：CN200480019206.3
申请日：2004-07-09
Applicant: 松下电器产业株式会社
IPC: H04L29/02
CPC classification number: H04L12/2801 , H04L29/06027
Abstract: 在通信系统的终端装置1中，设置了MAC部3(双向通信装置)、物理层部4、调谐器5以及背端部7。MAC部3中，包括：具有取代CPU15的一部分处理的功能的下行流数据处理块11、具有取代CPU15的一部分处理的功能的上行流数据处理块12、总线数据调停处理块13、CPU总线14、CPU15以及存储装置16。下行流数据处理块11和上行流数据处理块12构成为：对CPU总线14旁路，直接进行数据的接收、发送。
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公开(公告)号：CN1531211A
公开(公告)日：2004-09-22
申请号：CN200310120194.0
申请日：2003-12-10
Applicant: 松下电器产业株式会社
CPC classification number: H03M13/155 , H03M13/1515 , H03M13/1535 , H03M13/1545 , H03M13/1585
Abstract: 本发明提供一种里德索洛蒙码或扩展里德索洛蒙码的译码方法和译码器。比较由错误个数推测部(60)从输入数据校正子(SI)推测的错误个数(EN1)和在译码过程中由错误个数计算部(70)计算出的错误个数(EN2)，根据该比较结果和输入数据校正子(SI)，由纠错部(40)进行纠错处理后，对于被纠错的数据(C1)，由校正子计算部(10)再度进行校正子计算，求出订正数据校正子，当进行了误订正时或推测的错误个数(EN1)和计算的错误个数(EN2)不同时，把输入数据(DI)作为第二订正数据(C2)输出。当对扩展里德索洛蒙码进行译码时，有时对于非扩展成分和扩展成分进行了误订正，此外，当错误个数的推测错误时，有时进行多次的欧几里德算法运算处理和多次钱搜索处理。
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公开(公告)号：CN1164039C
公开(公告)日：2004-08-25
申请号：CN99107139.5
申请日：1999-06-02
Applicant: 松下电器产业株式会社
Inventor： 福冈俊彦
IPC: H03M13/00
CPC classification number: H03M13/151
Abstract: 提供了能对应于原始多项式、生成多项式和误差校正数的变化来进行里德-所罗门编码的里德-所罗门编码装置和编码方法。此装置具备有：生成多项式系数生成块1，它输入原始多项式设定值4和生成初始值3，用它们展开生成多项式而求得系数数据8；数据编码块2，它输入原始多项式设定值4，应用它由生成多项式来除信息多项式以进行数据编码。
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Patent Agency Ranking
公开(公告)号：CN1144374C
公开(公告)日：2004-03-31
申请号：CN99124966.6
申请日：1999-12-10
Applicant: 松下电器产业株式会社
Inventor： 福冈俊彦
IPC: H03M13/00
CPC classification number: H03M13/1535 , H03M13/1515
Abstract: 本发明提供一种里德-索洛蒙解码装置，包括监视超过纠错能力的错误的发生和纠错的程度的装置。里德-索洛蒙解码装置包括里德-索洛蒙解码器(1)和纠错状态监视器(2)。纠错状态监视器(2)检测出里德-索洛蒙解码器(1)内的欧几里德互除计算器(4)和链检索器(5)的处理错误的有无，生成表示输入数据的错误程度的信号。
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公开(公告)号：CN100553190C
公开(公告)日：2009-10-21
申请号：CN03803955.9
申请日：2003-04-16
Applicant: 松下电器产业株式会社
CPC classification number: H04N7/17309 , H04L12/2801 , H04N7/1675 , H04N21/42676 , H04N21/4353 , H04N21/4355 , H04N21/4402 , H04N21/4405 , H04N21/6168 , H04N21/643
Abstract: 本发明涉及数字双向通信控制装置及方法，其中，接口部分(11)对被输入的下行流数据(STRM)进行格式变换。CPU(12)接收被格式变换了的数据(DIF)，实现MAC功能的。另外TEK处理部分(13)接收从数据(DIF)所得到的TEK处理数据(DTEK)，进行该数据结构的解析，根据该解析的结果，进行解密处理。
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公开(公告)号：CN1817018A
公开(公告)日：2006-08-09
申请号：CN200480019206.3
申请日：2004-07-09
Applicant: 松下电器产业株式会社
IPC: H04L29/02
CPC classification number: H04L12/2801 , H04L29/06027
Abstract: 在通信系统的终端装置1中，设置了MAC部3(双向通信装置)、物理层部4、调谐器5以及背端部7。MAC部3中，包括：具有取代CPU15的一部分处理的功能的下行流数据处理块11、具有取代CPU15的一部分处理的功能的上行流数据处理块12、总线数据调停处理块13、CPU总线14、CPU15以及存储装置16。下行流数据处理块11和上行流数据处理块12构成为：对CPU总线14旁路，直接进行数据的接收、发送。
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公开(公告)号：CN1194474C
公开(公告)日：2005-03-23
申请号：CN02102380.8
申请日：2002-01-22
Applicant: 松下电器产业株式会社
IPC: H03M13/00
Abstract: 一种错误及同步的检出装置，利用数据排列替换单元1将7比特单位的字节数据替换为以8比特为1字节的字节数据。其后，始终使用该8比特单位的字节数据，并将该各字节数据存储在由RAM构成的数据存储单元3中。奇偶校验单元2接收来自数据排列替换单元1的字节数据和来自数据存储单元3的已延迟1496个时钟的各字节数据，进行各字节数据的同步检出运算及奇偶校验运算。因此，通过字节/字节变换处理，就不需要并行/串行变换电路及串行/并行变换电路。因为使用RAM来存储各字节数据，所以不需要1496段的延迟器。
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公开(公告)号：CN1238604A
公开(公告)日：1999-12-15
申请号：CN99107139.5
申请日：1999-06-02
Applicant: 松下电器产业株式会社
Inventor： 福冈俊彦
IPC: H03M13/02
CPC classification number: H03M13/151
Abstract: 提供了能对应于原始多项式、生成多项式和误差校正数的变化来进行里德－所罗门编码的里德－所罗门编码装置和编码方法。此装置具备有：生成多项式系数生成块1，它输入原始多项式设定值4和生成初始值3，用它们展开生成多项式而求得系数数据8；数据编码块2，它输入原始多项式设定值4，应用它由生成多项式来除信息多项式以进行数据编码。
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