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公开(公告)号：CN117472838B
公开(公告)日：2024-03-15
申请号：CN202311830283.8
申请日：2023-12-28
Applicant: 苏州元脑智能科技有限公司
Abstract: 本发明提供一种高速串行计算机扩展总线设备识别方法、装置及相关设备，涉及可编程逻辑器件技术领域，通过创建物理功能哈希表和虚拟功能哈希表；接收上位机发送的设备基地址空间访问请求信息；根据待访问设备的基地址寄存器空间地址并行进行哈希密钥计算生成物理功能哈希密钥和虚拟功能哈希密钥；并行查找所述物理功能哈希表和虚拟功能哈希表，获取待访问高速串行计算机扩展总线设备的标识信息，通过并行运算、并行查表，在高密度设备场景下能够快速完成BAR空间访问请求的目标匹配，减少匹配时间；通过分别设计物理功能哈希和虚拟功能哈希表，使虚拟功能基地址BAR空间大小摆脱物理功能基地址BAR空间大小限制，提高设备设计的灵活性。
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公开(公告)号：CN117472637B
公开(公告)日：2024-02-23
申请号：CN202311813316.8
申请日：2023-12-27
Applicant: 苏州元脑智能科技有限公司
IPC: G06F11/07
Abstract: 本发明涉及通信数据处理技术领域，公开了一种中断管理方法、系统、设备及介质。方法包括：根据当前时钟周期内接收到的内核单元发送的若干中断请求，基于中断识别逻辑模块确定发送中断请求的当前中断数量以及各中断请求对应的当前中断编号；将当前中断数量和各当前中断编号分别缓存至中断数量缓存模块和中断编号缓存模块；若检测到中断数量缓存模块非空，通过中断逻辑生成模块从中断数量缓存模块中读取当前中断数量，并基于当前中断数量依次从中断编号缓存模块中读取各当前中断编号；基于读取到的各当前中断编号和中断信息表生成中断消息。通过本发明的方案，有效避免了内核中断瓶颈的问题，提高内核工作效率。
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公开(公告)号：CN117312233B
公开(公告)日：2024-02-23
申请号：CN202311599266.8
申请日：2023-11-28
Applicant: 苏州元脑智能科技有限公司
Abstract: 本申请公开了一种现场可编程逻辑门阵列芯片、及其构建方法及加速器设备，涉及计算机技术领域，该现场可编程逻辑门阵列芯片包括依次连接的应用程序逻辑模块层、动态平台组件层和静态平台组件层；静态平台组件层包括与加速器设备的特性相关且不存在更新需求的第一功能组件；第一功能组件从加速器设备的闪存或只读存储器芯片加载；动态平台组件层包括动态添加或更新的与加速器设备的特性相关的第二功能组件、动态添加的多个应用程序共享的第二处理模块；第二功能组件和第二处理模块从主机配置；应用程序逻辑模块层包括动态添加的与单一应用程序相关的第一处理模块；第一处理模块从主机配置。本申请提高了现场可编程逻辑门阵列芯片的灵活性。
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公开(公告)号：CN117234742B
公开(公告)日：2024-02-09
申请号：CN202311515313.6
申请日：2023-11-14
Applicant: 苏州元脑智能科技有限公司
IPC: G06F9/50
Abstract: 本申请实施例涉及云服务技术领域，具体涉及一种处理器核心分配方法、装置、设备及存储介质，旨在提升云环境中处理器核心的利用率。所述方法包括：在服务器中创建第二虚拟机，第二虚拟机为高优先级虚拟机；将对应的数量的处理器核心分配至第二虚拟机，处理器核心是从预先创建的第一虚拟机中取出的，第一虚拟机为低优先级虚拟机；监控第二虚拟机在预设的运行周期数中的每个运行周期的实际使用的处理器核心的数量；根据实际使用的处理器核心的数量，对第二虚拟机在后续运行周期中的处理器核心的使用数量进行预测，得到后续运行周期中实际使用的处理器核心的数量的预测值；在后续运行周期中为第二虚拟机分配对应数量的处理器核心。
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公开(公告)号：CN118740760B
公开(公告)日：2024-12-27
申请号：CN202411203709.1
申请日：2024-08-29
Applicant: 苏州元脑智能科技有限公司
IPC: H04L47/6295
Abstract: 本发明实施例提供了一种数据传输方法、设备、介质及计算机程序产品，包括：在检测到接收数据传输请求的情况下，创建数据传输请求对象；基于所述数据传输请求对象确定待分配虚拟队列数目；基于所述待分配虚拟队列数目确定目标虚拟队列，以及，每个所述目标虚拟队列对应的数据传输量；基于所述数据传输量配置每个所述目标虚拟队列的数据传输信息，并通过所述目标虚拟队列对所述数据传输信息进行并行传输。本发明实施例通过多Virtqueue队列并行传输数据，有效地提高了主机和硬件加速器间的数据传输带宽，使的应用加速效果明显。
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Patent Agency Ranking
公开(公告)号：CN118897818A
公开(公告)日：2024-11-05
申请号：CN202411357314.7
申请日：2024-09-27
Applicant: 苏州元脑智能科技有限公司
Abstract: 本发明提供一种加速器设备及其实现方法、电子设备和存储介质，涉及加速器技术领域，该加速器设备的静态区包括物理功能、多个虚拟功能、虚拟功能状态信息表、加速单元状态信息表、映射表和加速单元配置表；动态区包括多个加速单元；虚拟功能状态信息表存放各虚拟功能的状态信息；加速单元状态信息表存放各加速单元的状态信息；物理功能用于基于虚拟功能状态信息表和加速单元状态信息表，将映射表配置为存放目标虚拟功能与多个目标加速单元之间的映射关系，将加速单元配置表配置为存放各目标加速单元的信息；将目标虚拟功能分配给目标虚拟机，可以提升加速器设备架构的灵活性，支持一个虚拟功能与多个加速单元绑定，从而提升加速效率和加速效果。
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公开(公告)号：CN118364513B
公开(公告)日：2024-10-01
申请号：CN202410782969.2
申请日：2024-06-18
Applicant: 苏州元脑智能科技有限公司
Abstract: 本申请涉及加密计算领域，公开了一种跨平台同态加密软件库架构、计算装置及开发方法。该架构包括：程序接口层、平台功能抽象层及具体平台功能实现层；平台功能抽象层部署在程序接口层与具体平台功能实现层之间；程序接口层是采用面向对象的设计方法构建的，被配置为向主机端程序提供多个同态加密方案的API接口；平台功能抽象层，被配置为对不同硬件加速器的编程框架进行抽象，并向程序接口层提供处理函数类的接口；具体平台功能实现层，被配置为基于同态加密软件库，向处理函数类的接口提供基于不同编程框架运行的处理函数。采用该软件架构能够使同态加密软件库跨硬件加速平台适配主机端程序，提升开发者的开发效率，降低开发成本。
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公开(公告)号：CN118364513A
公开(公告)日：2024-07-19
申请号：CN202410782969.2
申请日：2024-06-18
Applicant: 苏州元脑智能科技有限公司
Abstract: 本申请涉及加密计算领域，公开了一种跨平台同态加密软件库架构、计算装置及开发方法。该架构包括：程序接口层、平台功能抽象层及具体平台功能实现层；平台功能抽象层部署在程序接口层与具体平台功能实现层之间；程序接口层是采用面向对象的设计方法构建的，被配置为向主机端程序提供多个同态加密方案的API接口；平台功能抽象层，被配置为对不同硬件加速器的编程框架进行抽象，并向程序接口层提供处理函数类的接口；具体平台功能实现层，被配置为基于同态加密软件库，向处理函数类的接口提供基于不同编程框架运行的处理函数。采用该软件架构能够使同态加密软件库跨硬件加速平台适配主机端程序，提升开发者的开发效率，降低开发成本。
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公开(公告)号：CN117411842B
公开(公告)日：2024-02-27
申请号：CN202311708824.X
申请日：2023-12-13
Applicant: 苏州元脑智能科技有限公司
IPC: H04L49/901 , H04L47/62 , H04L47/6295
Abstract: 本发明涉及数据传输技术领域，公开了事件抑制方法、装置、设备、异构平台及存储介质，该方法包括：对描述符队列中的当前写位置执行写操作；读取事件抑制信息中的第一事件抑制项；由第二设备配置第一事件抑制项中的第一事件抑制条件；第一事件抑制条件表示描述符队列中允许第一设备发起第一事件的写位置；在第一事件抑制项表示抑制第一事件的情况下，若当前写位置与第一事件抑制条件相匹配，向第二设备发起第一事件。本发明基于该第一事件抑制条件能够实现对第一事件的抑制，有效避免因向第二设备插入过多的第一事件而影响第二设备的逻辑资源或线程资源；并且，不需要多次轮询，能够有
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公开(公告)号：CN117234742A
公开(公告)日：2023-12-15
申请号：CN202311515313.6
申请日：2023-11-14
Applicant: 苏州元脑智能科技有限公司
IPC: G06F9/50
Abstract: 本申请实施例涉及云服务技术领域，具体涉及一种处理器核心分配方法、装置、设备及存储介质，旨在提升云环境中处理器核心的利用率。所述方法包括：在服务器中创建第二虚拟机，第二虚拟机为高优先级虚拟机；将对应的数量的处理器核心分配至第二虚拟机，处理器核心是从预先创建的第一虚拟机中取出的，第一虚拟机为低优先级虚拟机；监控第二虚拟机在预设的运行周期数中的每个运行周期的实际使用的处理器核心的数量；根据实际使用的处理器核心的数量，对第二虚拟机在后续运行周期中的处理器核心的使用数量进行预测，得到后续运行周期中实际使用的处理器核心的数量的预测值；在后续运行周期中为第二虚拟机分配对应数量的处理器核心。
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