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公开(公告)号：CN104246745B
公开(公告)日：2017-05-24
申请号：CN201180076121.9
申请日：2011-12-29
Applicant: 英特尔公司
Inventor： G·玛格里斯 , J·M·康迪那 , C·B·兹尔斯 , M·奈利 , S·萨姆德若拉 , A·马丁内斯文森特 , P·谢卡拉科斯 , F·J·桑切斯 , M·卢彭 , G·突纳韦迪斯 , E·吉博特康迪那 , C·戈梅兹瑞克纳 , A·冈萨雷斯 , M·休塞诺瓦 , C·E·科特赛立迪斯 , F·拉托瑞 , P·洛佩茨 , C·玛德瑞尔斯吉梅诺 , P·马库罗 , R·马丁内斯 , D·奥特加 , D·帕弗洛 , K·A·斯塔弗洛
CPC classification number: G06F9/3001 , G06F9/30032 , G06F9/30087 , G06F9/30094 , G06F9/30101 , G06F9/3842
Abstract: 公开了一种通常涉及控制多媒体扩展控制及状态寄存器(MXCSR)的装置及方法。处理器核可以包括执行运算功能的浮点单元(FPU)；以及向所述FPU提供控制位的多媒体扩展控制寄存器(MXCR)。进一步地，优化器可以用来基于指令从多个推测性多媒体扩展状态寄存器(SPEC_MXSR)中选择推测性多媒体扩展状态寄存器SPEC_MXSR，以更新多媒体扩展状态寄存器(MXSR)。
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公开(公告)号：CN104011669A
公开(公告)日：2014-08-27
申请号：CN201180075833.9
申请日：2011-12-22
Applicant: 英特尔公司
Inventor： E·G·康迪那 , J·M·康迪那 , F·拉托瑞 , P·马库罗 , P·洛佩茨 , C·戈梅兹瑞克纳 , A·冈萨雷斯 , M·休塞诺瓦 , C·E·科特赛立迪斯 , M·卢彭 , C·M·吉梅诺 , G·玛格里斯 , A·M·文森特 , R·马丁内斯 , D·奥特加 , D·帕弗洛 , K·A·斯塔弗洛 , G·突纳韦迪斯 , P·谢卡拉科斯
IPC: G06F9/30
CPC classification number: G06F9/30145 , G06F9/30087 , G06F9/30185 , G06F9/3842 , G06F9/3857 , G06F9/3863
Abstract: 用于确定是否要执行提交动作的处理器的技术和机制。在实施例中，处理器执行多项操作以确定提交指令是否用于提交动作的有条件执行。在另一个实施例中，响应于确定该提交指令用于该提交动作的有条件执行，对处理器状态的一个或多个条件进行评价，其中执行该评价以确定是否要执行该提交指令所指示的提交动作。
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公开(公告)号：CN104321741B
公开(公告)日：2018-03-30
申请号：CN201380028676.5
申请日：2013-06-19
Applicant: 英特尔公司
CPC classification number: G06F7/4876 , G06F7/483 , G06F7/485 , G06F7/4991 , G06F7/49915 , G06F7/5443 , G06F2207/4802
Abstract: 公开了将双舍入组合浮点乘法和加法功能作为标量或向量SIMD指令或融合的微操作来提供的方法、装置、指令和逻辑。实施例包括检测浮点(FP)乘法操作和将FP乘法的结果指定为源操作数的后续的FP操作。FP乘法和后续的FP操作被编码为组合FP操作，包括对FP乘法的结果的舍入和随后的后续的FP操作。所述组合的FP操作的编码可被存储并利用融合的乘法－加法硬件来执行以作为可执行线程部分的一部分，该融合的乘法－加法硬件包括对FP乘法器的乘积的溢出检测、用于基于FP乘法器的乘积中存在溢出或无溢出而利用不同的舍入输入将第三操作数加数尾数与FP乘法器的乘积相加的第一和第二FP加法器。分别利用溢出检测来选择最终结果。
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公开(公告)号：CN104220980B
公开(公告)日：2018-01-19
申请号：CN201180076122.3
申请日：2011-12-29
Applicant: 英特尔公司
Inventor： K·A·斯塔弗洛 , E·吉博特康迪那 , J·M·康迪那 , C·戈梅兹瑞克纳 , A·冈萨雷斯 , M·休塞诺瓦 , C·E·科特赛立迪斯 , F·拉托瑞 , P·洛佩茨 , M·卢彭 , C·玛德里斯 , G·玛格里斯 , P·马库罗 , A·马丁内斯文森特 , R·马丁内斯 , D·奥特加 , D·帕弗洛 , G·突纳韦迪斯 , P·谢卡拉科斯
CPC classification number: G06F9/3804 , G06F9/30047 , G06F9/3017 , G06F9/3802 , G06F9/3806 , G06F9/3848 , G06F12/0862 , G06F2212/452
Abstract: 公开了一种用于管理从指令缓存中指令缓存预取的设备和方法。处理器可以包括：预取引擎；分支预测引擎，用于预测分支的结果；以及动态优化器。动态优化器可以用于控制：识别常见指令缓存未命中；以及将预取指令从预取引擎插入到指令缓存。
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公开(公告)号：CN104321741A
公开(公告)日：2015-01-28
申请号：CN201380028676.5
申请日：2013-06-19
Applicant: 英特尔公司
CPC classification number: G06F7/4876 , G06F7/483 , G06F7/485 , G06F7/4991 , G06F7/49915 , G06F7/5443 , G06F2207/4802
Abstract: 公开了将双舍入组合浮点乘法和加法功能作为标量或向量SIMD指令或融合的微操作来提供的方法、装置、指令和逻辑。实施例包括检测浮点(FP)乘法操作和将FP乘法的结果指定为源操作数的后续的FP操作。FP乘法和后续的FP操作被编码为组合FP操作，包括对FP乘法的结果的舍入和随后的后续的FP操作。所述组合的FP操作的编码可被存储并利用融合的乘法－加法硬件来执行以作为可执行线程部分的一部分，该融合的乘法－加法硬件包括对FP乘法器的乘积的溢出检测、用于基于FP乘法器的乘积中存在溢出或无溢出而利用不同的舍入输入将第三操作数加数尾数与FP乘法器的乘积相加的第一和第二FP加法器。分别利用溢出检测来选择最终结果。
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Patent Agency Ranking
公开(公告)号：CN101036120A
公开(公告)日：2007-09-12
申请号：CN200580033614.9
申请日：2005-11-14
Applicant: 英特尔公司
CPC classification number: G06F1/06 , G06F1/3203 , G06F1/324 , G06F1/3296 , G06F9/3869 , Y02D10/126 , Y02D10/172
Abstract: 一种用于缩放至少一个微处理器的时钟域的频率和操作电压的方法和装置。尤其，本发明涉及把微处理器划分成时钟域和单独控制每个时钟域的频率和操作电压的技术。
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公开(公告)号：CN107092466B
公开(公告)日：2020-12-08
申请号：CN201710265267.7
申请日：2011-12-29
Applicant: 英特尔公司
Inventor： G·玛格里斯 , J·M·康迪那 , C·B·兹尔斯 , M·奈利 , S·萨姆德若拉 , A·马丁内斯文森特 , P·谢卡拉科斯 , F·J·桑切斯 , M·卢彭 , G·突纳韦迪斯 , E·吉博特康迪那 , C·戈梅兹瑞克纳 , A·冈萨雷斯 , M·休塞诺瓦 , C·E·科特赛立迪斯 , F·拉托瑞 , P·洛佩茨 , C·玛德瑞尔斯吉梅诺 , P·马库罗 , R·马丁内斯 , D·奥特加 , D·帕弗洛 , K·A·斯塔弗洛
Abstract: 公开了一种通常涉及控制多媒体扩展控制及状态寄存器(MXCSR)的装置及方法。处理器核可以包括执行运算功能的浮点单元(FPU)；以及向所述FPU提供控制位的多媒体扩展控制寄存器(MXCR)。进一步地，优化器可以用来基于指令从多个推测性多媒体扩展状态寄存器(SPEC_MXSR)中选择推测性多媒体扩展状态寄存器SPEC_MXSR，以更新多媒体扩展状态寄存器(MXSR)。
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公开(公告)号：CN107092466A
公开(公告)日：2017-08-25
申请号：CN201710265267.7
申请日：2011-12-29
Applicant: 英特尔公司
Inventor： G·玛格里斯 , J·M·康迪那 , C·B·兹尔斯 , M·奈利 , S·萨姆德若拉 , A·马丁内斯文森特 , P·谢卡拉科斯 , F·J·桑切斯 , M·卢彭 , G·突纳韦迪斯 , E·吉博特康迪那 , C·戈梅兹瑞克纳 , A·冈萨雷斯 , M·休塞诺瓦 , C·E·科特赛立迪斯 , F·拉托瑞 , P·洛佩茨 , C·玛德瑞尔斯吉梅诺 , P·马库罗 , R·马丁内斯 , D·奥特加 , D·帕弗洛 , K·A·斯塔弗洛
Abstract: 公开了一种通常涉及控制多媒体扩展控制及状态寄存器(MXCSR)的装置及方法。处理器核可以包括执行运算功能的浮点单元(FPU)；以及向所述FPU提供控制位的多媒体扩展控制寄存器(MXCR)。进一步地，优化器可以用来基于指令从多个推测性多媒体扩展状态寄存器(SPEC_MXSR)中选择推测性多媒体扩展状态寄存器SPEC_MXSR，以更新多媒体扩展状态寄存器(MXSR)。
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公开(公告)号：CN104220980A
公开(公告)日：2014-12-17
申请号：CN201180076122.3
申请日：2011-12-29
Applicant: 英特尔公司
Inventor： K·A·斯塔弗洛 , E·吉博特康迪那 , J·M·康迪那 , C·戈梅兹瑞克纳 , A·冈萨雷斯 , M·休塞诺瓦 , C·E·科特赛立迪斯 , F·拉托瑞 , P·洛佩茨 , M·卢彭 , C·玛德里斯 , G·玛格里斯 , P·马库罗 , A·马丁内斯文森特 , R·马丁内斯 , D·奥特加 , D·帕弗洛 , G·突纳韦迪斯 , P·谢卡拉科斯
CPC classification number: G06F9/3804 , G06F9/30047 , G06F9/3017 , G06F9/3802 , G06F9/3806 , G06F9/3848 , G06F12/0862 , G06F2212/452
Abstract: 本发明公开了一种用于管理从指令缓存中指令缓存预取的设备和方法。处理器可以包括：预取引擎；分支预测引擎，用于预测分支的结果；以及动态优化器。动态优化器可以用于控制：识别常见指令缓存未命中；以及将预取指令从预取引擎插入到指令缓存。
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公开(公告)号：CN104011669B
公开(公告)日：2017-12-12
申请号：CN201180075833.9
申请日：2011-12-22
Applicant: 英特尔公司
Inventor： E·G·康迪那 , J·M·康迪那 , F·拉托瑞 , P·马库罗 , P·洛佩茨 , C·戈梅兹瑞克纳 , A·冈萨雷斯 , M·休塞诺瓦 , C·E·科特赛立迪斯 , M·卢彭 , C·M·吉梅诺 , G·玛格里斯 , A·M·文森特 , R·马丁内斯 , D·奥特加 , D·帕弗洛 , K·A·斯塔弗洛 , G·突纳韦迪斯 , P·谢卡拉科斯
IPC: G06F9/30
CPC classification number: G06F9/30145 , G06F9/30087 , G06F9/30185 , G06F9/3842 , G06F9/3857 , G06F9/3863
Abstract: 用于确定是否要执行提交动作的处理器的技术和机制。在实施例中，处理器执行多项操作以确定提交指令是否用于提交动作的有条件执行。在另一个实施例中，响应于确定该提交指令用于该提交动作的有条件执行，对处理器状态的一个或多个条件进行评价，其中执行该评价以确定是否要执行该提交指令所指示的提交动作。
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