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公开(公告)号：CN109074259A
公开(公告)日：2018-12-21
申请号：CN201780026326.3
申请日：2017-04-25
Applicant: 微软技术许可有限责任公司
IPC: G06F9/38
CPC classification number: G06F9/3836 , G06F9/3005 , G06F9/3016 , G06F9/3017 , G06F9/30181 , G06F9/30185 , G06F9/3802 , G06F9/3818 , G06F9/3834 , G06F9/3838 , G06F9/3855 , G06F9/3873 , G06F9/3885 , G06F9/3889 , G06F9/3897 , G06F12/0875 , G06F15/7867
Abstract: 公开了用于实现包括现场可编程门阵列(FPGA)实现的基于块的处理器的装置和方法。在所公开的技术的一个示例中，指令译码器被配置为针对指令块中的指令集生成就绪状态数据，指令集中的每个指令与编码在事务块中的不同指令标识符相关联，并且并行指令调度器被配置为基于译码的就绪状态数据而从指令集发出指令。在一些示例中，并行指令调度器允许根据可用的FPGA部件的大小和类型的改进的面积和能量节省。
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公开(公告)号：CN108734636A
公开(公告)日：2018-11-02
申请号：CN201810360463.7
申请日：2018-04-20
Applicant: 英特尔公司
Inventor： R·巴瑞克 , E·乌尔德-阿迈德-瓦尔 , 陈晓明 , D·斯里瓦斯塔瓦 , 姚安邦 , K·尼利斯 , E·努维塔蒂 , S·S·巴格索克希 , B·韦布 , T·史佩斯曼 , P·T·唐
IPC: G06T1/20
CPC classification number: G06N3/063 , G06F9/3001 , G06F9/3017 , G06F9/3851 , G06F9/3887 , G06F9/3895 , G06N3/0445 , G06N3/0454 , G06N3/084 , G06T1/20
Abstract: 一个实施例提供一种用于执行机器学习操作的计算设备，所述设备包括用于将单指令解码为已解码指令的解码单元，所述已解码指令用于执行一个或多个机器学习操作，其中，所述解码单元用于基于所述一个或多个机器学习操作的参数来请求调度器将所述一个或多个机器学习操作调度给可编程计算单元阵列和固定功能计算单元中的一个。
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公开(公告)号：CN104583957B
公开(公告)日：2018-08-10
申请号：CN201380043003.7
申请日：2013-06-10
Applicant: 英特尔公司
Inventor： M·阿布达拉
CPC classification number: G06F9/30043 , G06F9/30032 , G06F9/30047 , G06F9/3017 , G06F9/30185 , G06F9/3826 , G06F9/3834 , G06F9/3842 , G06F9/3855 , G06F9/3857
Abstract: 在处理器中，一种无消歧乱序加载存储队列方法。该方法包括：实现能够被多个异步核心访问的存储器资源；实现存储退出缓冲器，其中来自存储队列的存储具有按照原始程序顺序的存储退出缓冲器中的条目；以及实现推测性执行，其中能够将推测性执行的结果保存在存储退出/重新排序缓冲器中作为推测性状态。该方法还包括：在分派来自加载队列的后续加载时，在存储退出缓冲器中搜索地址匹配；以及在其中存在多个地址匹配的情况下，通过针对第一匹配扫描存储退出缓冲器来定位正确的转发条目，并且将来自第一匹配的数据转发至后续加载。一旦已知推测性结果，则使推测性状态退出至存储器。
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公开(公告)号：CN108268277A
公开(公告)日：2018-07-10
申请号：CN201711239218.2
申请日：2017-11-30
Applicant: 英特尔公司
IPC: G06F9/30
CPC classification number: G06F9/30036 , G06F9/3001 , G06F9/30018 , G06F9/30021 , G06F9/30032 , G06F9/30101 , G06F9/3016 , G06F9/3017 , G06F9/3838 , G06F9/30003 , G06F9/30098 , G06F9/30145
Abstract: 提供用于运行指令的系统、设备和方法的实施例。在一些情况下，指令具有目标操作数以及第一源操作数和第二源操作数的字段。解码指令引起采用归约操作对第一打包数据源的广播打包数据元素的归约，并且在打包数据目的地中存储每个归约的结果，其中要用于归约中的第一打包数据源的打包数据元素通过在第二打包数据源中存储的打包数据元素的广播值与在没有广播的情况下的在第二打包数据源中存储的打包数据元素的比较的结果来支配。
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公开(公告)号：CN108052348A
公开(公告)日：2018-05-18
申请号：CN201810003932.X
申请日：2007-09-24
Applicant: 英特尔公司
IPC: G06F9/30 , G06F9/34 , G06F9/38 , G06F12/0875 , G06F7/06
CPC classification number: G06F9/30145 , G06F7/06 , G06F9/30 , G06F9/3001 , G06F9/30021 , G06F9/30029 , G06F9/30036 , G06F9/30098 , G06F9/30109 , G06F9/3013 , G06F9/30167 , G06F9/3017 , G06F9/30185 , G06F9/30192 , G06F9/34 , G06F9/3802 , G06F9/3824 , G06F9/3853 , G06F9/3885 , G06F9/3887 , G06F12/0875 , G06F2212/452
Abstract: 本发明提供一种用于处理文本串的指令和逻辑。用于执行串比较操作的方法、装置和程序模块。在一个实施例中，一种装置包括用来执行第一指令的执行资源。响应于所述第一指令，所述执行资源存储分别与第一和第二文本串相对应的第一和第二操作数的每个数据元素之间的比较结果。
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Patent Agency Ranking
公开(公告)号：CN108027798A
公开(公告)日：2018-05-11
申请号：CN201680053747.0
申请日：2016-11-29
Applicant: 上海兆芯集成电路有限公司
IPC: G06F15/00
CPC classification number: G06F9/3016 , G06F3/0604 , G06F3/0631 , G06F3/0673 , G06F8/41 , G06F8/443 , G06F8/447 , G06F9/22 , G06F9/28 , G06F9/30 , G06F9/3001 , G06F9/30043 , G06F9/3017 , G06F9/30174 , G06F9/30181 , G06F9/30185 , G06F9/30196 , G06F9/3836
Abstract: 一种动态配置执行资源的具有可扩展指令集架构的处理器。该处理器包括可编程执行单元(PEU)，其中可对可编程执行单元进行编程以响应于用户定义指令(UDI)来执行用户定义功能。可编程执行单元包括可编程逻辑元件和可编程互连器，可编程逻辑元件和可编程互连器被共同配置为被编程以执行至少一个处理操作。UDI加载器响应于用于指定UDI和对PEU编程所使用的编程信息的位置的UDI加载指令。可编程执行单元可以针对一个或多个UDI进行编程以用于一个或多个处理。指令表存储各UDI和相应的用以标识该UDI并根据需要可对可编程执行单元进行重新编程的信息。UDI处理程序询问指令表以标识接收到的UDI并将相应信息发送给可编程执行单元从而执行相应的用户定义功能。
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公开(公告)号：CN104714778B
公开(公告)日：2018-04-06
申请号：CN201510115612.X
申请日：2012-04-09
Applicant: 威盛电子股份有限公司
IPC: G06F9/30
CPC classification number: G06F9/441 , G06F9/265 , G06F9/30043 , G06F9/30072 , G06F9/30076 , G06F9/30105 , G06F9/30123 , G06F9/30145 , G06F9/3017 , G06F9/30174 , G06F9/30189 , G06F9/30196 , G06F9/3802 , G06F9/4401 , G06F9/4403 , G06F15/82
Abstract: 一种操作微处理器的方法，包括：检测已经发送信号以重置一微处理器，其中由微处理器执行所述检测步骤；响应于所述检测已经发送信号以重置微处理器，确定x86ISA和ARM ISA中的哪一个被微处理器的一指标指示为微处理器的启动ISA，其中由微处理器执行所述确定步骤；初始化由启动ISA定义的微处理器的一架构状态，其中由微处理器执行所述初始化步骤；将在重置之后由微处理器从架构存储空间撷取的初始ISA指令转译为微指令以作为启动ISA的指令，其中由微处理器的一硬件指令转译器执行所述转译步骤；以及执行所述微指令以产生由启动ISA定义的结果，其中由耦接到硬件指令转译器的微处理器的一执行管线执行所述执行步骤，其中该指标包括微处理器的微编码中的预设值。
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公开(公告)号：CN107347253A
公开(公告)日：2017-11-14
申请号：CN201680011565.7
申请日：2016-04-20
Applicant: 米雷普里卡技术有限责任公司
Inventor： W·约翰逊
CPC classification number: G06F9/3016 , G06F9/3017 , G06F9/3881 , G06F9/3893 , G06F9/4552 , G06F15/76 , G06F15/80 , G06T1/20
Abstract: 公开将主机对接到专用处理器的方法、设备和系统。在一个实施例中，指令生成单元包括属性、解码、以及指令缓冲级。所述属性级被配置为从所述主机接收主机-程序操作代码和虚拟主机-程序操作数，并将所述虚拟主机-程序操作数扩展成操作数描述符。所述解码级被配置为接收所述第一操作数描述符和所述主机-程序操作代码，将所述主机-程序操作代码转换为一个或多个已解码指令以便由所述专用处理器执行，以及分配存储位置以便由所述专用处理器使用。所述指令缓冲级被配置为接收所述已解码指令，将所述一个或多个已解码指令放入一个或多个指令队列中，以及从所述一个或多个指令队列的至少一个指令队列中发出已解码指令以便由所述专用处理器执行。
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公开(公告)号：CN104484157B
公开(公告)日：2017-10-24
申请号：CN201410826057.7
申请日：2007-09-24
Applicant: 英特尔公司
CPC classification number: G06F9/30145 , G06F7/06 , G06F9/30 , G06F9/3001 , G06F9/30021 , G06F9/30029 , G06F9/30036 , G06F9/30098 , G06F9/30109 , G06F9/3013 , G06F9/30167 , G06F9/3017 , G06F9/30185 , G06F9/30192 , G06F9/34 , G06F9/3802 , G06F9/3824 , G06F9/3853 , G06F9/3885 , G06F9/3887 , G06F12/0875 , G06F2212/452
Abstract: 本发明提供一种用于处理文本串的指令和逻辑。用于执行串比较操作的方法、装置和程序模块。在一个实施例中，一种装置包括用来执行第一指令的执行资源。响应于所述第一指令，所述执行资源存储分别与第一和第二文本串相对应的第一和第二操作数的每个数据元素之间的比较结果。
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公开(公告)号：CN106716346A
公开(公告)日：2017-05-24
申请号：CN201580052354.3
申请日：2015-10-02
Applicant: 高通股份有限公司
CPC classification number: G06F9/30145 , G06F9/3012 , G06F9/30141 , G06F9/3017 , G06F9/30181 , G06F9/30189 , G06F9/383 , G06F9/3832 , G06F9/3885 , G06F9/3887
Abstract: 本发明描述了用于确定指令的执行是否将需要从通用寄存器GPR的存储器单元中读取与所述存储器单元的读取端口将允许的值相比更多的值的技术。在此情况下，所述技术在所述指令的执行之前可以将来自所述存储器单元中的一或多个值存储在单独的冲突队列中。在执行所述指令以实施由所述指令限定的运算期间，将从所述存储器单元中读取作为所述运算的操作数的一个值并且将从所述冲突队列中读取作为所述其它运算的操作数的另一个值。
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