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公开(公告)号:AU2023306696A2
公开(公告)日:2025-03-27
申请号:AU2023306696
申请日:2023-06-01
Applicant: PANASONIC IP CORP AMERICA
Inventor: GAO JINGYING , TEO HAN BOON , LIM CHONG SOON , YADAV PRAVEEN KUMAR , ABE KIYOFUMI , NISHI TAKAHIRO , TOMA TADAMASA
Abstract: The present invention is provided with: a circuit; and a memory connected to the circuit. In operation, the circuit decodes a first bitstream to acquire a first image, decodes a second bitstream to acquire specification information specifying a specific region in the first image and a second image including image data of the specific region, and generates a third image on the basis of the first image, the specification information, and the second image.
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公开(公告)号:MX2025000827A
公开(公告)日:2025-03-07
申请号:MX2025000827
申请日:2022-02-23
Applicant: PANASONIC IP CORP AMERICA
Inventor: LI JING YA , LIM CHONG SOON , TEO HAN BOON , KUO CHE-WEI , SUN HAI WEI , WANG CHU TONG , ABE KIYOFUMI , NISHI TAKAHIRO , TOMA TADAMASA , KATO YUSUKE
IPC: H04N19/52 , H04N19/593
Abstract: Un codificador (100) incluye circuitos y una memoria acoplada a los circuitos. Los circuitos, en funcionamiento: determinan si un tamaño de un bloque actual, que es una unidad para la que se genera una lista de candidatos a vector que incluye candidatos a vector, es menor o igual que un umbral (S3001); cuando el tamaño del bloque actual es menor o igual que el umbral (SÍ en S3001), generan la lista de candidatos a vector registrando un candidato a vector de movimiento basado en la historia (HMVP) en la lista de candidatos a vector desde una tabla HMVP sin realizar un primer proceso de poda (S3002); cuando el tamaño del bloque actual es mayor que el umbral (NO en S3001), generan la lista de candidatos a vectores realizando el primer proceso de poda y registrando el candidato a vector HMVP en la lista de candidatos a vector desde la tabla HMVP (S3003); y codifican el bloque actual usando la lista de candidatos a vector (S3004).
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公开(公告)号:MX2025000823A
公开(公告)日:2025-03-07
申请号:MX2025000823
申请日:2021-08-06
Applicant: PANASONIC IP CORP AMERICA
Inventor: LIM CHONG SOON , SUN HAI WEI , TEO HAN BOON , LI JING YA , KUO CHE-WEI , ABE KIYOFUMI , TOMA TADAMASA , NISHI TAKAHIRO , KATO YUSUKE
IPC: H04N19/52 , H04N19/105 , H04N19/119 , H04N19/159 , H04N19/176
Abstract: Se proporciona un codificador (100) que incluye: circuitería; y una memoria acoplada a la circuitería, en el cual en operación, la circuitería: genera una imagen de predicción de un bloque actual a ser procesado, por medio del uso de un primer vector de movimiento (paso S3001); y actualiza una tabla de predictores de vectores de movimiento basados en la historia (HMVP) por medio del uso de un primer candidato que tiene el primer vector de movimiento, la tabla de HMVP almacena, en un método de primera entrada-primera salida (FIFO), una pluralidad de segundos candidatos cada uno que tiene un segundo vector de movimiento usado para un bloque procesado (paso S3002), y en la actualización de la tabla de HMVP, la circuitería: determina si un tamaño del bloque actual es menor que o igual a un tamaño umbral (paso S30021); y omite la actualización de la tabla de HMVP (paso S30022) cuando se determina que el tamaño del bloque actual es menor que o igual al tamaño umbral (Si en el paso S30021).
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公开(公告)号:AU2023202734B2
公开(公告)日:2025-02-13
申请号:AU2023202734
申请日:2023-05-02
Applicant: PANASONIC IP CORP AMERICA
Inventor: ABE KIYOFUMI , NISHI TAKAHIRO , TOMA TADAMASA , KANOH RYUICHI , LIM CHONG SOON , LIAO RU LING , SUN HAI WEI , SHASHIDHAR SUGHOSH PAVAN , TEO HAN BOON , LI JING YA
IPC: H04N19/117 , H04N19/157 , H04N19/80
Abstract: An image encoder is provided, which includes circuitry and a memory coupled to the circuitry. The circuitry, in operation, performs a boundary smoothing operation along a boundary between a first partition having a non-rectangular shape (e.g., a triangular shape) and a second partition that are split from an image block. The boundary smoothing operation includes: first-predicting first values of a set of pixels of the first partition along the boundary, using information of the first partition; second-predicting second values of the set of pixels of the first partition along the boundary, using information of the second partition; weighting the first values and the second values; and encoding the first partition using the weighted first values and the weighted second values.
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公开(公告)号:AU2023306696A1
公开(公告)日:2025-01-23
申请号:AU2023306696
申请日:2023-06-01
Applicant: PANASONIC IP CORP AMERICA
Inventor: GAO JINGYING , TEO HAN BOON , LIM CHONG SOON , YADAV PRAVEEN KUMAR , ABE KIYOFUMI , NISHI TAKAHIRO , TOMA TADAMASA
Abstract: The present invention is provided with: a circuit; and a memory connected to the circuit. In operation, the circuit decodes a first bitstream to acquire a first image, decodes a second bitstream to acquire specification information specifying a specific region in the first image and a second image including image data of the specific region, and generates a third image on the basis of the first image, the specification information, and the second image.
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公开(公告)号:MX2024004992A
公开(公告)日:2024-05-07
申请号:MX2024004992
申请日:2020-02-18
Applicant: PANASONIC IP CORP AMERICA
Inventor: LIM CHONG SOON , SUN HAI WEI , TOMA TADAMASA , NISHI TAKAHIRO , ABE KIYOFUMI , KANOH RYUICHI , SHASHIDHAR SUGHOSH PAVAN , TEO HAN BOON , LIAO RU LING , LI JING YA
IPC: H04N19/537 , H04N19/105 , H04N19/157 , H04N19/96
Abstract: Se proporciona un codificador de imagen el cual incluye conjunto de circuitos y una memoria acoplada al conjunto de circuitos. En operación, el conjunto de circuitos realiza: división de un bloque de imagen en una pluralidad de divisiones que incluyen una primera división que tiene una forma no rectangular (por ejemplo, una forma triangular) y una segunda división; predecir un primer vector de movimiento para la primera división y un segundo vector de movimiento para la segunda división; y codificar la primera división usando el primer vector de movimiento y la segunda división usando el segundo vector de movimiento.
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公开(公告)号:MX2024004987A
公开(公告)日:2024-05-07
申请号:MX2024004987
申请日:2020-02-18
Applicant: PANASONIC IP CORP AMERICA
Inventor: LIM CHONG SOON , SUN HAI WEI , TOMA TADAMASA , NISHI TAKAHIRO , ABE KIYOFUMI , KANOH RYUICHI , SHASHIDHAR SUGHOSH PAVAN , TEO HAN BOON , LIAO RU LING , LI JING YA
IPC: H04N19/537 , H04N19/105 , H04N19/157 , H04N19/96
Abstract: Se proporciona un codificador de imagen el cual incluye conjunto de circuitos y una memoria acoplada al conjunto de circuitos. En operación, el conjunto de circuitos realiza: división de un bloque de imagen en una pluralidad de divisiones que incluyen una primera división que tiene una forma no rectangular (por ejemplo, una forma triangular) y una segunda división; predecir un primer vector de movimiento para la primera división y un segundo vector de movimiento para la segunda división; y codificar la primera división usando el primer vector de movimiento y la segunda división usando el segundo vector de movimiento.
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公开(公告)号:AU2024200587A1
公开(公告)日:2024-02-22
申请号:AU2024200587
申请日:2024-01-31
Applicant: PANASONIC IP CORP AMERICA
Inventor: LI JING YA , LIM CHONG SOON , SHASHIDHAR SUGHOSH PAVAN , LIAO RU LING , SUN HAI WEI , TEO HAN BOON , ABE KIYOFUMI , TOMA TADAMASA , NISHI TAKAHIRO
IPC: H04N19/52
Abstract: An encoder includes circuitry and memory connected to the circuitry. In operation, the circuitry corrects a base motion vector using a correction value 5 in a fixed direction; and encodes a current partition by using the corrected base motion vector corrected. The correction value is specified by an index indicating one of correction values included in a table. The table is selected from among a plurality of tables, wherein the correction values in one of the plurality of tables have different increments from the correction values in 10 another one of the plurality of tables. 205300261(
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公开(公告)号:BR112021017765A2
公开(公告)日:2022-04-26
申请号:BR112021017765
申请日:2020-06-15
Applicant: PANASONIC IP CORP AMERICA
Inventor: ABE KIYOFUMI , TOMA TADAMASA , NISHI TAKAHIRO , KATO YUSUKE
IPC: H04N19/577
Abstract: codificador, descodificador, método de codificação e método de decodificação. a presente invenção refere-se a um codificador (100) que inclui circuitos e memória conectada aos circuitos. o circuito, em operação: deriva, como primeiro parâmetro, uma soma total dos valores absolutos das somas dos valores de gradiente horizontal, respectivamente, para pares de posições relativas dos pixels; deriva, como um segundo parâmetro, uma soma total de valores absolutos de somas de valores de gradiente vertical, respectivamente, para os pares de posições de pixel relativas; deriva, como um terceiro parâmetro, uma soma total de valores de diferença de pixel relacionados à horizontal, respectivamente, para os pares de posições de pixel relativas; deriva, como um quarto parâmetro, uma soma total de valores de diferença de pixel relacionados à vertical, respectivamente, para os pares de posições de pixel relativas; deriva, como um quinto parâmetro, uma soma total de somas relacionadas à vertical de valores de gradiente horizontal, respectivamente, para os pares de posições de pixel relativas; e gera uma imagem de previsão a ser usada para codificar o bloco atual usando o primeiro, segundo, terceiro, quarto e quinto parâmetros.
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公开(公告)号:BR112021023637A2
公开(公告)日:2022-03-29
申请号:BR112021023637
申请日:2020-06-18
Applicant: PANASONIC IP CORP AMERICA
Inventor: ABE KIYOFUMI , TOMA TADAMASA , NISHI TAKAHIRO , DRUGEON VIRGINIE , KATO YUSUKE
IPC: H04N19/70
Abstract: codificador, decodificador, método de codificação, e método de decodificação. a presente invenção refere-se a um codificador (100) incluindo memória (a2) e circuitos (a1) acoplados à memória (a2) (incluindo os métodos associados). o circuito (a1), para cada uma das subcamadas temporais para escalabilidade temporal diferente da escalabilidade espacial, armazena os primeiros parâmetros nas informações de melhoria complementares (sei) do período de armazenamento em buffer e codifica os primeiros parâmetros. os primeiros parâmetros apresentam atrasos iniciais na temporização para extrair dados de um buffer de imagem codificado (cpb). o circuito (a1) armazena um segundo parâmetro no período de buffer sei e codifica o segundo parâmetro. o segundo parâmetro indica um número total de subcamadas temporais. um valor do segundo parâmetro é igual a um valor de um terceiro parâmetro que é codificado em um conjunto de parâmetros de sequência e indica um número total de subcamadas temporais.
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