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公开(公告)号：KR100213940B1
公开(公告)日：1999-08-02
申请号：KR1019970041594
申请日：1997-08-27
Applicant: 전자부품연구원
IPC: C04B35/64
Abstract: 본 발명은 중심부에 관통되는 구멍을 갖는 몸체와, 상기 중심부에 관통된 구멍에 삽입되고 상기 몸체의 상부 표면과 평행을 이루는 중심봉과, 상기 몸체의 하부에서 상기 중심봉에 의하여 마련된 공간에 소정 높이로 삽입되어 상하로 이동가능하고 상기 중심봉을 지지하는 하부 펀치와, 상기 몸체의 상부에서 상기 중심봉에 마련된 공간에 소정 깊이로 삽입되고 상하로 이동 가능한 상부 펀치를 포함하여 이루어지는 것을 특징으로 하는 성형체 제조형 금형을 제공하는 데 있다. 상기 몸체의 상부 표면에 상기 몸체의 표면 이상 높이로 주입된 분말을 제거하기 위한 수평 지그를 더 구비할 수 있다. 또한, 상기 하부 펀치가 삽입된 소정 높이는 상기 몸체의 중심 이상의 높이로 구성한다. 본 발명은 성형체 제조시에 생기는 미세균열등의 결함과 성형 밀도 변화에 의한 두께 편차를 제거하여 균일한 성형체를 형성할 수 있다.
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公开(公告)号：KR1019990027840A
公开(公告)日：1999-04-15
申请号：KR1019970050370
申请日：1997-09-30
Applicant: 전자부품연구원
IPC: H01F17/00
Abstract: 본 발명의 적층 세라믹 트랜스포머는 표면에 각각 1차 코일 및 2차 코일 연결전극이 형성되고 측면에 외부 단자 전극이 형성된 페라이트 기판과, 상기 페라이트 기판 상에 탑재되고, 상기 1차 코일 및 2차 코일 연결전극과 접속전극을 통하여 연결되는 1차 코일 및 2차 코일이 형성되어 있고 가운데에 구멍을 갖는 적층 세라믹 코일과, 상기 적층 세라믹 코일 상에 탑재되고 상기 적층 세라믹 코일의 구멍에 끼워지는 돌출부을 갖는 페라이트 코어를 포함한다. 본 발명의 적층 세라믹 트랜스포머는 고주파 스위칭 트랜스포머로써 사용할 경우에도 누설자속에 의한 외부로의 전자파 노이즈의 방사문제를 해결할 수 있다.
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公开(公告)号：KR1019990012954A
公开(公告)日：1999-02-25
申请号：KR1019970036536
申请日：1997-07-31
Applicant: 전자부품연구원
IPC: H01L23/48
Abstract: 본 발명은 복수개의 그린 쉬트를 적층한 적층체를 절단한 후 소성하여 만들어지는 적층 세라믹 부품의 제조방법에 있어서, 상기 적층체의 절단은 상기 그린 쉬트의 크기보다 작은 치수의 절단날을 이용하여 수행하는 것을 특징으로 하는 적층 세라믹 부품의 제조방법을 제공한다. 상기 적층체의 절단시 상기 그린 쉬트에 형성된 전극 패턴의 외부에 형성된 절단선을 이용하여 수행할 수 있다. 본 발명의 적층 세라믹 부품의 제조방법에 적용되는 적층체의 절단방법은 그린 쉬트보다 작은 절단날과 절단선을 이용하여 수행하기 때문에, 적층 세라믹 부품의 치수 정밀도을 향상시킬 수 있고 특성에 편차가 없게 할 수 있다.
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公开(公告)号：KR100243359B1
公开(公告)日：2000-02-01
申请号：KR1019970060600
申请日：1997-11-17
Applicant: 전자부품연구원
IPC: H01F10/20
Abstract: 본 발명의 적층형 페라이트 인덕터는 사각기둥의 모양을 갖는 페라이트 성형체와, 상기 페라이트 성형체의 외부를 둘러싸며 그 표면에 제1 노출 전극 및 제2 노출 전극을 갖고 그 내부에 상기 제1 노출 전극 및 제2 노출 전극을 연결하는 코일 패턴이 형성된 제1 그린 쉬트와, 상기 제1 그린 쉬트의 외부를 둘러싸는 제2 그린 쉬트와, 상기 제1 노출 전극 및 제2 노출 전극 상의 각각에 형성된 외부전극을 포함한다. 본 발명의 적층형 페라이트 인덕터의 코일 패턴이 비아홀에 의하여 연결되지 않아 단락되지 않으므로 적층형 페라이트 인덕터의 신뢰성을 향상시킬 수 있다.
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公开(公告)号：KR100238777B1
公开(公告)日：2000-01-15
申请号：KR1019970036538
申请日：1997-07-31
Applicant: 전자부품연구원
Abstract: 적층세라믹 부품제조용 지그에 관하여 개시한다. 이를 위한 본 발명은 복수개의 수직 및 수평홀이 형성된 패드와, 상기 패드에 형성된 수직홀에 마련되며, 상기 패드의 상면으로 부터 상하 수직운동이 가능하도록 마련된 복수개의 핀 및, 상기 패드의 내부에서 상기 복수개의 핀과 단부가 각각 접촉되며, 핀에 상하 수직운동을 제공하는 핀 조절수단을 구비하는 것을 특징으로 하며, 본 발명의 지그는 핀의 높이를 자유로이 조절하거나 또는 핀을 선택적으로 사용할 수 있기 때문에, 하나의 지그만으로 여러 가지 크기의 그린시트를 안착하여 다층 세라믹 부품을 제조할 수 있다. 따라서 해당크기의 지그를 필요시마다 제작해야 하는 번거로움을 덜 수 있고, 아울러 원가 절감의 효과가 있다.
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Patent Agency Ranking
公开(公告)号：KR1019990079688A
公开(公告)日：1999-11-05
申请号：KR1019980012422
申请日：1998-04-08
Applicant: 전자부품연구원
IPC: H01L21/28
Abstract: 본 발명은 고주파통신 회로에서 신호전력의 측정과 신호전력의 분배 및 합성 등에 사용되는 적층구조의 세라믹 커플러를 소형화 시킬수 있는 방법을 제공하는데 목적이 있다.
상기 목적을 달성하기 위한 본 발명의 커플러 제조방법은 그린시트 상에 정해진 위치에 홀을 펀칭하여 형성된 비아홀에 도전성 페이스트를 충진하고 원하는 길이의 전송로를 얻을 수 있도록 내부 회로를 패터닝 하는 회로 그린시트 형성공정과, 상기 회로 그린시트 상의 비아홀에 맞추어 비아홀을 형성하며 상기 회로 그린시트 적층시 층간 실드를 위해 층간 접속용 비아홀 부위를 오픈시킨 그라운드 전극패턴을 형성하여 접지 그린시트를 형성하는 공정과, 상기 회로 그린시트와 그라운드 전극 패턴이 형성된 접지 그린시트를 비아홀을 일치시켜 교대로 적층하는 공정과, 상기 적층된 그린시트를 정해진 절단선을 따라 절단하여 소성하는 공정을 포함한다.-
公开(公告)号：KR200149425Y1
公开(公告)日：1999-06-15
申请号：KR2019950055222
申请日：1995-12-30
Applicant: 전자부품연구원
IPC: H01L21/66
Abstract: 본 고안은 그린 쉬트(green sheet)의 픽업장치에 관한 것으로서, 더 상세하게는 전자석을 이용하여 베이스 필름(base film)에서 그린 쉬트를 변형없이 효과적으로 픽업하는 그린 쉬트의 픽업장치에 관한 것이다. 이를 위한 본 고안은, 자성체 성분이 포함되어 있으며 적층형 LC 필터 또는 인덕터와 같은 적층형 소자에 이용되는 그린 쉬트를 소정의 베이스 필름에서 픽업하여 이송하는 그린 쉬트의 픽업장치에 있어서, 상기 그린 쉬트를 일정한 크기로 절단하는 그린 쉬트 절단수단과, 절단된 그린 쉬트에 자력을 가하여 자화시킴과 동시에 이를 픽업하는 자화 픽업 수단 및 상기 자화픽업 수단에 픽업된 그린 쉬트를 공기를 이용하여 상기 자화픽업 수단으로부터 분리하기 위한 그린 쉬트 분리수단을 포함함으로써, 절단된 그린 쉬트를 변형없이 효과적으로 픽업하여 이송하는 이점을 제공한다.
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公开(公告)号：KR1019990040271A
公开(公告)日：1999-06-05
申请号：KR1019970060600
申请日：1997-11-17
Applicant: 전자부품연구원
IPC: H01F10/20
Abstract: 본 발명의 적층형 페라이트 인덕터는 사각기둥의 모양을 갖는 페라이트 성형체와, 상기 페라이트 성형체의 외부를 둘러싸며 그 표면에 제1 노출 전극 및 제2 노출 전극을 갖고 그 내부에 상기 제1 노출 전극 및 제2 노출 전극을 연결하는 코일 패턴이 형성된 제1 그린 쉬트와, 상기 제1 그린 쉬트의 외부를 둘러싸는 제2 그린 쉬트와, 상기 제1 노출 전극 및 제2 노출 전극 상의 각각에 형성된 외부전극을 포함한다. 본 발명의 적층형 페라이트 인덕터의 코일 패턴이 비아홀에 의하여 연결되지 않아 단락되지 않으므로 적층형 페라이트 인덕터의 신뢰성을 향상시킬 수 있다.
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公开(公告)号：KR100292839B1
公开(公告)日：2001-09-17
申请号：KR1019980021899
申请日：1998-06-12
Applicant: 전자부품연구원
Abstract: 이중 대역 세라믹 칩 안테나를 개시한다. 이러한 이중 대역 세라믹 칩 안테나는 세라믹 유전체를 재료로 하여 직육면체로 형성되는 본체와, 본체 내부에 독립적으로 형성되는 두 개의 헬리컬 도체를 포함한다. 각 헬리컬 도체는 나선형으로 형성되며 각 나선 회전축은 본체의 밑면과 옆면에 각각 평행하다. 각 헬리컬 도체의 길이 등을 다르게 형성함으로서 각 헬리컬 도체의 사용 주파수 대역이 달라지게 된다. 따라서 두 개의 주파수 대역을 사용할 수 있으며, 크기가 작아서 휴대 단말기에 내장이 가능하고, 또한 비교적 넓은 밴드 폭을 갖는다.
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公开(公告)号：KR100248196B1
公开(公告)日：2000-03-15
申请号：KR1019970047362
申请日：1997-09-13
Applicant: 전자부품연구원
IPC: H01G4/12
Abstract: 본 발명의 적층 세라믹 부품의 제조방법은 복수개의 그린 쉬트를 압착하여 더미용 압착 그린쉬트를 형성하는 단계와, 상기 더미용 압착 그린 쉬트에 펀칭 공정으로 비아홀을 형성하는 단계와, 상기 비아홀에 금속 페이스트를 필링하는 단계와, 상기 금속 페이스트를 커버하도록 상기 더미용 압착 그린 쉬트 상에 회로 패턴을 형성하는 단계와, 상기 회로 패턴이 형성된 더미용 압착 그린 쉬트를 복수개 적층한 후 소결하는 단계를 포함한다. 본 발명의 적층 세라믹 부품의 제조방법에 의하면, 회로 패턴이 없는 더미용 그린 쉬트들을 압착한 후 비아홀 형성, 비아 필링의 공정을 한번에 행함으로써 이에 따른 시간과 비용을 절감할 수 있다.
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