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公开(公告)号：KR100622945B1
公开(公告)日：2006-09-19
申请号：KR1020040058555
申请日：2004-07-27
Applicant: 재단법인서울대학교산학협력재단 , 삼성전자주식회사
IPC: G06F9/38
CPC classification number: G06F8/4434
Abstract: 본 발명은 하나의 명령으로 메모리에 저장되어 있는 복수 개의 데이터들을 전달하는 방안을 제안한다. 이를 위해 각 영역별로 어드레스가 할당된 적어도 2개의 영역들로 구성된 메모리에서, 데이터들을 각 어드레스에 순차적으로 할당하고, 상기 어드레스 할당된 데이터들을 하나의 명령으로 전달하게 된다. 즉, 하나의 명령으로 구성하고 있는 데이터들을 전달하는 적어도 하나의 블록을 생성하고, 데이터를 상기 블록들 중 적어도 하나의 블록에 구성되도록 지시한다. 상기 블록을 구성하고 있는 데이터들을 상호 연결하고, 상기 블록들에 대해 동일한 데이터들을 상호 연결한 경로의 합들을 산출하고, 상기 연결한 경로의 합을 고려하여 상기 데이터들을 최소 경로로 연결한다. 상기 최소 경로를 이용하여 상기 데이터들을 어드레스별로 순차적으로 할당한다.
메모리, 레지스터, 어드레스, MLS-
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公开(公告)号：KR101783312B1
公开(公告)日：2017-10-10
申请号：KR1020110119147
申请日：2011-11-15
Applicant: 삼성전자주식회사
CPC classification number: G06F9/30032 , G06F9/3828
Abstract: 클러스터(Cluster) 간의값의복사또는이동에따른오버헤드를최소화하는기술에관한것으로, 코드생성시 mov 명령어등과같이클러스터간의값을이동하거나복사하는명령어들이최소화되도록함으로써클러스터외부의레지스터파일에접근하는것을최소화하여클러스터구조를가진슈퍼스칼라(superscalar)나 VLIW 프로세서등 모든프로세서에서사용되는코드의성능을향상시킬수 있다.
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公开(公告)号：KR101756820B1
公开(公告)日：2017-07-12
申请号：KR1020100103095
申请日：2010-10-21
Applicant: 삼성전자주식회사
CPC classification number: G06F9/5066
Abstract: 중첩루프에포함된내부루프및 외부루프를병합하고, 병합된루프를프로세싱엘리먼트(processing element; PE)에병렬적으로할당함으로써, 중첩루프의처리시간을단축할수 있는재구성가능프로세서및 방법이개시된다. 재구성가능프로세서는중첩루프(nested loop)에포함된내부루프(inner loop) 및외부루프(outer loop)로부터루프실행횟수정보를추출하고, 추출된루프실행횟수정보에기초하여상기내부루프및 상기외부루프를병합한다.
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Patent Agency Ranking
公开(公告)号：KR1020170065085A
公开(公告)日：2017-06-13
申请号：KR1020150170966
申请日：2015-12-02
Applicant: 삼성전자주식회사
Inventor： 유창훈 , 김원진 , 김현식 , 문선호 , 안민욱 , 김락기 , 조경수 , 니쿤쥬사운시 , 파리차이카푸르 , 아가왈판카즈 , 김원섭 , 김진효 , 김형훈 , 오지수 , 이경호 , 이승범 , 이진석 , 장동기 , 조수빈 , 아뿌르브칸살
CPC classification number: G06F9/50 , G06F12/02 , G06F12/0882
Abstract: 본개시는다양한상황에서시스템리소스관리에관한것이다. 본개시에서는전자장치가데이터에대한특정연산을위해패딩(padding)을할 경우메모리요구량을줄이고처리속도를향상시키기방법및 장치를제공한다. 상술한목적을달성하기위한본 개시에서전자장치의동작방법은, 제1 메모리로부터데이터의제1 일부를읽는과정과, 제1 일부에포함된다수의바이트들중 데이터의경계영역에속하는바이트의주소에기반하여제1 패딩주소를결정하는과정과, 다수의바이트들의값과제1 패딩주소에대응하는값을제2 메모리에쓰는과정과, 제1 메모리로부터데이터의제2 일부를읽는과정을포함한다.
Abstract translation: 本公开涉及在各种情况下的系统资源管理。 本公开提供了一种用于在电子设备针对数据进行特定操作时进行缓冲时减少存储器需求并提高处理速度的方法和装置。 根据本发明的另一方面，提供了一种操作电子设备的方法，包括：从第一存储器读取第一部分数据; 将对应于多个字节的值任务的填充地址的值写入第二存储器，并且从第一存储器读取数据的第二部分; 。
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公开(公告)号：KR101722695B1
公开(公告)日：2017-04-04
申请号：KR1020100109998
申请日：2010-11-05
Applicant: 삼성전자주식회사
Abstract: 메모리액세스명령들간의의존관계를분석하고, 분석된결과에기초하여명령들을다수의프로세싱엘리먼트에할당함으로써, 잘못된연산을줄일수 있는재구성가능프로세서및 제어방법이개시된다. 시뮬레이션결과로부터연산트레이스를추출하고, 연산트레이스중 메모리액세스명령에해당하는트레이스에기초하여, 이터레이션들에포함된명령들간의메모리의존관계를분석한다.
Abstract translation: 公开了一种可重构处理器和控制方法，其可以通过分析存储器访问指令之间的依赖性并基于分析结果将指令分配给多个处理元件来减少错误的操作。 从仿真结果中提取操作轨迹，并根据操作轨迹中与存储器访问指令对应的轨迹分析迭代中包含的指令之间的内存依赖关系。
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公开(公告)号：KR1020160046149A
公开(公告)日：2016-04-28
申请号：KR1020140141694
申请日：2014-10-20
Applicant: 삼성전자주식회사
CPC classification number: G06F9/30087 , G06F9/06 , G06F9/30 , G06F9/3012 , G06F9/30167 , G06F9/34
Abstract: 피연산자인상수를구성하는제 1 상수부및 제 2 상수부중 제 1 명령어에포함된제 1 상수부를레지스터에저장하는단계, 제 2 명령어에포함된제 2 상수부를저장된제 1 상수부와연결(catenate)하여상수를결정하는단계및 제 2 명령어가지시하는값과결정된상수를이용하여연산을수행하는단계를포함하는데이터처리방법이개시된다.
Abstract translation: 一种数据处理方法，包括：在寄存器中存储包括在第一命令中的第一辅音单元在第一辅音单元和构成作为操作数的辅音的第二辅音单元之间的步骤; 将包含在第二命令中的第二个辅音单元连接到第一辅音单元以确定辅音的步骤; 以及基于所确定的辅音执行计算的步骤和由第二命令指定的值。 本发明的目的是提供数据处理方法来提高数据处理速度。
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公开(公告)号：KR1020120052750A
公开(公告)日：2012-05-24
申请号：KR1020100114044
申请日：2010-11-16
Applicant: 삼성전자주식회사
CPC classification number: G06F15/7867 , G06F8/452 , G06F9/38 , G06F9/3853 , G06F9/3897 , G06F11/3409 , G06F9/22
Abstract: PURPOSE: An apparatus and method for dynamically determining a practice mode of a reconfigurable array are provided to practice a loop in the optimum practice mode by dynamically determining a practice mode of the loop based on performance information and an estimate value of running time. CONSTITUTION: A performance information acquisition unit(301) obtains performance information showing running time according to loop repeat count at the VLIW(Very Long Instruction Word) mode and the CGA(Coarse Grained Array) mode. A running time estimating unit(302) obtains an estimate value in regard to the running time of a loop. A code generating unit(303) creates a CGA code of the loop for the CGA mode and a VLIW cod for the VLIW mode. A mode determining unit(304) selects the CGA code or the CGA code by using the performance information and the estimate value.
Abstract translation: 目的：提供用于动态地确定可重构阵列的练习模式的装置和方法，以通过基于性能信息和运行时间的估计值动态地确定循环的练习模式来在最佳练习模式中练习循环。 构成：性能信息获取单元（301）根据VLIW（超长指令字）模式和CGA（粗粒度阵列）模式下的循环重复计数获得表示运行时间的性能信息。 运行时间估计单元（302）获得关于循环的运行时间的估计值。 代码生成单元（303）创建用于CGA模式的循环的CGA代码和用于VLIW模式的VLIW代码。 模式确定单元（304）通过使用演奏信息和估计值来选择CGA码或CGA码。
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公开(公告)号：KR1020120041581A
公开(公告)日：2012-05-02
申请号：KR1020100103095
申请日：2010-10-21
Applicant: 삼성전자주식회사
CPC classification number: G06F9/5066 , G06F9/38 , G06F15/7892
Abstract: PURPOSE: A reconfigurable processor and a method thereof are provided to reduce processing time and code length of a superposition loop by allocating a loop to a PE. CONSTITUTION: An extracting unit(105) extracts loop execution count information from inner and outer loops in a superposition loop. A loop merger(110) merges the inner and outer loops based on the loop execution count information. A scheduler(120) allocates a command of the inner loop to a PE(Processing Element).
Abstract translation: 目的：提供可重构处理器及其方法，通过向PE分配循环来减少叠加循环的处理时间和代码长度。 构成：提取单元（105）从叠加循环中的内圈和外圈提取循环执行计数信息。 循环合并（110）根据循环执行计数信息合并内循环和外循环。 调度器（120）将内部循环的命令分配给PE（处理单元）。
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